Luciano Volcan Agostini

É professor da Universidade Federal de Pelotas (UFPel) desde 2002, onde lidera o Grupo de Arquiteturas e Circuitos Integrados - GACI e o Video Technology Research Group (ViTech). Realizou pós-doutoramento na Universidade de Lisboa (entre 2017 e 2018). É doutor (2007) e mestre (2002) em Ciências da Computação pela Universidade Federal do Rio Grande do Sul e bacharel em Informática pela UFPel (1998). Foi Pró-Reitor de Pesquisa e Pós-Graduação da UFPel entre 2013 e 2017. Foi Presidente do Conselho Municipal de Ciência e Tecnologia de Pelotas-RS entre 2013 e 2017. Foi membro de Comitês de Assessoramento da Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul (FAPERGS) entre 2013 e 2019. Possui diversos prêmios de melhor artigo em eventos internacionais e nacionais. É Editor Associado da IEEE Transactions on Circuits for Video Technology (TCSVT) e do IEEE Open Journal of Circuits and Systems (OJCAS) e Editor Convidado da IEEE Transactions on Circuits and Systems I: Regular Papers (TCAS-I). Foi Editor Convidado da Springer Analog Integrated Circuits and Signal Processing (ALOG).Tem experiência na área de Ciência da Computação, com ênfase em sistemas digitais, arquitetura e organização de computadores e compressão de dados. Sua pesquisa é concentrada nos seguintes temas: projeto de hardware para compressão de imagens e vídeos, algoritmos para compressão de vídeos, codificadores AV1, VVC, VP9, HEVC e H.264/AVC, codificação 3D, 360, light fields e nuvens de pontos, projeto digital com FPGAs e ASICs e microeletrônica. É Senior Member da IEEE e da ACM. Na IEEE faz parte da IEEE CAS, da IEEE SP e da IEEE CS. Na IEEE CAS é membro eleito do Multimedia Systems & Applications Technical Committee (MSATC). É membro da SBC e da SBMicro. É integrante do Conselho da SBMicro e do Steering do SBCCI. ORCID:

Informações coletadas do Lattes em 22/06/2020

Acadêmico

Seção coletada automaticamente pelo Escavador

Formação acadêmica

Doutorado em Computação

2002 - 2007

Universidade Federal do Rio Grande do Sul
Título: Desenvolvimento de Arquiteturas de Alto Desempenho Dedicadas à Compressão de Vídeo Segundo o Padrão H.264/AVC
Sergio Bampi. Bolsista do(a): Conselho Nacional de Desenvolvimento Científico e Tecnológico, CNPq, Brasil. Palavras-chave: Compressão de Vídeo; H.264/AVC; Arquiteturas para Compressão de Vídeo.Grande área: Ciências Exatas e da TerraGrande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação / Especialidade: Microeletrônica. Grande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Metodologia e Técnicas da Computação / Especialidade: Processamento Gráfico (Graphics). Setores de atividade: Fabricação de Material Eletrônico e de Aparelhos e Equipamentos de Comunicações.

Mestrado em Computação

1999 - 2002

Universidade Federal do Rio Grande do Sul
Título: Projeto de Arquiteturas Integradas para a Compressão de Imagens JPEG,Ano de Obtenção: 2002
Sergio Bampi.Bolsista do(a): Coordenação de Aperfeiçoamento de Pessoal de Nível Superior, CAPES, Brasil. Palavras-chave: Compressão de Imagens; Compressão JPEG; Arquiteturas para a compressão de imagens; Arquiteturas para a compressão JPEG.Grande área: Ciências Exatas e da TerraGrande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação / Especialidade: Microeletrônica. Grande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Metodologia e Técnicas da Computação / Especialidade: Processamento Gráfico (Graphics). Setores de atividade: Fabricação de Material Eletrônico e de Aparelhos e Equipamentos de Comunicações.

Graduação em Bacharelado Em Informática

1995 - 1998

Universidade Federal de Pelotas

Curso técnico/profissionalizante em Eletrônica

1990 - 1994

Escola Técnica Federal de Pelotas

Seção coletada automaticamente pelo Escavador

Pós-doutorado

2017 - 2018

Pós-Doutorado. , Universidade de Lisboa, UL, Portugal. , Bolsista do(a): Coordenação de Aperfeiçoamento de Pessoal de Nível Superior, CAPES, Brasil. , Grande área: Ciências Exatas e da Terra, Grande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação.

Seção coletada automaticamente pelo Escavador

Formação complementar

2013 - 2013

LINCE. (Carga horária: 48h). , Master Mind - Treinamentos de Alta Performance, MASTERMIND, Brasil.

2008 - 2008

Escola de Microeletrônica. (Carga horária: 40h). , Sociedade Brasileira de Computação - Porto Alegre, SBC, Brasil.

2006 - 2006

Escola de Microeletrônica. (Carga horária: 40h). , Sociedade Brasileira de Computação - Porto Alegre, SBC, Brasil.

2004 - 2004

Escola de Microeletrônica. (Carga horária: 40h). , Sociedade Brasileira de Computação - Porto Alegre, SBC, Brasil.

2003 - 2003

V Escola de Microeletrônica da Sbc Sul. (Carga horária: 40h). , Universidade Federal do Rio Grande, FURG, Brasil.

2001 - 2001

III Escola de Microeletrônica da Sbc Sul. (Carga horária: 40h). , Universidade Federal de Santa Maria, UFSM, Brasil.

2000 - 2000

II Escola de Microeletrônica da Sbc Sul. (Carga horária: 40h). , Universidade Luterana do Brasil, ULBRA, Brasil.

2000 - 2000

Interfacing Microsystems. , Fundação Centro Tecnológico Para Informática, CTI, Brasil.

1999 - 1999

Ieee International Cas Tour In South America. (Carga horária: 16h). , Universidade Federal de Santa Catarina, UFSC, Brasil.

1999 - 1999

Dispositivos Semicondutores. (Carga horária: 12h). , Pontifícia Universidade Católica do Rio Grande do Sul, PUCRS, Brasil.

1999 - 1999

I Escola de Microeletrônica da Sbc Sul. (Carga horária: 40h). , Universidade Federal de Pelotas, UFPEL, Brasil.

1998 - 1998

Introdução Ao Sistema Operacional Linux. (Carga horária: 8h). , Universidade Federal de Pelotas, UFPEL, Brasil.

1998 - 1998

Design de Software Educativo. (Carga horária: 4h). , Universidade Federal de Santa Maria, UFSM, Brasil.

1998 - 1998

Testes de Software. (Carga horária: 4h). , Universidade Federal de Santa Maria, UFSM, Brasil.

1998 - 1998

Objetos Distribuídos. (Carga horária: 4h). , Universidade Federal de Santa Maria, UFSM, Brasil.

1998 - 1998

VI Escola Regional de Informática. (Carga horária: 40h). , Sociedade Brasileira de Computação Regional Sul, SBC-SUL, Brasil.

1997 - 1997

V Escola Regional de Informática. (Carga horária: 33h). , Sociedade Brasileira de Computação Regional Sul, SBC-SUL, Brasil.

1996 - 1996

IV Escola Regional de Informática. , Sociedade Brasileira de Computação Regional Sul, SBC-SUL, Brasil.

1995 - 1995

III Escola Regional de Informática. (Carga horária: 33h). , Sociedade Brasileira de Computação Regional Sul, SBC-SUL, Brasil.

1993 - 1993

Automação Industrial. (Carga horária: 56h). , Escola Técnica Federal de Pelotas, ETFPEL, Brasil.

Seção coletada automaticamente pelo Escavador

Idiomas

Inglês

Compreende Bem, Fala Razoavelmente, Lê Bem, Escreve Bem.

Espanhol

Compreende Bem, Fala Razoavelmente, Lê Razoavelmente, Escreve Pouco.

Português

Compreende Bem, Fala Bem, Lê Bem, Escreve Bem.

Seção coletada automaticamente pelo Escavador

Áreas de atuação

    Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Codificação de Imagens e Vídeos.

    Grande área: Engenharias / Área: Engenharia Elétrica / Subárea: Microeletrônica.

    Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas Digitais.

Seção coletada automaticamente pelo Escavador

Organização de eventos

AGOSTINI, LUCIANO VOLCAN . ISCAS 2019 - IEEE International Symposium on Circuits and Systems - Review Committee Member (RCM). 2019. (Congresso).

AGOSTINI, L. V. . ICECS 2019 - 26th IEEE International Conference on Electronics Circuits and Systems - Track Chair: Signal Image and Video Processing Architectures. 2019. (Congresso).

AGOSTINI, L. V. . SBCCI 2018 - 31th Symposium on Integrated Circuits and Systems Design - General Chair. 2018. (Congresso).

AGOSTINI, L. V. . SBMicro 2018 - 33rd Symposium on Microelectronics Technology and Devices - General Chair. 2018. (Congresso).

AGOSTINI, L. V. . WCAS 2018 - 8th Workshop on Circuits and Systems Design - General Chair. 2018. (Congresso).

AGOSTINI, L. V. . SForum 2018 - 18th Microelectronics Students Forum - General Chair. 2018. (Congresso).

AGOSTINI, L. V. . ISCAS 2018 - IEEE International Symposium on Circuits and Systems - Review Committee Member (RCM). 2018. (Congresso).

AGOSTINI, L. V. . ICECS 2018 - 25th IEEE International Conference on Electronics Circuits and Systems - Track Chair: Signal Image and Video Processing Architectures. 2018. (Congresso).

AGOSTINI, L. V. . LASCAS 2019 - 10th IEEE Latin American Symposium on Circuits and Systems - Track Chair: Digital Signal Processing. 2018. (Congresso).

SILVEIRA, J. ; AGOSTINI, L. V. . SBCCI 2017 - 30th Symposium on Integrated Circuits and Systems Design - Panels Chair. 2017. (Congresso).

AGOSTINI, L. V. . CIC 2016 - XXV Congresso de Iniciação Científica da UFPel - Comissão Organizadora. 2016. (Congresso).

AGOSTINI, L. V. . ENPOS 2016 - XVIII Encontro de Pós-Graduação da UFPel - Comissão Organizadora. 2016. (Congresso).

LIMA, R. N. ; AGOSTINI, L. V. . SBCCI 2015 - 28th Symposium on Integrated Circuits and Systems Design - Track Chair. 2015. (Congresso).

AGOSTINI, L. V. . CIC 2015 - XXIV Congresso de Iniciação Científica da UFPel - Comissão Organizadora. 2015. (Congresso).

AGOSTINI, L. V. . ENPOS 2015 - XVII Encontro de Pós-Graduação da UFPel - Comissão Organizadora. 2015. (Congresso).

MORENO, E. D. ; AZEVEDO, R. J. ; KINGET, P. ; AGOSTINI, L. V. . SBCCI 2014 - 27th Symposium on Integrated Circuits and Systems Design - Track Chair. 2014. (Congresso).

KRUGER, R. ; AGOSTINI, L. V. . CIC 2014 - XXIII Congresso de Iniciação Científica da UFPel - Comissão Organizadora. 2014. (Congresso).

LEITE, M. C. L. ; AGOSTINI, L. V. . ENPOS 2014 - XVI Encontro de Pós-Graduação da UFPel - Comissão Organizadora. 2014. (Congresso).

RODA, V. O. ; AGOSTINI, L. V. ; SUTTER, G. ; FINOCHIETTO, J. . SPL 2014 - Southern Conference on Programmable Logic - Publicity Co-Chair. 2014. (Congresso).

AGOSTINI, L. V. ; GILL, L. A. ; CANEVER, M. D. ; GIGANTE, D. P. . CIC 2013 - XXII Congresso de Iniciação Científica da UFPel - Coordenador Geral. 2013. (Congresso).

GILL, L. A. ; AGOSTINI, L. V. ; GIGANTE, D. P. ; CANEVER, M. D. . ENPOS 2013 - XV Encontro de Pós-Graduação da UFPel - Comissão Organizadora. 2013. (Congresso).

GOUVEIA FILHO, O. ; AGOSTINI, L. V. . Chip in Curitiba 2013 - XXVI SBCCI, XXVIII SBMicro, III WCAS, XII SForum - Panels Chair. 2013. (Congresso).

AGOSTINI, L. V. ; BOEMO, E. ; ZEFERINO, C. ; MARQUES, F. ; MATOS, J. C. B. ; ROSA JR, L. S. . SPL 2012 - Southern Conference on Programmable Logic - General Chair. 2012. (Outro).

BOEMO, E. ; SANTOS, E. ; RODA, V. O. ; TODOROVICH, E. ; AGOSTINI, L. V. . SPL 2011 - Southern Conference on Programmable Logic - Publicity Co-Chair. 2011. (Outro).

CARDENAS, C. S. ; AGOSTINI, L. V. . IWS 2010 - XV Workshop Iberchip - Program Chair. 2010. (Congresso).

AGOSTINI, L. V. ; ZEFERINO, C. . SIM 2010 - 25o Simpósio Sul de Microeletrônica - Program Chair. 2010. (Congresso).

AGOSTINI, L. V. ; BRISOLARA, Lisane ; Tavares, R. . SIM 2009 - 24o Simpósio Sul de Microeletrônica - General Chair. 2009. (Congresso).

AGOSTINI, L. V. ; MATOS, J. C. B. ; GÜNTZEL, José Luis . EMICRO 2009 - 11a Escola de Microeletrônica - General Chair. 2009. (Outro).

SILVA, Ivan Saraiva ; KASTENSMIDT, F. ; AGOSTINI, L. V. . SBCCI 2009 - 22nd Symposium on Integrated Circuits and Systems Design - Publication Co-Chair. 2009. (Congresso).

CAVALHEIRO, G. G. ; YAMIN, Adenauer ; AGOSTINI, L. V. . CLEI 2009 - Conferência Latinoamericana de Informática. 2009. (Congresso).

BOEMO, E. ; AGOSTINI, L. V. ; WANDERLEY, E. B. . SPL 2008 - Southern Conference on Programmable Logic - Latin American Publicity Co-Chair. 2007. (Congresso).

SAWICKI, Sandro ; AGOSTINI, L. V. . SIM2004 - 19th South Symposium on Microelectronics. 2004. (Congresso).

SAWICKI, Sandro ; AGOSTINI, L. V. . EMICRO 2004 - VI Escola Regional de Microeletrônica da SBC - Sul. 2004. (Outro).

AGOSTINI, L. V. ; CAPPELATTI, Ewerton Artur . SIM 2003 - XVII South Microeletronics Seminar - Program Chair. 2003. (Congresso).

AGOSTINI, L. V. ; GÜNTZEL, José Luis ; FRANCO, Dênis . EMICRO 2003 - V Escola de Microeletrônica da SBC - Sul. 2003. (Congresso).

REIS, Ricardo ; AGOSTINI, L. V. . EMICRO 2000 - II Escola de Microeletrônica da SBC - Sul. 2000. (Congresso).

REIS, Ricardo ; GUNTZEL, José Luis ; AGOSTINI, L. V. . SIM 2000 - XV Microeletronics Seminar. 2000. (Congresso).

REIS, Ricardo ; AGOSTINI, L. V. . SBCCI 2000 - XIII Symposiym on Integrated Circuits ans System Design. 2000. (Congresso).

SILVEIRA, L. M. ; DEVADAS, S. ; REIS, Ricardo ; AGOSTINI, L. V. . VLSI-SoC 1999 - VLSI: Systems on a Chip - IFIP TC10 WG10.5 Tenth International Conference on Very Large Scale Integration (VLSI '99). 1999. (Congresso).

REIS, Ricardo ; FRAGOSO, J. ; AGOSTINI, L. V. . SIM 99 - XIV Microeletronics Seminar. 1999. (Congresso).

REIS, Ricardo ; MACARTHY, M. ; AGOSTINI, L. V. . EMICRO 99 - I Escola de Microeletrônica da SBC-Sul. 1999. (Congresso).

DINIZ, E. ; AGOSTINI, L. V. . ERI 1998 - VI Escola de Informática da SBC Regional Sul. 1998. (Congresso).

AGOSTINI, L. V. . III Semana Acadêmica da Informática da UFPel. 1997. (Congresso).

AGOSTINI, L. V. . II Semana Acadêmica da Informática da UFPel. 1996. (Congresso).

AGOSTINI, L. V. . Semana da Saúde do Grêmio da ETFPel. 1993. (Outro).

AGOSTINI, L. V. . Semana dos Direitos Humanos do Grêmio da ETFPel. 1993. (Outro).

AGOSTINI, L. V. ; GILL, L. A. ; CANEVER, M. D. ; GIGANTE, D. P. . CIC 2013 - XXII Congresso de Iniciação Científica da UFPel - Coordenador Geral. 2013. (Congresso).

GILL, L. A. ; AGOSTINI, L. V. ; GIGANTE, D. P. ; CANEVER, M. D. . ENPOS 2013 - XV Encontro de Pós-Graduação da UFPel - Comissão Organizadora. 2013. (Congresso).

Seção coletada automaticamente pelo Escavador

Participação em eventos

2019 26th IEEE International Conference on Electronics, Circuits and Systems (ICECS). Energy-Efficiency Exploration of Memory Hierarchy Using NVMs for HEVC Motion Estimation. 2019. (Congresso).

2019 27th European Signal Processing Conference (EUSIPCO). Compression Efficiency and Computational Cost Comparison Between AV1 and HEVC Encoders. 2019. (Congresso).

2019 IEEE 10th Latin American Symposium on Circuits & Systems (LASCAS).Low-Power and High-Throughput Approximate 44 DCT Hardware Architecture. 2019. (Simpósio).

ICECS 2018 - IEEE International Conference on Electronics, Circuits and Systems. Membro do Technical Programm Commitee. 2018. (Congresso).

ICME 2018 - IEEE International Conference on Multimedia and Expo. Membro do Technical Programm Commitee. 2018. (Congresso).

LASCAS 2018 - IEEE Latin American Symposium on Circuits & Systems.Membro do Technical Programm Commitee. 2018. (Simpósio).

MWSCAS 2018 - IEEE International Midwest Symposium on Circuits and Systems.Revisor de artigos. 2018. (Simpósio).

SBCCI 2018 - Symposium on Integrated Circuits and Systems Design.Membro do Technical Programm Commitee. 2018. (Simpósio).

SBrT 2018 - Simpósio Brasileiro de Telecomunicações e Processamento de Sinais.Membro do Technical Programm Commitee. 2018. (Simpósio).

WebMedia 2018 - Brazillian Symposium on Multimedia and the Web.Membro do Technical Programm Commitee. 2018. (Simpósio).

2017 25th European Signal Processing Conference (EUSIPCO).Complexity reduction of 3D-HEVC based on depth analysis for background and ROI classification. 2017. (Seminário).

ISCAS 2017 - International Symposium of Circuits and Systems.Revisor de artigos. 2017. (Simpósio).

MMSP 2017 - IEEE 19th International Workshop on Multimedia Signal Processing.Multiple Early-Termination Scheme for TZSearch Algorithm based on Data Mining and Decision Trees. 2017. (Oficina).

WEAC 2017 - Workshop sobre Educação em Arquitetura de Computadores.Membro do Technical Programm Commitee. 2017. (Outra).

WEAC 2017 - Workshop sobre Educação em Arquitetura de Computadores.Membro do Technical Programm Commitee. 2017. (Outra).

WebMedia 2017 - Brazillian Symposium on Multimedia and the Web.Membro do Technical Programm Commitee. 2017. (Simpósio).

Workshop IBERCHIP 2017.Membro do Technical Programm Commitee. 2017. (Outra).

2016 IEEE International Symposium on Circuits and Systems (ISCAS).Fast H.264/AVC to HEVC transcoder based on data mining and decision trees. 2016. (Simpósio).

29th Symposium on Integrated Circuits and Systems Design - SBCCI 2016.Energy-aware light-weight DMM-1 patterns decoders with efficiently storage in 3D-HEVC. 2016. (Simpósio).

ISCAS 2016 - International Symposium of Circuits and Systems.Revisor de artigos. 2016. (Simpósio).

LASCAS 2016 - IEEE Latin American Symposium on Circuits & Systems.Membro do Technical Programm Commitee. 2016. (Simpósio).

SBrT 2016 - Simpósio Brasileiro de Telecomunicações e Processamento de Sinais.Membro do Technical Programm Commitee. 2016. (Simpósio).

Workshop IBERCHIP 2016.Membro do Technical Programm Commitee. 2016. (Outra).

2015 IEEE 6th Latin American Symposium on Circuits & Systems (LASCAS 2015).Hardware design of fast HEVC 2-D IDCT targeting real-time UHD 4K applications. 2015. (Simpósio).

2015 IEEE International Symposium on Circuits and Systems (ISCAS).Encoding time control system for HEVC based on Rate-Distortion-Complexity analysis. 2015. (Simpósio).

28th Symposium on Integrated Circuits and Systems Design - SBCCI 2015.Memory-Aware and High-Throughput Hardware Design for the HEVC Fractional Motion Estimation. 2015. (Simpósio).

EUROCON 2015 - IEEE International Conference on Computer as a Tool. Membro do Technical Programm Commitee. 2015. (Congresso).

ISCAS 2015 - International Symposium of Circuits and Systems.Revisor de artigos. 2015. (Simpósio).

LASCAS 2015 - IEEE Latin American Symposium on Circuits & Systems.Membro do Technical Programm Commitee. 2015. (Simpósio).

Workshop IBERCHIP 2015.Membro do Technical Programm Commitee. 2015. (Outra).

2014 IEEE International Symposium on Circuits and Systems (ISCAS).ower efficient and high troughtput multi-size IDCT targeting UHD HEVC decoders. 2014. (Simpósio).

2014 Visual Communications and Image Processing (VCIP).A complexity reduction algorithm for depth maps intra prediction on the 3D-HEVC. 2014. (Simpósio).

27th Symposium on Integrated Circuits and Systems Design (SBCCI).A Memory Energy Consumption Analysis of Motion Estimation Algorithms using Data Reuse in Video Coding Systems. 2014. (Simpósio).

ICASSP 2014 2014 IEEE International Conference on Acoustics, Speech and Signal Processing (ICASSP). A low-complexity and lossless reference frame encoder algorithm for video coding. 2014. (Congresso).

LASCAS 2014 - IEEE Latin American Symposium on Circuits & Systems.Membro do Technical Programm Commitee. 2014. (Simpósio).

WEAC 2014 - Workshop sobre Educação em Arquitetura de Computadores.Membro do Technical Programm Commitee. 2014. (Outra).

WebMedia 2014 - Brazillian Symposium on Multimedia and the Web.Membro do Technical Programm Commitee. 2014. (Simpósio).

2013 20th IEEE International Conference on Image Processing (ICIP). An adaptive workload management scheme for HEVC encoding. 2013. (Congresso).

2013 26th Symposium on Integrated Circuits and Systems Design (SBCCI).Hardware design for the 32 32 IDCT of the HEVC video coding standard. 2013. (Simpósio).

2013 IEEE 20th International Conference on Electronics, Circuits, and Systems (ICECS). Inter-view prediction of coding tree depth for HEVC-based multiview video coding. 2013. (Congresso).

2013 IEEE 4th Latin American Symposium on Circuits and Systems (LASCAS).A real time high definition architecture for the Variable-Length Reference Frame Decoder. 2013. (Simpósio).

ISCAS 2013 - International Symposium of Circuits and Systems.Revisor de artigos. 2013. (Simpósio).

WVC 2013 - Workshop de Visão Computacional.Membro do Technical Programm Commitee. 2013. (Outra).

ICECS 2012 - IEEE International Conference on Electronics, Circuits, and Systems,. A High Quality Hardware Friendly Motion Estimation Algorithm Focusing in HD Videos. 2012. (Congresso).

ICECS 2012 - IEEE International Conference on Electronics, Circuits and Systems. Revisor de artigos. 2012. (Congresso).

ICIP 2012 - 19th IEEE International Conference on Image Processing. A memory aware and multiplierless VLSI architecture for the complete Intra Prediction of the HEVC emerging standard. 2012. (Congresso).

ICME 2012 - IEEE International Conference on Multimedia & Expo. Motion Vectors Merging: Low Complexity Prediction Unit Decision Heuristic for the InterPrediction of HEVC Encoders. 2012. (Congresso).

ICME 2012 - IEEE International Conference on Multimedia & Expo. Motion Vectors Merging: Low Complexity Prediction Unit Decision Heuristic for the InterPrediction of HEVC Encoders. 2012. (Congresso).

MWSCAS 2012 - IEEE International Midwest Symposium on Circuits and Systems.Revisor de artigos. 2012. (Simpósio).

SBCCI 2012 - 25th Annual Symposium on Integrated Circuits and System Design.High Throughput Hardware Design for the Adaptive Loop Filter of the Emerging HEVC Video Coding. 2012. (Simpósio).

SPL 2012 - Southern Programmable Logic Conference. Membro do Technical Programm Commitee. 2012. (Congresso).

SPL 2012 - VIII Southern Programmable Logic Conference. Very High Throughput FPGA Design for Vertical Rotational Transform of HEVC Emergent Video Coding Standard. 2012. (Congresso).

Workshop IBERCHIP 2012.Membro do Technical Programm Commitee. 2012. (Outra).

WVC 2012 - Workshop de Visão Computacional.Membro do Technical Programm Commitee. 2012. (Outra).

CLEI 2011 - Conferencia Latinoamericana de Informática. Membro do Technical Programm Commitee. 2011. (Congresso).

ICECS 2011 - IEEE International Conference on Electronics, Circuits and Systems. Revisor de artigos. 2011. (Congresso).

IEEE EUROCON 2011. IEEE EUROCON 2011. 2011. (Congresso).

ISCAS 2011 - IEEE International Symposium on Circuits and Systems.A Multilevel Data Reuse Scheme for Motion Estimation and Its VLSI Design. 2011. (Simpósio).

LASCAS 2011 - II IEEE Latin American Symposium on Circuits and Systems.LASCAS 2011 - II IEEE Latin American Symposium on Circuits and Systems. 2011. (Simpósio).

SPL 2010 - V Southern Programmable Logic Conference. 2011. (Congresso).

SPL 2011 - VII Southern Programmable Logic Conference. SPL 2011 - VII Southern Programmable Logic Conference. 2011. (Congresso).

SPL 2011 - VII Southern Programmable Logic Conference. SPL 2011 - VII Southern Programmable Logic Conference. 2011. (Congresso).

ICECS 2010 - IEEE International Conference on Electronics, Circuits, and Systems. ICECS 2010 - IEEE International Conference on Electronics, Circuits, and Systems. 2010. (Congresso).

ICM 2010 - International Conference on Microelectronics. Revisor de artigos. 2010. (Congresso).

LASCAS 2010 - IEEE Latin American Symposium on Circuits and Systems. 2010. (Simpósio).

SBCCI 2010 - 23rd Annual Symposium on Integrated Circuits and System Design.SBCCI 2010 - 23rd Annual Symposium on Integrated Circuits and System Design. 2010. (Simpósio).

SPL 2010 - VI Southern Programmable Logic Conference. Participante do Program Committee. 2010. (Congresso).

Workshop IBERCHIP 2010.Membro do Technical Programm Commitee. 2010. (Outra).

XIX Congresso de Iniciação Científica da UFPel. XIX Congresso de Iniciação Científica da UFPel. 2010. (Congresso).

IBERCHIP 2009 - XV Workshop Iberchip. Avaliador de artigos. 2009. (Congresso).

ICECS 2009 - 16th IEEE International Conference on Electronics, Circuits, and Systems. Avaliador de artigos. 2009. (Congresso).

ICIP 2009 - IEEE International Conference on Image Processing. Low Latency and High Throughput Dedicated Loop of Transforms and Quantization Focusing in the H.264/AVC Intra Prediction. 2009. (Congresso).

SBCCI 2009 - 22nd Annual Symposium on Integrated Circuits and System Design: Chip on the Dunes.SBCCI 2009 - 22nd Annual Symposium on Integrated Circuits and System Design: Chip on the Dunes. 2009. (Simpósio).

SPL 2009 - V Southern Programmable Logic Conference. Avaliador de artigos. 2009. (Congresso).

VLSI-SOC 2009 - 17TH IFIP International Conference on Very Large Scale Integration. VLSI-SOC 2009 - 17TH IFIP International Conference on Very Large Scale Integration. 2009. (Congresso).

XVIII Congresso de Iniciação Científica da UFPel. XVIII Congresso de Iniciação Científica da UFPel. 2009. (Congresso).

XXXV CLEI - Conferência Latino-Americana de Informática. 2009. (Congresso).

ISCAS 2008 - IEEE International Symposium on Circuits and Systems. ISCAS 2008 - IEEE International Symposium on Circuits and Systems. 2008. (Congresso).

SBCCI2008 - 21st SYMPOSIUM ON INTEGRATED CIRCUITS AND SYSTEM DESIGN. 2008. (Simpósio).

SPL2008 - IV IEEE Southern Conference on Programmable Logic. SPL2008 - IV IEEE Southern Conference on Programmable Logic. 2008. (Congresso).

XVII Congresso de Iniciação Científica da UFPel. XVII Congresso de Iniciação Científica da UFPel. 2008. (Congresso).

XXIII SIM - Simpósio Sul de Microeletrônica.XXIII SIM - Simpósio Sul de Microeletrônica. 2008. (Simpósio).

Fórum Internacional Centros de Design. 2007. (Outra).

Iberchip2007 - XIII Taller IBERCHIP. Iberchip2007 - XIII Taller IBERCHIP. 2007. (Congresso).

ICECS2007 - IEEE International Conference on Electronics, Circuits, and Systems. ICECS2007 - IEEE International Conference on Electronics, Circuits, and Systems. 2007. (Congresso).

PSIVT2007 - Pacific-Rim Symposium on Image and Video Technology.A Pipelined 8x8 2-D Forward DCT Hardware Architecture for H.264/AVC High Profile Encoder. 2007. (Simpósio).

SBCCI 2007 - XX Symposium on Integrated Circuits and Systems Design. SBCCI 2007 - XX Symposium on Integrated Circuits and Systems Design. 2007. (Congresso).

SIMS2007 - XII Simpósio de Informática e VIIª Mostra de Software.TV digital e princípios de codificação de vídeo. 2007. (Simpósio).

SPL2007 - III IEEE Southern Conference on Programmable Logic. SPL2007 - III IEEE Southern Conference on Programmable Logic. 2007. (Congresso).

SPL2007 - III IEEE Southern Conference on Programmable Logic.FPGA Based Design of CAVLC and Exp-Golomb Coders for H.264/AVC Baseline Entropy Coding. 2007. (Outra).

VLSI-SoC 2007 - XV International Conference on Very Large Scale Integration. VLSI-SoC 2007 - XV International Conference on Very Large Scale Integration. 2007. (Congresso).

WebMedia 2007 - XIII Brazilian Symposium on Multimedia and the Web. 2007. (Simpósio).

WSCAD 2007 - VIII Workshop em Sistemas Computacionais de Alto Desempenho. WSCAD 2007 - VIII Workshop em Sistemas Computacionais de Alto Desempenho. 2007. (Congresso).

WSL 2007 - 8° Fórum Internacional de Software Livre. WSL 2007 - 8° Fórum Internacional de Software Livre. 2007. (Congresso).

XVI Congresso de Iniciação Científica da UFPel. XVI Congresso de Iniciação Científica da UFPel. 2007. (Congresso).

XXII SIM - Simpósio Sul de Microeletrônica.XXII SIM - Simpósio Sul de Microeletrônica. 2007. (Simpósio).

43st DAC - Design Automation Conference - University Booth. FPGA Design of a H.264/AVC Main Profile Video Decoder. 2006. (Congresso).

FPL 2006 - 16th IEEE International Conference on Field Programmable Logic and Applications.FPGA Design of a H.264/AVC Main Profile Decoder for HDTV. 2006. (Outra).

ISCAS 2006 - IEEE International Symposium on Circuits and Systems. High Throughput Multitransform and Multiparallelism IP Directed to the H.264/AVC Video Compression Standard. 2006. (Congresso).

MWSCAS 2006 - 49th IEEE International Midwest Symposium on Circuits and Systems.High Throughput FPGA Based Architecture for H.264/AVC Inverse Transforms and Quantization. 2006. (Simpósio).

PATMOS 2006 - International Workshop on Power and Timing Modeling, Optimization and Simulation. PATMOS 2006 - International Workshop on Power and Timing Modeling, Optimization and Simulation. 2006. (Congresso).

SIMS 2006 - XI Simpósio de Informática VI Mostra de Software Acadêmico.SIMS 2006 - XI Simpósio de Informática VI Mostra de Software Acadêmico. 2006. (Simpósio).

SPL2006 - II IEEE Southern Conference on Programmable Logic.Forward and Inverse 2-D DCT Architectures for H.264/AVC Video Compression Directed to HDTV. 2006. (Outra).

XXI SIM - Simpósio Sul de Microeletrônica.XXI SIM - Simpósio Sul de Microeletrônica. 2006. (Simpósio).

XXI SIM - Simpósio Sul de Microeletrônica.A Multitransform and Multiparallelism IP Directed to the H.264/AVC Video Compression Standard. 2006. (Simpósio).

SBCCI 2005 - XVIII Symposium on Integrated Circuits and Systems Design. SBCCI 2005 - XVIII Symposium on Integrated Circuits and Systems Design. 2005. (Congresso).

SIMS 2005 - X Simpósio de Informática V Mostra de Software Acadêmico.SIMS 2005 - X Simpósio de Informática V Mostra de Software Acadêmico. 2005. (Simpósio).

XI Workshop Iberchip. 2005. (Outra).

XX SIM - Simpósio Sul de Microeletrônica.XX SIM - Simpósio Sul de Microeletrônica. 2005. (Simpósio).

41st DAC - Design Automation Conference - University Booth. Design of a Fully Pipelined Architecture for JPEG Compression of Gray Scale Images. 2004. (Congresso).

XIX SIM - Simpósio Sul de Microeletrônica. 2004. (Simpósio).

X Workshop Iberchip. 2004. (Outra).

IX Workshop Iberchip. IX Workshop Iberchip. 2003. (Congresso).

SBCCI2003 - XV Symposium on Integrated Circuits and Systems Design.SBCCI 2002 - XV Symposium on Integrated Circuits and Systems Design. 2003. (Simpósio).

SBMICRO2003 - XVIII Symposium on Microelectronics Tecnology and Devices.SBMICRO 2003 - XVIII Symposium on Microelectronics Tecnology and Devices. 2003. (Simpósio).

SIM 2003 - XVIII South Microelectronics Seminar. 2003. (Seminário).

VIII Semana Acadêmica do Curso de Ciência da Computação. 2003. (Outra).

XII Congresso de Iniciação Científica da UFPel. XII Congresso de Iniciação Científica da UFPel. 2003. (Congresso).

II SForum - Student Forum on Microelectronics. 2002. (Seminário).

SBCCI2002 - XIV SYMPOSIUM ON INTEGRATED CIRCUITS AND SYSTEM DESIGN.SBCCI 2002 - XV Symposium on Integrated Circuits and Systems Design. 2002. (Simpósio).

SIM 2002 - XVII South Microelectronics Seminar.Entropy Coder for JPEG Compression of Gray Scale Images. 2002. (Simpósio).

XI Congresso de Iniciação Científica da UFPel. XI Congresso de Iniciação Científica da UFPel. 2002. (Congresso).

Fórum Internacional de Software Livre 2001. 2001. (Simpósio).

I Student Forum on Microelectronics.Caipirinha: A Free Graphical Viewer for Berkeley Spice. 2001. (Seminário).

SBCCI 2001 - XIV Symposium on Integrated Circuits and Systems Design.Pipelined Fast 2-D DCT Architecture for JPEG Image Compression. 2001. (Simpósio).

SIM 2001 - XVI Microelectronics Seminar.2-D DCT Architecture for Image Compression. 2001. (Seminário).

SBCCI2000 - XIII SYMPOSIUM ON INTEGRATED CIRCUITS AND SYSTEM DESIGN.SisECO: Design of an Echo-Canceling IC for Base Band Modems. 2000. (Simpósio).

SBMicro 2000 - XV International Conference on Microelectronics and Packaging.Modeling and Simulation of a Heterogeneous Embedded System. 2000. (Simpósio).

SIM 2000 - XV Microelectronics Seminar.SisECO: an Echo -Canceling Integrated Circuit. 2000. (Seminário).

VI Workshop Iberchip. Implementações de Filtros Adaptativos para Cancelamento de Eco. 2000. (Congresso).

SIM 99 - XIV Microelectronics Seminar. 1999. (Seminário).

11a Escola de Computação. 1998. (Outra).

IV Semana Acadêmica da Informática. 1998. (Outra).

III Semana Acadêmica da Informática. 1997. (Outra).

II Semana Acadêmica da Informática. 1996. (Outra).

I Congresso Ibero-Americano de Microeletrônica. 1995. (Congresso).

I Semana Acadêmica da Informática. 1995. (Outra).

VII Simpósio Brasileiro de Arquitetura de Computadores - Processamento de Alto Desempenho. 1995. (Simpósio).

X Congresso da Sociedade Brasileira de Microeletrônica. 1995. (Congresso).

XV Congreso da Sociedade Brasileira de Computação. 1995. (Congresso).

Seção coletada automaticamente pelo Escavador

Participação em bancas

Aluno: Bruno Boessio Vizzotto

AGOSTINI, L. V.SUSIN, Altamiro; Valter Roesler. Algoritmos para o Módulo de Controle de Taxa de Codificação de Vídeos Multivistas do Padrão H.264/MVC. 2012. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

Aluno: Alba Sandyra Bezerra Lopes

SILVA, Ivan SaraivaAGOSTINI, L. V.; KREUTZ, M. E.; JACOBI, R.. Arquitetura com Elevada Taxa de Processamento e Reduzida Largura de Banda de Memória para a Estimação de Movimento em Vídeos Digitais. 2011. Dissertação (Mestrado em Sistemas e Computação) - Universidade Federal do Rio Grande do Norte.

Aluno: Fabio Luís Livi Ramos

KASTENSMIDT, F.; Valter Roesler;AGOSTINI, L. V.. Arquitetura para o Algoritmo CAVLC de Codificação de Entropia Segundo o Padrão H.264/AVC. 2010. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

Aluno: Dieison Antonelo Deprá

JACOBI, R.;AGOSTINI, L. V.SUSIN, AltamiroBAMPI, Sergio. Algoritmos e Desenvolvimento de Arquitetura para a Codificação Binária Adaptativa ao Contexto para o Decodificador H.264/AVC. 2009. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

Aluno: Mateus Grellert da Silva

SUSIN, A.; PAGLIARI, C.;AGOSTINI, L. V.. Machine Learning Mode Decision for Complexity Reduction and Scaling in Video Applications. 2018. Tese (Doutorado em Computação) - Universidade Federal do Rio Grande do Sul.

Aluno: Purnachand Nalluri

AGOSTINI, L. V.; MATTAVELLI, M.; SOUSA, L.; SANTOS, D.; NAVARRO, A.; RAMOS, F.. A Fast Motion Estimation Algorithm and Its VLSI Architecture for High Efficiency Video Coding. 2016. Tese (Doutorado em Engenharia Eletrotécnica) - Universidade de Aveiro.

Aluno: Juan Pablo Oliver

AGOSTINI, L. V.; RODA, V. O.; RANDALL, G.; BOEMO, E.. Técnicas de bajo consumo en FPGAs. 2014. Tese (Doutorado em DOCTORADO EN INGENIERÍA ELÉCTRICA) - Universidad de la Republica Uruguay.

Aluno: Sidnei Ghissoni

REIS, RicardoBAMPI, S.AGOSTINI, L. V.; BALEN, T. R.. Decomposição de Coeficientes Trigonométricos para a Redução de Área e Potência em Arquiteturas FFT Híbridas na Base 2. 2012. Tese (Doutorado em Microeletrônica) - Universidade Federal do Rio Grande do Sul.

Aluno: Leomar Soares da Rosa Junior

GÜNTZEL, José LuisAGOSTINI, L. V.; WIRTH, G.; JOHANN, M.. Automatic Generation and Evaluation of Transistor Networks. 2008. Tese (Doutorado em PGMICRO) - Universidade Federal do Rio Grande do Sul.

Aluno: Bruno Boessio Vizzotto

Susin, Altamiro;Agostini, LucianoROSA, Vagner. Efficient Algorithms for Process and Communication of Multiview Videos: Contributions in Rate Control and Thread Management for 3D-Videos. 2017. Exame de qualificação (Doutorando em Computação) - Universidade Federal do Rio Grande do Sul.

Aluno: Sidinei Ghissoni

REIS, RicardoBAMPI, SergioAGOSTINI, L. V.; BALEN, T. R.. Decomposição de Coeficientes Trigonométricos para a Redução de Área e Potência em Arquiteturas FFT Híbridas na Base 2. 2012. Exame de qualificação (Doutorando em Microeletrônica) - Universidade Federal do Rio Grande do Sul.

Aluno: Rafael Lima Pereira

BRISOLARA, Lisane; BOIS, A. R.;AGOSTINI, LUCIANO V.. Ferramentas de análise de bytecodes para aplicações Java com ênfase em sistemas embarcados. 2011. Trabalho de Conclusão de Curso (Graduação em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Wellisson Guilhermino Pereira da Silva

MATTOS, JULIO C. B.; FOSS, L.;AGOSTINI, LUCIANO V.. Uso de Refatorações na Exploração do Espaço de Projeto de Software Embarcado. 2011. Trabalho de Conclusão de Curso (Graduação em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Tiago Henrique Trojahn

MATTOS, JULIO C. B.AGOSTINI, LUCIANO V.; PILLA, M.. Implementação e avaliação de desempenho de duas versões do componente responsável pela decodificação de fluxos de mídia no middleware Ginga. 2011. Trabalho de Conclusão de Curso (Graduação em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Gabriel Paniz Patzer

AGOSTINI, LUCIANO V.. Aplicação da Análise de Fase em Exames Gated Spect de Perfusão Miocárdica. 2008. Trabalho de Conclusão de Curso (Graduação em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Bruno Atrib Zanchet

OLIVEIRA, Lucas Ferrari;AGOSTINI, L. V.; COSTA, Simone A. da. Desenvolvimento de uma ferramenta para analise quantitativa de espessamento miocárdio através do processamento de imagens médicas. 2007. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Marcelo Horne Mattos

FERRUGEM, Anderson; OLIVEIRA, Lucas Ferrari; FLEISCHMANN, Ana M. Pernas;AGOSTINI, L. V.. Visão computacional: estudo do filtro de kalman em conjunto ao mean shift no rastramento de jogadores em esportes coletivos. 2007. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Ismael Dias da Silva

MACARTHY, M.;AGOSTINI, L. V.YAMIN, Adenauer. Sistema de Comunicação Móvel Domótico. 2007. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Gustavo Pereira Mateus

AGOSTINI, L. V.; Tavares, R.; MACARTHY, Marcello de Rocha. Caracterização Automática de Atrasos de Portas Lógicas em Circuitos Combinacionais CMOS. 2006. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Carolina Gomes Neves

KASTENSMIDT, F.; MEDEIROS, Gil Carlos Rodrigues;AGOSTINI, L. V.. Análise Automática da Propagação de Single Event Transients em Circuitos Combinacionais CMOS. 2006. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Gustavo Pereira Mateus

AGOSTINI, LUCIANO V.. Caracterização automática de atrasos de portas lógicas em circuitos combinacionais CMOS. 2006. Trabalho de Conclusão de Curso (Graduação em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Lucas Medeiros Donato

AGOSTINI, L. V.; MEDEIROS, Gil Carlos Rodrigues; MEIRELES, Luis Fernando. Uma Metodologia de Forense Computacional Apoiada por Profiling Psicológico. 2004. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Adriel Mota Ziesemer Junior

AGOSTINI, L. V.GÜNTZEL, José LuisCOSTA, EduardoREIS, Ricardo. Geração Automática de Multiplicadores para Números Inteiros Binários. 2004. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Wagner Alterman

AGOSTINI, L. V.REIS, RicardoGÜNTZEL, José Luis. Geração Automática de Somadores. 2004. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Jorge Hosni Pereira Júnior

AGOSTINI, L. V.; RIBEIRO, Carlos Jorge de Souza; RIBEIRO, Leonardo. Auditoria em Tecnologia da Informação. 2004. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Daniel Lima Ferrão

GUNTZEL, José LuisREIS, RicardoAGOSTINI, L. V.; MACARTHY, M.. Desenvolvimento de uma Ferramenta de Análise de Timing de Circuitos Combinacionais Baseada em Sensibilização Individual de Caminhos. 2003. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Rubinei Peske Angelo

AGOSTINI, L. V.; MACARTHY, M.; DANDOLINI, G.. Estudo de Técnicas de Tolerância à Falhas Aplicadas em Redes Neurais Artificiais. 2003. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

Aluno: Emerson Barbiero Hernandez

REIS, Ricardo; GAYER, C.;AGOSTINI, L. V.. Homero Editor de Descrição Textuais para Trabalho Colaborativo. 2002. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal do Rio Grande do Sul.

AGOSTINI, L. V.; ROSSI, M. L.; AZZOLIN, R. Z.. Concurso Público para Professor de Magistério Superior - Classe A na Área de Circuitos Eletrônicos - CDTeC/UFPel. 2018. Universidade Federal de Pelotas.

FERREIRA, A. P. L.; OLIVEIRA, L. P. L.;AGOSTINI, L. V.. Concurso Público para Professor Assistente na Área de Processamento Digital de Sinais - UNIPAMPA Bagé. 2011. Universidade Federal do Pampa.

MATOS, J. C. B.; FRANCO, Dênis;AGOSTINI, L. V.. Concurso Público para Professor Adjunto na área de Engenharia da Computação. 2010. Universidade Federal de Pelotas.

FERREIRA JR., P.; DINIZ, E.;AGOSTINI, L. V.. Concurso Público para Professor Adjunto na Área de Ciência da Computação. 2010. Universidade Federal de Pelotas.

FERREIRA, A. P. L.; OLIVEIRA, L. P. L.;AGOSTINI, L. V.. Concurso Público para Professor Assistente na Área de Processamento Digital de Sinais - UNIPAMPA Bagé. 2010. Universidade Federal do Pampa.

AGOSTINI, L. V.; MEDEIROS, Gil Carlos Rodrigues; MAILLARD, N.. Concurso Público para Professor Adjunto na Área de Ciência da Computação. 2009. Universidade Federal de Pelotas.

OLIVEIRA, Lucas Ferrari; CATAPAN, Araci Hack;AGOSTINI, L. V.. Concurso Público para Professor Assistente na Área de Gestão de Projetos - UAB. 2009. Universidade Federal de Pelotas.

AGOSTINI, L. V.COSTA, Eduardo; MANGAN, P.. Concurso Público para Professor Adjunto na Área de Engenharia ? Redes de Computadores e Arquitetura de Computadores. 2008. Universidade Federal do Pampa.

CAMPANI, C. A. P.;AGOSTINI, L. V.; MACARTHY, M.. Concurso Público para Professor Adjunto na Área de Ciência da Computação (Sistemas Digitais e Arquitetura de Computadores). 2008. Universidade Federal de Pelotas.

DINIZ, E.;AGOSTINI, L. V.; OLIVEIRA, Lucas Ferrari. Concurso Público para Professor Adjunto na Área de Ciência da Computação. 2008. Universidade Federal de Pelotas.

MACARTHY, Marcello de Rocha;GÜNTZEL, José LuisAGOSTINI, L. V.. Concurso Público para Professor Assistente da Universidade Federal de Pelotas (Universidade Fedaral do Pampa). 2006. Universidade Federal de Pelotas.

FERRUGEM, Anderson;AGOSTINI, L. V.; OLIVEIRA, Lucas Ferrari. Seleção de Professor Substituto - Computação Aplicada. 2007. Universidade Federal de Pelotas.

MEDEIROS, Gil Carlos Rodrigues;AGOSTINI, L. V.; MACARTHY, Marcello de Rocha. Seleção de Professor Substituto - Computação Aplicada. 2004. Universidade Federal de Pelotas.

AGOSTINI, L. V.; SILVEIRA, Ricardo Azambuja; MEDEIROS, Gil Carlos Rodrigues. Seleção de Professor Substituto - Computação Teórica. 2003. Universidade Federal de Pelotas.

MACARTHY, M.;AGOSTINI, L. V.; SILVEIRA, Ricardo Azambuja. Seleção de Professor Substituto - Computação Aplicada. 2003. Universidade Federal de Pelotas.

MEDEIROS, Gil Carlos Rodrigues;AGOSTINI, L. V.; SILVEIRA, Ricardo Azambuja. Seleção de Professor Substituto - Computação Teorica. 2003. Universidade Federal de Pelotas.

MACARTHY, M.;AGOSTINI, L. V.; SILVEIRA, Ricardo Azambuja. Seleção de Professor Substituto - Computação Aplicada. 2003. Universidade Federal de Pelotas.

Seção coletada automaticamente pelo Escavador

Comissão julgadora das bancas

Eliane da Silva Alcoforado Diniz

DINIZ, E. S. A.; CARVALHO, F. A.; RIBEIRO, M. V.. Projeto de Gerenciamento do Setor de Editoração Eletrônica do CEPET Pelotas-RS. 1999. Trabalho de Conclusão de Curso (Graduação em Ciência da Computação) - Universidade Federal de Pelotas.

Flávia Braga de Azambuja

AZAMBUJA, F. B.; DINIZ, Eliane Alcoforado; RIBEIRO, Marcus Vinicius. Projeto de Gerenciamento do setor de editoração eletrônica do CEFET Pelotas/RS. 1998. Trabalho de Conclusão de Curso (Graduação em Ciência da Computação) - Universidade Federal de Pelotas.

Ivan Saraiva Silva

AGOSTINI, Luciano VolcanSILVA, I. S.; REIS, R. A. L.; SUSIN, Altamiro Amadeu. Projeto de Arquiteturas integradas para Compressão de Imagens e JPEG. 2002. Dissertação (Mestrado em Ciência da Computação) - Universidade Federal do Rio Grande do Sul.

Eduardo Antonio Barros da Silva

da Silva, E. A. B.. Desenvolvimento de Arquiteturas de Alto Desempenho Dedicadas à Compressão de Vídeo Segundo o Padrão H.264/AVC. 2007 - Universidade Federal do Rio Grande do Sul.

Eduardo Antonio Barros da Silva

da Silva, E. A. B.. Desenvolvimento de Arquiteturas de Alta Performance Dedicadas à Compressão de Vídeo Segundo o Padrão H.264. 2005. Exame de qualificação (Doutorando em Engenharia de Minas, Metalúrgica e de Materiais) - Universidade Federal do Rio Grande do Sul.

Altamiro Amadeu Susin

SUSIN, A. A.. Projeto de Arquiteturas Integradas para a Compressão de Imagens JPEG. 2002. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

Ricardo Pezzuol Jacobi

SUSIN, A.;REIS, R. A. L.JACOBI, R. P.; SILVA, E. A. B.;BAMPI, S.. Desenvolvimento de Arquiteturas de Alto Desempenho Dedicadas à Compressão de Vídeo Segundo o Padrão H.264/AVC. 2007. Tese (Doutorado em Computação) - Universidade Federal do Rio Grande do Sul.

Ricardo Pezzuol Jacobi

SUSIN, A.; SILVA, E. A. B.;JACOBI, R. P.. Desenvolvimento de Arquiteturas de Alta Performance Dedicadas à Compressão de Vídeo Segundo o Padrão H.264. 2005. Exame de qualificação (Doutorando em Computação) - Universidade Federal do Rio Grande do Sul.

Seção coletada automaticamente pelo Escavador

Orientou

Samuel Oliveira

a definir; Início: 2020; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; (Orientador);

Yan Ballinhas Soares

a definir; Início: 2019; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas; (Orientador);

Paulo Henrik Ribeiro Gonçalves

a definir; Início: 2019; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; (Coorientador);

Pablo De Chiaro Rosa

a definir; Início: 2019; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas; (Orientador);

Rogério Cassanta Rosado

a definir; Início: 2020; Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas; (Orientador);

Marta Breunig Loose

a definir; Início: 2020; Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas; (Orientador);

Jones Willian Goebel

a definir; Início: 2019; Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; (Coorientador);

Mário Roberto de Freitas Saldanha

a definir; Início: 2018; Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas; (Orientador);

Isis Duarte Bender

a definir; Início: 2018; Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas; (Coorientador);

MARCEL MOSCARELLI CORRÊA

a definir; Início: 2018; Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas; (Orientador);

Roberta de Carvalho Nobre Palau

a definir; Início: 2017; Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas; (Orientador);

Robson André Domanski

a definir; Início: 2017; Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas; (Orientador);

Ramon Costi Fernandes

a definir; Início: 2017; Tese (Doutorado em Ciência da Computação) - Pontifícia Universidade Católica do Rio Grande do Sul, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; (Coorientador);

Fabrício Neitzke Ferreira

a definir; Início: 2016; Tese (Doutorado em Computação) - Universidade Federal de Pelotas; (Orientador);

Ruhan Ávilia Conceição

a definir; Início: 2016; Tese (Doutorado em Computação) - Universidade Federal de Pelotas; (Orientador);

Vinicius de Araujo Borges

Desenvolvimento de hardware dedicado para módulos da codificação de vídeos no padrão 3D-HEVC; Início: 2019; Iniciação científica (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; (Orientador);

William Kolodziejski

Desenvolvimento de hardware dedicado para módulos da codificação de vídeos nos padrões VVC e AV1; Início: 2019; Iniciação científica (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Universidade Federal de Pelotas; (Orientador);

Cristhopher Conceição Moura

Desenvolvimento de algoritmos para a codificação de vídeos no padrão 3D-HEVC; Início: 2019; Iniciação científica (Graduando em Ciência da Computação) - Universidade Federal de Pelotas; (Orientador);

Eduardo Amaro da Rosa

Investigação de soluções algorítmicas para compressão de vídeos 360; Início: 2019; Iniciação científica (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; (Orientador);

Mateus Mendes Gonçalves

Esquema de Predição Intraquadro para a Compressão de Nuvens de Pontos no Point Cloud Codec; 2020; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas,; Coorientador: Luciano Volcan Agostini;

Murilo Roschildt Perleberg

An Energy-Efficient Hardware Design for the 3D-HEVC Integer Motion Estimation Adopting Reuse Strategies for Data and Operations; 2020; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas,; Coorientador: Luciano Volcan Agostini;

Iago Coelho Storch

Exploração das Distorções da Projeção ERP para Redução de Complexidade da Codificação de Vídeos Omnidirecionais; 2020; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Coorientador: Luciano Volcan Agostini;

Jones Willian Goebel

Solução Arquitetural para a Decodificação Intraquadro do Padrão de Codificação AV1; 2019; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Coorientador: Luciano Volcan Agostini;

Miguel Oliveira Inocêncio

Transform Co-Processor for AV1 Video Coding Standard; 2019; Dissertação (Mestrado em Engenharia Eletrónica e de Telecomunicações) - Universidade de Aveiro,; Coorientador: Luciano Volcan Agostini;

Mário Roberto de Freitas Saldanha

Redução do Tempo de Codificação de Mapas de Profundidade do 3D-HEVC Usando Árvores de Decisão Estáticas Construídas Através de Data Mining; 2018; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Orientador: Luciano Volcan Agostini;

LÍVIA AMARAL

Projeto e Gerenciamento Dinâmico de uma Memória de Busca para a Estimação de Movimento na Codificação de Vídeo; 2018; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Coorientador: Luciano Volcan Agostini;

Luciano Braatz

Energy/Quality-Aware Hardware Solutions for the Residual Coding Loop Components of the High Efficiency Video Coding Standard; 2018; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Coorientador: Luciano Volcan Agostini;

MARCEL MOSCARELLI CORRÊA

Desenvolvimento Arquitetural para a Predição Intraquadro do Padrão HEVC de Codificação de Vídeos; 2017; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas,; Orientador: Luciano Volcan Agostini;

Wagner Ishizaka Penny

Controlador de Energia para o Codificador HEVC Baseado em Frentes de Pareto; 2016; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas,; Coorientador: Luciano Volcan Agostini;

Ruhan Avila da Conceição

Early Skip/DIS: Uma Heurística para Redução de Complexidade no Codificador de Mapas de Profundidade do 3D-HEVC; 2016; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Orientador: Luciano Volcan Agostini;

FABIANE KONRAD REDIESS

Otimizações Algorítmicas e Desenvolvimento de Hardware para o In-loop Filter do Padrão HEVC; 2015; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas,; Orientador: Luciano Volcan Agostini;

Dieison Soares Silveira

Algoritmos e Arquiteturas de Hardware para a Compressão de Quadros de Referência em Codificadores de Vídeo Digitais; 2015; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Coorientador: Luciano Volcan Agostini;

Gustavo Freitas Sanchez

DMMFast: Esquema de Redução de Complexidade para a Predição Intra de Mapas de Profundidade no Padrão Emergente 3D-HEVC; 2014; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Orientador: Luciano Volcan Agostini;

Ricardo Garcia Jeske

Otimizações Algorítmicas e Desenvolvimento Arquitetural para as DCTs do HEVC; 2013; Dissertação (Mestrado em Programa de Pós Graduação em Computação) - Universidade Federal de Pelotas,; Orientador: Luciano Volcan Agostini;

Daniel Munari Palomino

Algorithm and Hardware Based Architectural Design Targeting the Intra-Frame Prediction of the HEVC Video Coding Standard; 2013; Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Coorientador: Luciano Volcan Agostini;

Felipe Martin Sampaio

Energy-Efficient Memory Hierarchy for Motion and Disparity Estimation in Multiview Video Coding; 2013; Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Coorientador: Luciano Volcan Agostini;

Vladimir Afonso

Desenvolvimento de uma arquitetura para estimação de movimento fracionária segundo o padrão emergente HEVC; 2013; Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas,; Coorientador: Luciano Volcan Agostini;

Henrique Avila Vianna

Desenvolvimento de Hardware para a Transformada Rotacional 8x8 com Foco na Codificação de Vídeos Digitais de Altíssima Resolução; 2012; Dissertação (Mestrado em Programa de Pós Graduação em Computação) - Universidade Federal de Pelotas,; Orientador: Luciano Volcan Agostini;

Alba Sandyra Bezerra Lopes

Arquitetura com Elevada Taxa de Processamento e Reduzida Largura de Banda de Memória para a Estimação de Movimento em Vídeos Digitais; 2011; Dissertação (Mestrado em Sistemas e Computação) - Universidade Federal do Rio Grande do Norte, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Coorientador: Luciano Volcan Agostini;

Guilherme Ribeiro Corrêa

Estudo e Desenvolvimento de Heurísticas e Arquiteturas de Hardware para Decisão Rápida do Modo de Codificação de Bloco para o Padrão H; 264/AVC; 2010; Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Coorientador: Luciano Volcan Agostini;

Thaísa Leal da Silva

Desenvolvimento de Módulos de Hardware para a Decodificação de Vídeo Focando na Escalabilidade Espacial Diádica do Padrão H; 264/SVC; 2007; Dissertação (Mestrado em Microeletrônica) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Coorientador: Luciano Volcan Agostini;

Roger Endrigo Carvalho Porto

Exploração de Computação Aproximada no Projeto de Hardware Dedicado de Baixo Consumo para a Codificação de Vídeo em Dispositivos Móveis; 2020; Tese (Doutorado em Computação) - Universidade Federal de Pelotas,; Coorientador: Luciano Volcan Agostini;

Gustavo Freitas Sanchez

Exploration of Algorithms and Implementations for Efficient 3D-HEVC Depth Map Encoding; 2019; Tese (Doutorado em Ciência da Computação) - Pontifícia Universidade Católica do Rio Grande do Sul,; Coorientador: Luciano Volcan Agostini;

Ismael Seidel

Exploiting SATD Properties to Reduce Energy in Video Coding; 2019; Tese (Doutorado em Ciências da Computação) - Universidade Federal de Santa Catarina, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Coorientador: Luciano Volcan Agostini;

Vladimir Afonso

High-Throughput Dedicated Hardware Design Targeting the 3D-HEVC-Prediction Coding Tools; 2019; Tese (Doutorado em Microeletrônica) - Universidade Federal do Rio Grande do Sul,; Coorientador: Luciano Volcan Agostini;

Daniel Munari Palomino

Application-Driven Temperature-Aware Solutions for Video Coding; 2017; Tese (Doutorado em Computação) - Universidade Federal do Rio Grande do Sul,; Coorientador: Luciano Volcan Agostini;

Guilherme Ribeiro Corrêa

Computational Complexity Reduction and Scaling for High Efficiency Video Encoders; 2015; Tese (Doutorado em Engenharia Electrotecnica e de Computadores) - Universidade de Coimbra, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Coorientador: Luciano Volcan Agostini;

Thaísa Leal da Silva

Contribuições para a Redução de Complexidade da Codificação Intra na Norma HEVC e Extensão 3D-HEVC; 2015; Tese (Doutorado em Engenharia Electrotecnica e de Computadores) - Universidade de Coimbra, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Coorientador: Luciano Volcan Agostini;

Marcelo Schiavon Porto

Desenvolvimento Algorítmico e Arquitetural para a Estimação de Movimento na Compressão de Vídeo de Alta Definição; 2012; Tese (Doutorado em Computação) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Coorientador: Luciano Volcan Agostini;

Guilherme Ribeiro Corrêa

2016; Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Luciano Volcan Agostini;

Guilherme Povala

Redução de Acesso à Memória Externa na Codificação de Vídeos UHD Utilizando Compressão de Quadros de Referência; 2015; Trabalho de Conclusão de Curso; (Graduação em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Mário Roberto de Freitas Saldanha

Esquema para Redução da Complexidade e Energia na Predição de Mapas de Profundidade do Padrão 3D-HEVC; 2015; Trabalho de Conclusão de Curso; (Graduação em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Cássio Rodrigo Cristani

Investigação da Estimação de Movimento para o Novo Codificador de Vídeo HEVC em Vídeos de Ultra Alta Definição; 2014; Trabalho de Conclusão de Curso; (Graduação em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Ruhan Avila da Conceição

Uma Solução Hardware/software Para O Filtro ALF Do Padrão HEVC; 2014; Trabalho de Conclusão de Curso; (Graduação em Engenharia de Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Gustavo Freitas Sanchez

Implementação e Análise de Algoritmos para a Estimação de Movimento em Vídeos de Alta Definição no Padrão Emergente HEVC; 2012; Trabalho de Conclusão de Curso; (Graduação em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Dieison Soares Silveira

Redução de Acessos à Memória em Codificadores de Vídeo através da Compressão dos Quadros de Referência; 2012; Trabalho de Conclusão de Curso; (Graduação em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

MARCEL MOSCARELLI CORRÊA

Implementação de Interpoladores para a Predição com Pixels Fracionários no HEVC; 2012; Trabalho de Conclusão de Curso; (Graduação em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Mateus Grellert da Silva

Heurísticas para Controle de Complexidade na Predição Inter-Quadros do Padrão de Codificacão de Vídeo Emergente HEVC; 2012; Trabalho de Conclusão de Curso; (Graduação em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Diego Vrague Noble

Exploração de novos algoritmos para a estimação de movimento em vídeos de alta definição; 2010; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Daniel Munari Vilchez Palomino

Desenvolvimento e implementação em hardware de heurísticas rápidas para o módulo de decisão de modo do padrão H; 264/AVC de codificação de vídeo; 2010; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Felipe Martin Sampaio

Arquitetura para a Estimação de Movimento (ME) e de Disparidade (DE) com Hierarquia de Memória Dedicada para a Codificação de Vídeos com Múltiplas Vistas Segundo o Padrão MVC; 2010; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Robson Sejanes Dornelles

Arquitetura para a Estimação de Movimento VBSME Integrada à Compensação de Movimento com Modo de Decisão Rápído para o Padrão H; 264/AVC; 2009; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Guilherme Ribeiro Corrêa

Desenvolvimento de Arquitetura para Vídeo Escalável Segundo o padrão H; 264/AVC; 2008; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Fabiane Rediess

Projeto, Síntese e Validação de Arquitetura do Upsampling para o Padrão H; 264/SVC de Codificação de Vídeo Escalável; 2008; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Carolina Marques Fonseca

Investigação em Software sobre o Padrão H; 264 Escalável de Compressão de Vídeos; 2008; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Rafael de Lima Petry

Desenvolvimento de Aplicações para TV Digital Interativa em Java com o Middleware GINGA; 2008; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Leandro Zanetti Paiva da Rosa

Investigação sobre Algoritmos para a Estimação de Movimento na Compressão de Vídeos Digitais de Alta Definição: Uma Análise Quantitativa; 2007; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Matheus Porciúncula Braga

Análise Automática da Propagação de Single-Event Transients Considerando Análise Temporal e Lógica; 2007; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Helen Franck

Uma Investigação Sobre Implementações Tolerantes a Falhas Transientes de Somadores Carry Lookahead e Ripple Carry em FPGA; 2007; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Eduardo Mesquita

Somadores Rápidos Tolerantes a Falhas Transientes Implementados em FPGA; 2007; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Bruno Zatt

Preditor de Vetores de Movimento em Hardware Segundo o Padrão H; 264/AVC; 2006; Trabalho de Conclusão de Curso; (Graduação em Engenharia de Computação) - Universidade Federal do Rio Grande do Sul; Orientador: Luciano Volcan Agostini;

Thaísa Leal da Silva

Codificação de Entropia no Padrão de Compressão de Vídeo H; 264/AVC: Algoritmos e Arquiteturas; 2005; 0 f; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Marcelo Schiavon Porto

Algoritmos e Arquiteturas para a Estimação de Movimento em Compressão de Vídeo; 2005; 0 f; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

André Marcelo Coelho da Silva

Desenvolvimento de um Compensador de Movimento para o Padrão H; 264 de Compressão de Vídeo; 2005; 0 f; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Rodrigo Araújo Tavares

Avaliação dos Impactos do Reuso de Hardware Através da Implementação de uma Interface PVCI Integrada a uma Arquitetura de Cálculo da DCT 2-D; 2004; 68 f; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Natan Bueno Ungethuem

DomoWork: Ambiente para Projeto de Sistemas de Automação Predial\Residencial Orientado a Objetos; 2004; 67 f; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Cristiano Brasil Sperb

Desenvolvimento de um Compressor JPEG em Software; 2004; 46 f; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Bruno Silveira Neves

Minimização de Erros das Operações de DCT 2-D e Quantização de um Compressor JPEG para Imagens em Tons de Cinza Descrito em VHDL; 2003; 80 f; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Roger Endrigo Carvalho Porto

Estudo e Desenvolvimento de Arquiteturas de Somadores para Uso na Compressão de Imagens JPEG; 2003; 45 f; Trabalho de Conclusão de Curso; (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Bianca Herrmann Waskow

Adaptação das Predições Intervistas e Interquadros do MV-HEVC para a Codificação Eficiente de Light Fields; 2019; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Eduardo Vargas Zummach

Desenvolvimento de hardware para codificadores de vídeo do estado da arte; 2019; Iniciação Científica; (Graduando em Engenharia de Controle e Automação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Mariana Ücker

Desenvolvimento de Modos de Predição Intraquadro para a Codificação de Imagens do Tipo Light Fields; 2018; Iniciação Científica; (Graduando em Engenharia Elétrica) - Instituto Federal Sul-Rio-Grandense, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Marilia Santos

Adaptação das Predições Intervistas e Interquadros do MV-HEVC para a Codificação Eficiente de Light Fields; 2018; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Iago Coelho Storch

Desenvolvimento de Algoritmos para a Codificação de Vídeos Omnidirecionais Através do Padrão HEVC; 2018; Iniciação Científica; (Graduando em Engenharia de Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Iago Coelho Storch

Desenvolvimento de um Controlador de Complexidade em Software para o Codificador do Padrão 3D-HEVC; 2017; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Mateus Terribele Leme

Projeto de hardware dedicado para predição Intraquadro de mapas de profundidade segundo o padrão 3D-HEVC; 2017; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Paulo Henrik Gonçalves

Desenvolvimento de Algoritmos Inovador no Sensoriamento da Detecção de Oclusão do Escoamento de Líquidos em Bombas de Infusão; 2017; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Guilherme Povala

edução de Acesso à Memória Externa na Codificação de Vídeos UHD Utilizando Compressão de Quadros de Referência; 2016; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Mário Roberto de Freitas Saldanha

Otimização de Algoritmos e Desenvolvimento de Arquiteturas de Hardware Dedicadas para a Predição Intra-Quadro do Padrão HEVC; 2016; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul; Orientador: Luciano Volcan Agostini;

Vinicius Furlan

Exploração de aprendizado de máquina aplicado na codificação de vídeos; 2016; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul; Orientador: Luciano Volcan Agostini;

Giovanni Avila

Redução de Complexidade em Codificadores de Vídeo 3D-HEVC; 2016; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Luan Audibert

Desenvolvimento de Algoritmos Otimizados e Hardware Dedicado para a Predição Inter-Quadros do Padrão HEVC; 2015; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Henrique do Amarilho Maich

Investigação e Desenvolvimento de Arquiteturas e de Algoritmos para a Compressão de Vídeos Digitais de Acordo com o Padrão Emergente HEVC ? High Efficiency Video Coding; 2014; Iniciação Científica; (Graduando em Engenharia de Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul; Orientador: Luciano Volcan Agostini;

Ândrio Ferreira de Araújo Campos

Investigação das ferramentas de codificação do padrão HEVC; 2014; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Ruhan Ávila Conceição

Otimização e desenvolvimento arquitetural para os filtros do padrão HEVC; 2014; Iniciação Científica; (Graduando em Engenharia de Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Cássio Rodrigo Cristani

Estimação de movimento em vídeos de resolução ultra alta; 2013; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

MARCEL MOSCARELLI CORRÊA

Desenvolvimento Arquitetural para a ME em Vídeos de Alta Definição com Suporte a Precisão de de Pixel; 2012; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul; Orientador: Luciano Volcan Agostini;

Victor Renan Covalski Junes

Investigação Algorítmica sobre a Estimação de Movimento no Padrão HEVC; 2012; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Guilherme Povala

Investigação e Desenvolvimento de Arquiteturas e de Algoritmos para a Compressão de Vídeos Digitais de Acordo com o Padrão Emergente HEVC ? High Efficiency Video Coding; 2012; Iniciação Científica; (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul; Orientador: Luciano Volcan Agostini;

Cássio Cristani

Investigação algoritmica para a estimação de movimento na codificação de vídeos digitais; 2012; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Financiadora de Estudos e Projetos; Orientador: Luciano Volcan Agostini;

Mateus Thurow Schoenknecht

Investigação sobre Interfaces de Entrada e Saída do Terminal de Acesso do SBTVD; 2011; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Financiadora de Estudos e Projetos; Orientador: Luciano Volcan Agostini;

MARCEL MOSCARELLI CORRÊA

Investigação sobre Interfaces de Entrada e Saída do Terminal de Acesso do SBTVD; 2010; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul; Orientador: Luciano Volcan Agostini;

Pargles Wenz Dall Oglio

Arquiteturas para a Predição Entre Camadas do Compressor H; 264/AVC Escalável; 2010; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Daniel Munari Vilchez Palomino

Desenvolvimento de soluções arquiteturais para a integração dos módulos do set-top Box do SBTVD com o decodificador H; 264/AVC, focado na hierarquia de memória; 2010; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fudação de Empreendimentos Científicos e Tecnológicos; Orientador: Luciano Volcan Agostini;

Felipe Martin Sampaio

Desenvolvimento e Prototipação de Arquiteturas para a Compressão de Vídeo Escalável com Foco nas Próximas Gerações do Sistema Brasileiro de TV Digital; 2010; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul; Orientador: Luciano Volcan Agostini;

Gabriel Leitão Cardozo

Desenvolvimento de Algoritmos Rápidos de Alta Qualidade com Estratégia Multi-Ponto; 2010; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Robson Sejanes Soares Dornelles

Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo Escalável para TV Digital - Parte I: Arquiteturas para as Transformadas Diretas e Inversas; 2009; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Gustavo Freitas Sanchez

Investigação de algoritmos para estimação de movimento na codificação de vídeos digitais; 2009; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Financiadora de Estudos e Projetos; Orientador: Luciano Volcan Agostini;

Felipe Martin Sampaio

Prototipação de Arquiteturas para Compressão de Vídeos em Placas com FPGAs Altera; 2008; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul; Orientador: Luciano Volcan Agostini;

Daniel Munari Palomino

Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo Escalável para TV Digital: Arquiteturas para Predição Intra Camadas; 2008; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Diego Vrague Noble

Desenvolvimento de Arquitetura para Loop de Transformadas e Quantização Dedicadas à Predição Intra do Codificador H; 264/AVC; 2008; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Financiadora de Estudos e Projetos; Orientador: Luciano Volcan Agostini;

Gabriel Sica Siedler

Validação de Arquiteturas Desenvolvidas para o Codificador do padrão H; 264/AVC; 2008; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Financiadora de Estudos e Projetos; Orientador: Luciano Volcan Agostini;

Guilherme Ribeiro Corrêa

Desenvolvimento de Arquitetura para as Transformadas do Perfil High do Padrão H; 264/AVC; 2007; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Carolina Marques Fonseca

Prototipação de Arquiteturas para Compressão de Vídeos em Placas com FPGAs Xilinx; 2007; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Felipe Martin Sampaio

Prototipação de Arquiteturas para Compressão de Vídeos em Placas com FPGAs Altera; 2007; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Leandro Zanetti Paiva da Rosa

Projeto de Arquiteturas para Compressão de Imagens JPEG Utilizando Metodologias de Reuso de Blocos de Hardware; 2006; 0 f; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul; Orientador: Luciano Volcan Agostini;

Rafael de Lima Petry

Investigação Algoritmica sobre a Estimação de Movimento; 2006; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Leandro Zanetti Paiva da Rosa

Investigação Algoritmica sobre a Estimação de Movimento; 2006; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Thaísa Leal da Silva

Estudo e Desenvolvimento de uma Interface BVCI; 2005; 0 f; Iniciação Científica; (Graduando em Bacharelado Em Informática) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Marcelo Schiavon Porto

Estudo e Desenvolvimento de uma Interface OCP; 2005; 0 f; Iniciação Científica; (Graduando em Bacharelado Em Informática) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

André Marcelo Coelho da Silva

Desenvolvimento de Blocos Arquiteturais para a Compressão de Vídeo Segundo o Padrão H; 264; 2005; 0 f; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

João Alberto Vortman

Desenvolvimento Arquitetural para a Codificação CAVLC do Padrão H; 264/AVC; 2005; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

FABIANE KONRAD REDIESS

Investigação Algoritmica sobre a Estimação de Movimento; 2005; Iniciação Científica; (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Guilherme Paim

Arquitetura de Hardware Multipadrão para o Interpolador dos Padrões de Codificação de Vídeo H; 264 e HEVC; 2015; Orientação de outra natureza; (Engenharia Eletrônica) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

MARCEL MOSCARELLI CORRÊA

Estimação de movimento em vídeos 3D no padrão HEVC; 2013; Orientação de outra natureza; (Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Paulo Eugenio Ferreira Fernandes

PET Computação UFPel - SBTVD: Processamento Paralelo e Distribuído; 2012; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Dieison Soares Silveira

PET Computação UFPel - SBTVD: Sistemas Digitais; 2010; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Israel Silva Barbará

PET Computação UFPel - SBTVD: Sistemas Inteligentes; 2010; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Daniel Santin Debastiani

PET Computação UFPel - SBTVD: Software Embarcado; 2010; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Ruhan Avila da Conceição

PET Computação UFPel - SBTVD: Sistemas Embarcados; 2010; Orientação de outra natureza; (Engenharia de Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

José Cláudio de Souza Jr

; PET Computação UFPel - SBTVD: Sistemas Embarcados; 2010; Orientação de outra natureza; (Engenharia de Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Gabriel Sica Siedler

PET Computação UFPel - SBTVD: Sistemas Inteligentes; 2010; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Gustavo Wrege Gonçalves

PET Computação UFPel - SBTVD: Sistemas Digitais; 2010; Orientação de outra natureza; (Engenharia de Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Andrws Aires Vieira

PET Computação UFPel - SBTVD: Sistemas Embarcados; 2010; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Vitor Alano de Ataides

PET Computação UFPel - SBTVD: Processamento Paralelo e Distribuído; 2009; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Pamela Polnow Gnutzmann

PET Computação UFPel - SBTVD: Processamento Paralelo e Distribuído; 2009; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Davi Decker Reinke

PET Computação UFPel; 2009; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Vinicius Neves Possani

PET Computação UFPel - SBTVD: Sistemas Digitais; 2009; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundo Nacional de Desenvolvimento da Educação; Orientador: Luciano Volcan Agostini;

Carolina Marques Fonseca

Gerência e Administração do Laboratório do Grupo de Arquiteturas e Circuitos Integrados; 2008; Orientação de outra natureza; (Técnico em Eletrônica) - Instituto Federal Sul-Rio-Grandense; Orientador: Luciano Volcan Agostini;

Mateus Grellert da Silva

Monitoria das Disciplinas da Área de Hardware do Curso de Ciência da Computação - UFPel; 2008; Orientação de outra natureza; (Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas; Orientador: Luciano Volcan Agostini;

Roger Endrigo Carvalho Porto

Desenvolvimento de Arquiteturas para a Compressão de Imagens e Vídeos; 2005; 0 f; Orientação de outra natureza - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Luciano Volcan Agostini;

Seção coletada automaticamente pelo Escavador

Foi orientado por

Sergio Bampi

Projeto de Arquiteturas Integradas para Compressão de Imagens JPEG; 2002; 0 f; Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul,; Orientador: Sergio Bampi;

Sergio Bampi

Desenvolvimento de Arquiteturas de Alto Desempenho dedicadas à compressão de vídeo segundo o Padrão H; 264/AVC; 2007; Tese (Doutorado em Computação) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Sergio Bampi;

Ivan Saraiva Silva

Desenvolvimento de Arquiteturas de Alto Desempenho Dedicadas à Compressão de Vídeo Segundo o Padrão H; 264/AVC; 2007; Tese (Doutorado em Computação) - Universidade Federal do Rio Grande do Sul,; Coorientador: Ivan Saraiva Silva;

Seção coletada automaticamente pelo Escavador

Produções bibliográficas

  • SANCHEZ, GUSTAVO ; SALDANHA, MARIO ; FERNANDES, RAMON ; CATALDO, RODRIGO ; Agostini, Luciano ; MARCON, CESAR . 3D-HEVC Bipartition Modes Encoder and Decoder Design Targeting High-Resolution Videos. IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS. I, REGULAR PAPERS (ONLINE) , v. 67, p. 415-427, 2020.

  • SALDANHA, MARIO ; SANCHEZ, GUSTAVO ; MARCON, CESAR ; Agostini, Luciano . Fast 3D-HEVC Depth Map Encoding Using Machine Learning. IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS FOR VIDEO TECHNOLOGY , v. 30, p. 850-861, 2020.

  • CORREA, MARCEL MOSCARELLI ; WASKOW, BIANCA HERMANN ; GOEBEL, JONES WILLIAM ; PALOMINO, DANIEL MUNARI ; CORREA, GUILHERME RIBEIRO ; AGOSTINI, LUCIANO VOLCAN . A High-Throughput Hardware Architecture for AV1 Non-Directional Intra Modes. IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS I-REGULAR PAPERS , v. 67, p. 1481-1494, 2020.

  • PERLEBERG, MURILO ; BORGES, VINICIUS ; AFONSO, VLADIMIR ; PALOMINO, Daniel ; Agostini, Luciano ; PORTO, Marcelo . 6WR: A Hardware Friendly 3D-HEVC DMM-1 Algorithm and its Energy-Aware and High-Throughput Design. IEEE Transactions on Circuits and Systems II: Express Briefs , v. 67, p. 836-840, 2020.

  • SALDANHA, MARIO ; SANCHEZ, GUSTAVO ; MARCON, CESAR ; Agostini, Luciano . Tile Adaptation for Workload Balancing of 3D-HEVC Encoder in Homogeneous Multicore Systems. IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS I-REGULAR PAPERS , v. 67, p. 1704-1714, 2020.

  • CORREA, Guilherme ; CONCEIÇÃO, RUHAN ; ZATT, Bruno ; Agostini, Luciano ; BUBOLZ, THIAGO ALVES ; GRELLERT, MATEUS . Direct and Semi-Direct Frame Partitioning Mapping for Computation and Energy-Aware HEVC Transrating. JICS. JOURNAL OF INTEGRATED CIRCUITS AND SYSTEMS (ED. PORTUGUÊS) , v. 15, p. 1-8, 2020.

  • PALAU, ROBERTA DE CARVALHO NOBRE ; PORTO, Marcelo ; Agostini, Luciano ; CORREA, Guilherme ; GOEBEL, JONES ; PALOMINO, Daniel . Real-Time and Low-Power HEVC Deblocking Filter Architecture Targeting 8K UHD @ 60fps Videos. JICS. JOURNAL OF INTEGRATED CIRCUITS AND SYSTEMS (ED. PORTUGUÊS) , v. 15, p. 1-9, 2020.

  • STORCH, I. ; CRUZ, L. A. S. ; AGOSTINI, L. V. ; ZATT, Bruno ; PALOMINO, D. M. . The Impacts of Equirectangular 360-degrees Videos in the Intra-Frame Prediction of HEVC. JICS. JOURNAL OF INTEGRATED CIRCUITS AND SYSTEMS (ED. PORTUGUÊS) , v. 14, p. 1-10, 2019.

  • DOMANSKI, R. A. ; GOEBEL, J. ; PENNY, W. ; PORTO, MARCELO ; PALOMINO, D. M. ; ZATT, Bruno ; AGOSTINI, L. V. . High-Throughput Multifilter Interpolation Architecture for AV1 Motion Compensation. IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS II-EXPRESS BRIEFS , v. 66, p. 883-887, 2019.

  • PENNY, WAGNER ; GOEBEL, JONES ; PAIM, GUILHERME ; PORTO, Marcelo ; Agostini, Luciano ; ZATT, Bruno . High-throughput and power-efficient hardware design for a multiple video coding standard sample interpolator. Journal of Real-Time Image Processing , v. 16, p. 175-192, 2019.

  • SILVEIRA, DIEISON ; POVALA, GUILHERME ; AMARAL, LÍVIA ; ZATT, Bruno ; Agostini, Luciano ; PORTO, Marcelo . Efficient reference frame compression scheme for video coding systems: algorithm and VLSI design. Journal of Real-Time Image Processing , v. 16, p. 391-411, 2019.

  • SEIDEL, ISMAEL ; MONTEIRO, MARCIO ; BONOTTO, BRUNO ; AGOSTINI, LUCIANO VOLCAN ; GUNTZEL, JOSE LUIS . Energy-Efficient Hadamard-Based SATD Hardware Architectures Through Calculation Reuse. IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS. I, REGULAR PAPERS (ONLINE) , v. 66, p. 2102-2115, 2019.

  • BUBOLZ, THIAGO LUIZ ALVES ; CONCEICAO, RUHAN A. ; GRELLERT, MATEUS ; Agostini, Luciano ; ZATT, Bruno ; CORREA, Guilherme . Quality and Energy-Aware HEVC Transrating Based on Machine Learning. IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS. I, REGULAR PAPERS (ONLINE) , v. 66, p. 2124-2136, 2019.

  • PERLEBERG, M. ; AFONSO, V. ; CONCEICAO, R. ; SUSIN, A. ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, MARCELO . High-Throughput Hardware Design for 3D-HEVC Disparity Estimation. IEEE Design & Test , v. 99, p. 1-1, 2019.

  • STORCH, I. ; PALOMINO, D. M. ; Zatt, Bruno ; AGOSTINI, L. V. . Speedup evaluation of HEVC parallel video coding using Tiles. Journal of Real-Time Image Processing , v. 99, p. 1-18, 2019.

  • AFONSO, VLADIMIR ; CONCEICAO, RUHAN ; SALDANHA, MARIO ; BRAATZ, LUCIANO ; PERLEBERG, MURILO ; CORREA, Guilherme ; PORTO, Marcelo ; Agostini, Luciano ; ZATT, Bruno ; SUSIN, Altamiro . Energy-Aware Motion and Disparity Estimation System for 3D-HEVC With Run-Time Adaptive Memory Hierarchy. IEEE Transactions on Circuits and Systems for Video Technology , v. 29, p. 1878-1892, 2019.

  • SANCHEZ, GUSTAVO ; SILVEIRA, JARBAS ; AGOSTINI, LUCIANO V. ; MARCON, CESAR . Performance Analysis of Depth Intra-Coding in 3D-HEVC. IEEE Transactions on Circuits and Systems for Video Technology , v. 29, p. 2509-2520, 2019.

  • UCKER, MARIANA ; AFONSO, V. ; SALDANHA, M. ; AUDIBERT, L. ; CONCEICAO, R. ; SUSIN, A. ; PORTO, MARCELO ; ZATT, Bruno ; AGOSTINI, L. V. . High-Throughput Hardware for 3D-HEVC Depth-Map Intra Prediction. IEEE Design & Test , v. 99, p. 1-6, 2019.

  • SANCHEZ, G. ; FERNANDES, RAMON ; CATALDO, RODRIGO ; AGOSTINI, L. V. ; SOUSA, L. ; MARCON, CESAR . Multicore Parallelism Exploration Targeting 3D-HEVC Intra-Frame Prediction. IEEE Design & Test , v. 99, p. 1-6, 2019.

  • PORTO, ROGER ; CORREA, MARCEL ; GOEBEL, JONES ; ZATT, Bruno ; ROMA, NUNO ; Agostini, Luciano ; PORTO, Marcelo . UHD 8K energy-quality scalable HEVC intra-prediction SAD unit hardware using optimized and configurable imprecise adders. Journal of Real-Time Image Processing , v. 99, p. 1-17, 2019.

  • SANCHEZ, GUSTAVO ; SALDANHA, MÁRIO ; Agostini, Luciano ; MARCON, CÉSAR . Analysis of parallel encoding using tiles in 3D High Efficiency Video Coding. Signal Image and Video Processing , v. 13, p. 1079-1086, 2019.

  • SALDANHA, M. ; SANCHEZ, G. ; MARCON, CESAR ; AGOSTINI, L. V. . Block-level fast coding scheme for depth maps in three-dimensional high efficiency video coding. JOURNAL OF ELECTRONIC IMAGING , v. 27, p. 1-4, 2018.

  • SANCHEZ, G. ; AGOSTINI, L. V. ; MARCON, CÉSAR . A reduced computational effort mode-level scheme for 3D-HEVC depth maps intra-frame prediction. JOURNAL OF VISUAL COMMUNICATION AND IMAGE REPRESENTATION , v. 54, p. 193-203, 2018.

  • SILVEIRA, DIEISON ; ZATT, Bruno ; Agostini, Luciano ; PORTO, Marcelo . Reference frame context-adaptive variable-length coder: a real-time hardware-friendly approach for lossless external memory bandwidth reduction in current video-coding systems. Journal of Real-Time Image Processing , v. 14, p. 249-265, 2018.

  • STORCH, I. ; PALOMINO, D. M. ; ZATT, Bruno ; AGOSTINI, L. V. . Speedup-Oriented History-Based Tiling Algorithm for the HEVC Standard Targeting an Efficient Parallelism Exploration. JICS. JOURNAL OF INTEGRATED CIRCUITS AND SYSTEMS (ED. PORTUGUÊS) , v. 13, p. 1-8, 2018.

  • PERLEBERG, M. ; AFONSO, V. ; CONCEICAO, R. ; SUSIN, A. ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, MARCELO . Energy and Rate-Aware Design for HEVC Motion Estimation Based on Pareto Efficiency. JICS. JOURNAL OF INTEGRATED CIRCUITS AND SYSTEMS (ED. PORTUGUÊS) , v. 13, p. 1-12, 2018.

  • SANCHEZ, G. ; AGOSTINI, L. V. ; SOUSA, L. ; MARCON, CESAR . Parallelism exploration for 3D high-efficiency video coding depth modeling mode one. Journal of Real-Time Image Processing , v. 99, p. 1-11, 2018.

  • SANCHEZ, GUSTAVO ; MARCON, CÉSAR ; AGOSTINI, LUCIANO VOLCAN . Exploration of depth modeling mode one lossless wedgelets storage strategies for 3D-high efficiency video coding. JOURNAL OF ELECTRONIC IMAGING , v. 27, p. 1-12, 2018.

  • AFONSO, V. ; CONCEICAO, R. ; PERLEBERG, M. ; PORTO, MARCELO ; ZATT, Bruno ; AGOSTINI, L. V. ; SUSIN, A. . Fast an Low-Power Hardware Design for HEVC Fractional Motion Estimation. IEEE COMSOC MMTC Communications - Frontiers , v. 12, p. 6-11, 2017.

  • SANCHEZ, GUSTAVO ; MARCON, CÉSAR ; Agostini, Luciano . Real-time scalable hardware architecture for 3D-HEVC bipartition modes. Journal of Real-Time Image Processing , v. 13, p. 71-83, 2017.

  • SALDANHA, MÁRIO ; SANCHEZ, GUSTAVO ; ZATT, Bruno ; PORTO, Marcelo ; Agostini, Luciano . Energy-aware scheme for the 3D-HEVC depth maps prediction. Journal of Real-Time Image Processing , v. 13, p. 55-69, 2017.

  • SANCHEZ, GUSTAVO ; JORDANI, L. ; MARCON, CESAR ; AGOSTINI, L. V. . DFPS: a fast pattern selector for depth modeling mode 1 in three-dimensional high-efficiency video coding standard. Journal of Electronic Imaging (Print) , v. 25, p. 063011, 2016.

  • AFONSO, V. ; MAICH, H. ; AUDIBERT, L. ; ZATT, Bruno ; PORTO, MARCELO ; AGOSTINI, L. V. ; SUSIN, A. . Hardware Implementation for the HEVC Fractional Motion Estimation Targeting Real-Time and Low-Energy. JICS. Journal of Integrated Circuits and Systems (Ed. Português) , v. 11, p. 106-120, 2016.

  • DA SILVA, THAÍSA LEAL ; AGOSTINI, LUCIANO VOLCAN ; DA SILVA CRUZ, LUIS ALBERTO . Fast intra prediction algorithm based on texture analysis for 3D-HEVC encoders. Journal of Real-Time Image Processing , v. 12, p. 357-368, 2016.

  • CORREA, Guilherme ; ASSUNCAO, PEDRO A. ; AGOSTINI, LUCIANO VOLCAN ; DA SILVA CRUZ, LUIS A. . Pareto-Based Method for High Efficiency Video Coding With Limited Encoding Time. IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS FOR VIDEO TECHNOLOGY , v. 26, p. 1734-1745, 2016.

  • CORREA, Guilherme ; ASSUNCAO, PEDRO ; Agostini, Luciano ; DA SILVA CRUZ, LUIS A. . Complexity scalability for real-time HEVC encoders. Journal of Real-Time Image Processing , v. 12, p. 107-122, 2016.

  • CORREA, GUILHERME ; ASSUNCAO, PEDRO ; Agostini, Luciano ; DA SILVA CRUZ, LUIS A. . Fast coding tree structure decision for HEVCbased on classification trees. ANALOG INTEGRATED CIRCUITS AND SIGNAL PROCESSING , v. 87, p. 129-139, 2016.

  • SANCHEZ, GUSTAVO ; SALDANHA, M. ; BALOTA, GABRIEL ; Zatt, Bruno ; PORTO, MARCELO ; AGOSTINI, LUCIANO V. . DMMFast: a complexity reduction scheme for three-dimensional high-efficiency video coding intraframe depth map coding. Journal of Electronic Imaging (Print) , v. 24, p. 023011, 2015.

  • CANCELLIER, L. H. ; BRASCHER, A. B. ; SEIDEL, I. ; GÜNTZEL, J. L. A. ; AGOSTINI, L. V. . Exploring Optimized Hadamard Methods to Design Energy-Efficient SATD Processors. JICS. Journal of Integrated Circuits and Systems (Ed. Português) , v. 10, p. 113-122, 2015.

  • CORREA, Guilherme ; ASSUNCAO, PEDRO A. ; AGOSTINI, LUCIANO VOLCAN ; DA SILVA CRUZ, LUIS A. . Fast HEVC Encoding Decisions Using Data Mining. IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS FOR VIDEO TECHNOLOGY , v. 25, p. 660-673, 2015.

  • SANCHEZ, GUSTAVO ; ZATT, Bruno ; PORTO, Marcelo ; Agostini, Luciano . Hardware-friendly HEVC motion estimation: new algorithms and efficient VLSI designs targeting high definition videos. ANALOG INTEGRATED CIRCUITS AND SIGNAL PROCESSING (DORDRECHT. ONLINE) , v. 82, p. 135-146, 2015.

  • SILVA, Thaisa Leal da ; AGOSTINI, L. V. ; CRUZ, LUIS A. DA SILVA . Inter-view prediction of intra mode decision forhigh-efficiency video coding-based multiviewvideo coding. Journal of Electronic Imaging (Print) , v. 23, p. 033008, 2014.

  • CONCEICAO, R. ; SOUZA JR., J. C. ; JESKE, R. G. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. . Low-Cost and High-Throughput Hardware Design for the HEVC 16x16 2-D DCT Transform. JICS. Journal of Integrated Circuits and Systems (Ed. Português) , v. 9, p. 25-35, 2014.

  • DA SILVA, THAÍSA LEAL ; AGOSTINI, LUCIANO VOLCAN ; DA SILVA CRUZ, LUIS ALBERTO . HEVC intra prediction acceleration based on texture direction and prediction unit modes reuse. APSIPA Transactions on Signal and Information Processing , v. 3, p. e13, 2014.

  • ZATT, Bruno ; LIMA, L. M. ; AZEVEDO, Arnaldo ; AGOSTINI, L. V. ; SUSIN, Altamiro ; BAMPI, Sergio . A reduced memory bandwidth and high throughput HDTV motion compensation decoder for H.264/AVC High 4:2:2 profile. Journal of Real-Time Image Processing (Print) , v. 8, p. 127-140, 2013.

  • AGOSTINI, L. V. ; PORTO, Marcelo Schiavon ; CRISTANI, C. R. ; OGLIO, P. D. ; SILVA, M. G. ; MATOS, J. C. B. ; BAMPI, Sergio . Iterative random search: a new local minima resistant algorithm for motion estimation in high-definition videos. Multimedia Tools and Applications , v. 63, p. 107-127, 2013.

  • GONCALVES, J. L. ; TROJAN, T. ; MARQUES, F. ; MATOS, J. C. B. ; AGOSTINI, L. V. ; ROSA JR, L. S. . Implementation and Performance Evaluation of a Media Decoder with Hardware Acceleration Support Targeting High Definition Streams in the SBTVD Ginga Middleware. J INTERNET TECHNOL , v. 14, p. 273-280, 2013.

  • TROJAN, T. ; GONCALVES, J. L. ; MATOS, J. C. B. ; AGOSTINI, L. V. ; ROSA JR, L. S. . Evaluating two implementations of the component responsible for decoding video and audio in the Brazilian digital TV middleware. Multimedia Tools and Applications , v. 57, p. 373-392, 2012.

  • POSSANI, V. N. ; Souza, R. S. ; Domingues, J. S. ; AGOSTINI, L. V. ; MARQUES, F. ; ROSA JR, L. S. . Optimizing transistor networks using a graph-based technique. Analog Integrated Circuits and Signal Processing , v. 73, p. 841-850, 2012.

  • PORTO, Marcelo Schiavon ; ALTERMANN, J. ; COSTA, Eduardo ; AGOSTINI, L. V. ; BAMPI, Sergio . Power efficient SDS motion estimation architecture using dynamic iteration control and hierarchical adder compressors for real time HDTV video coding. Analog Integrated Circuits and Signal Processing , v. 73, p. 919-930, 2012.

  • CORRÊA, Guilherme Ribeiro ; PALOMINO, Daniel ; DINIZ, Cláudio Machdo ; BAMPI, Sergio ; AGOSTINI, L. V. . Low-Complexity Hierarchical Mode Decision Algorithms Targeting VLSI Architecture Design for the H.264/AVC Video Encoder. VLSI Design , v. 2012, p. 1-20, 2012.

  • CORRÊA, Guilherme Ribeiro ; AGOSTINI, L. V. ; CRUZ, Luís Alberto . Sample-Level Filtering Order for High-Throughput and Memory-Aware H.264 Deblocking Filter. ISRN Signal Processing , v. 2012, p. 1-6, 2012.

  • PORTO, Marcelo Schiavon ; BAMPI, Sergio ; SANCHEZ, G. ; NOBLE, Diego ; AGOSTINI, L. V. . New Motion Estimation Algorithms and its VLSI Architectures for Real Time High Definition Video Coding. JICS. Journal of Integrated Circuits and Systems (Ed. Português) , v. 7, p. 37-46, 2012.

  • LOPES, A. S. B. ; SILVA, Ivan Saraiva ; AGOSTINI, L. V. . A Memory Hierarchy Model Based on Data Reuse for Full-Search Motion Estimation on High-Definition Digital Videos. International Journal of Reconfigurable Computing (Print) , v. 2012, p. 1-10, 2012.

  • SANCHEZ, G. ; CORREA, M. M. ; NOBLE, Diego ; PORTO, Marcelo Schiavon ; BAMPI, Sergio ; AGOSTINI, L. V. . Hardware design focusing in the tradeoff cost versus quality for the H.264/AVC fractional motion estimation targeting high definition videos. Analog Integrated Circuits and Signal Processing , v. 73, p. 931-944, 2012.

  • CORRÊA, Guilherme Ribeiro ; ASSUNCAO, P. A. ; CRUZ, Luís Alberto ; AGOSTINI, L. V. . Performance and Computational Complexity Assessment of High-Efficiency Video Encoders. IEEE Transactions on Circuits and Systems for Video Technology (Print) , v. 22, p. 1899-1909, 2012.

  • PALOMINO, D. M. ; CORRÊA, G. ; DINIZ, C. ; AGOSTINI, L. V. ; BAMPI, Sérgio ; SUSIN, A. . Algorithm and Hardware Design of a Fast Intra Frame Mode Decision Module for H.264/AVC Encoders. International Journal of Reconfigurable Computing (Print) , v. 2012, p. 1-10, 2012.

  • SILVA, M. G. ; SAMPAIO, Felipe ; AGOSTINI, L. V. ; MATTOS, JÚLIO . MSBSD: Um Algoritmo para Decisão Rápida na Inter-Predição em Codificadores HEVC. Revista Eletrônica de Iniciação Científica , v. 12, p. 30811, 2012.

  • MONTEIRO, Jucemar Luis ; AGOSTINI, L. V. ; GÜNTZEL, J. L. ; GÜNTZEL, J. L. A. . Uma Arquitetura Rápida de Somador Binário de Alta Eficiência Energética. Revista Eletrônica de Iniciação Científica , v. 12, p. 1-11, 2012.

  • SANCHEZ, G. ; SAMPAIO, Felipe Martin ; PORTO, Marcelo ; BAMPI, Sérgio ; AGOSTINI, L. V. . DMPDS: A Fast Motion Estimation Algorithm Targeting High Resolution Videos and Its FPGA Implementation. International Journal of Reconfigurable Computing (Print) , v. 2012, p. 1-12, 2012.

  • CORREA, M. M. ; SCHOENKNECHT, M. T. ; DORNELLES, Robson ; AGOSTINI, L. V. . A High-Throughput Hardware Architecture for the H.264/AVC Half-Pixel Motion Estimation Targeting High-Definition Videos. International Journal of Reconfigurable Computing (Print) , v. 2011, p. 1-9, 2011.

  • PORTO, Marcelo Schiavon ; NOBLE, Diego ; BAMPI, Sergio ; AGOSTINI, L. V. . Two fast multi-point search algorithms for high quality motion estimation in high resolution videos. International Journal of Information Technology, Communications and Convergence , v. 1, p. 410, 2011.

  • TROJAN, T. ; GONCALVES, J. L. ; MATOS, J. C. B. ; AGOSTINI, L. V. ; ROSA JR, L. S. . A comparative analysis of media processing component implementations for the Brazilian digital TV middleware. International Journal of Information Technology, Communications and Convergence , v. 1, p. 391, 2011.

  • SILVA, Thaísa Leal da ; CRUZ, Luís Alberto ; AGOSTINI, L. V. . A Novel Macroblock-Level Filtering Upsampling Architecture for H.264/AVC Scalable Extension. JICS. Journal of Integrated Circuits and Systems (Ed. Português) , v. 6, p. 43-49, 2011.

  • Cristani, C. ; DALL'OGLIO, Pargles ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. . Galaxy Random Search: Algoritmo e Arquitetura para Estimação de Movimento em Vídeos de Alta Definição. Revista Eletrônica de Iniciação Científica , v. 11, p. 23780, 2011.

  • CORREA, GUILHERME ; ASSUNCAO, PEDRO ; Agostini, Luciano ; DA SILVA CRUZ, LUIS . Complexity control of high efficiency video encoders for power-constrained devices. IEEE Transactions on Consumer Electronics , v. 57, p. 1866-1874, 2011.

  • SAMPAIO, Felipe ; PALOMINO, Daniel ; DORNELLES, Robson ; AGOSTINI, L. V. . High Throughput and Low Cost Architecture for the Forward Quantization of the H.264/AVC Video Compression Standard. CLEI Electronic Journal , v. 13, p. 5, 2010.

  • TROJAN, T. ; MATOS, J. C. B. ; AGOSTINI, L. V. ; GONCALVES, J. L. ; ROSA JR, L. S. . A Comparative Analysis of Media Processing Component Implementations for the Brazilian Digital TV Middleware. Revista Ciência e Tecnologia , v. 12, p. 1-9, 2009.

  • AGOSTINI, L. V. ; PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; ROSA, Leandro Zanetti Paiva da ; GÜNTZEL, José Luis ; SILVA, Ivan Saraiva ; BAMPI, Sergio . Forward and Inverse 2-D DCT architectures targeting HDTV for H.264/AVC video compression standard. Latin American Applied Research , v. 37, p. 11-16, 2007.

  • AGOSTINI, L. V. ; SILVA, Ivan Saraiva ; BAMPI, Sergio . Multiplierless and fully pipelined JPEG compression soft IP targeting FPGAs. Microprocessors and Microsystems , v. 31, p. 487-497, 2007.

  • ROSA, Leandro Zanetti Paiva da ; PORTO, Marcelo Schiavon ; REDIESS, Fabiane Konrad ; PETRY, Rafael ; SUSIN, Altamiro ; BAMPI, Sergio ; AGOSTINI, L. V. . Avaliação Algorítmica para a Estimação de Movimento na Compressão de Vídeos Digitais. Hífen (PUCRS. Impresso) , v. 31, p. 57-63, 2007.

  • AGOSTINI, LUCIANO V. ; AZEVEDO FILHO, ARNALDO P. ; STAEHLER, WAGSTON T. ; ROSA, VAGNER S. ; ZATT, Bruno ; PINTO, ANA CRISTINA M. ; PORTO, ROGER ENDRIGO ; Bampi, Sergio ; SUSIN, ALTAMIRO A. . Design and FPGA prototyping of a H.264/AVC main profile decoder for HDTV. JOURNAL OF THE BRAZILIAN COMPUTER SOCIETY (ONLINE) , v. 13, p. 25-36, 2007.

  • VORTMAN, João Alberto ; SILVA, Thaísa Leal da ; REDIESS, Fabiane Konrad ; GÜNTZEL, José Luis ; BAMPI, Sergio ; AGOSTINI, L. V. . Codificador de Entropia Segundo o Perfil Baseline do padrão H.264/AVC de Compressão de Vídeo. Hífen (PUCRS. Impresso) , Uruguaiana, v. 30, p. 49-56, 2006.

  • REDIESS, Fabiane Konrad ; SILVA, Andre Marcelo Coelho da ; VORTMAN, João Alberto ; GÜNTZEL, José Luis ; BAMPI, Sergio ; AGOSTINI, L. V. . Projeto de Hardware para a Compensação de Movimento do Padrão H.264/AVC de Compressão de Vídeo. Hífen (PUCRS. Impresso) , Uruguaiana, v. 30, p. 57-64, 2006.

  • PORTO, Marcelo Schiavon ; ROSA, Leandro Zanetti Paiva da ; SILVA, Thaisa Leal da ; PORTO, Roger Endrigo Carvalho ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; GÜNTZEL, José Luis ; AGOSTINI, L. V. . Arquiteturas de Cálculo da FDCT 2-D e da IDCT 2-D para Codecs HDTV no Padrão H.264/AVC. Hífen (PUCRS. Impresso) , Uruguaiana - RS, v. 29, n.55/56, p. 129-138, 2005.

  • SILVA, Thaisa Leal da ; PORTO, Marcelo Schiavon ; PORTO, Roger Endrigo Carvalho ; ROSA, Leandro Zanetti Paiva da ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; GÜNTZEL, José Luis ; AGOSTINI, L. V. . Comparison between OCP, PVCI and BVCI Hardware Reuse Interfaces Designed in VHDL and Mapped to FPGAs. Hífen (PUCRS. Impresso) , Uruguaiana - RS, v. 29, n.55/56, p. 119-128, 2005.

  • AGOSTINI, L. V. ; SILVA, Ivan Saraiva ; BAMPI, Sergio . Parallel color space converters for JPEG image compression. Microelectronics and Reliability , Inglaterra, v. 44, n.4, p. 697-703, 2004.

  • UNGETHUEM, Natan Bueno ; ARAÚJO, Jair Jonko ; AGOSTINI, L. V. . DomoWork: Ambiente para Projeto de Sistemas de Automação Predial\Residencial Orientado a Objetos. Hífen (PUCRS. Impresso) , Uruguaiana - RS, v. 28, n.54, p. 59-64, 2004.

  • AGOSTINI, L. V. ; PORTO, Roger Endrigo Carvalho . Exploração do Espaço de Projeto da DCT 2-D de um Compressor de Imagens JPEG. Hífen (PUCRS. Impresso) , Uruguaiana, v. 27, n.52, p. 171-176, 2003.

Seção coletada automaticamente pelo Escavador

Outras produções

AGOSTINI, L. V. . Consultor ad hoc da FAPERGS no Edital Emergencial 06/2020 - Ciência e Tecnologia no Combate à COVID - 19. 2020.

AGOSTINI, L. V. . Consultor Ad Hoc da FACEPE no Edital PIBIC 01/2020, área de Computação.. 2020.

AGOSTINI, L. V. . Consultor Ad Hoc do Programa Centelha/RS Fase 1 - Ideia Inovadora. 2019.

AGOSTINI, L. V. . Consultor Ad Hoc do Programa Centelha/RS Fase 2 - Projetos de Empreendimento.. 2019.

AGOSTINI, L. V. . Consultor Ad Hoc do Programa Centelha/RS Fase 3 - Projetos de Fomento.. 2019.

AGOSTINI, L. V. . Consultor Ad Hoc do Edital FAPERGS/CAPES 04/2018 - Programa de Bolsas de Fixação de Doutores - DOCFIX. 2018.

AGOSTINI, L. V. . Consultor Ad Hoc do Edital FAPERGS 04/2016 - Programa de Nucleação de Grupos de Pesquisa (PRONUPEQ). 2016.

AGOSTINI, L. V. . Consultor Ad Hoc do Programa Proyectos de I+D. 2016.

AGOSTINI, LUCIANO V. . Membro do Comitê de Avaliação do Edital FAPERGS 03/2014 - Programa de Iniciação em Ciências, Matemática, Engenharias, Tecnologias Criativas e Letras (PICMEL), área de Computação.. 2014.

AGOSTINI, LUCIANO V. . Consultor Ad Hoc do Edital PIBIC/FACEPE - 02/2014, área de Computação.. 2014.

AGOSTINI, L. V. . Coordenador do Comitê de Avaliação do Edital FAPERGS 02/2014 - Programa Pesquisador Gaúcho (PqG), área de Matemática, Estatística e Computação. 2014.

AGOSTINI, L. V. . Avaliador externo na FURG dos Editais PIBIC e PIBITI do CNPq, área de Computação.. 2014.

AGOSTINI, LUCIANO V. . Membro do Comitê de Avaliação do Edital FAPERGS 01/2013 - Pesquisador Gaúcho (PqG), área de Matemática, Estatística e Computação.. 2013.

AGOSTINI, LUCIANO V. . Membro do Comitê de Avaliação do Edital FAPERGS 15/2013 - Programa de Iniciação em Ciências, Matemática, Engenharias, Tecnologias Criativas e Letras (PICMEL), área de Computação.. 2013.

AGOSTINI, LUCIANO V. . Membro do Comitê de Avaliação da Chamada Pública MCT/FINEP/CT-INFRA - 01/2013.. 2013.

AGOSTINI, LUCIANO V. . Avaliador externo na FURG dos Editais PIBIC e PIBITI do CNPq, área de Computação.. 2013.

AGOSTINI, LUCIANO V. . Membro do Comitê de Avaliação do Edital FAPERGS 09/2013 - Cooperação Internacional FAPERGS/INRIA/INS2i-CNRS, área de Computação.. 2013.

AGOSTINI, LUCIANO V. . Avaliador de projeto do Edital PAPPE SUBVENÇÃO - 04/2008, área de Computação.. 2008.

TROJAN, T. ; GONCALVES, J. L. ; MATOS, J. C. B. ; AGOSTINI, L. V. ; ROSA JR, L. S. . Componente Media Processing do OpenGinga - Gingaj do SBTVD. 2011.

BRAGA, Matheus ; AGOSTINI, L. V. ; GÜNTZEL, José Luis . GILDA. 2007.

UNGETHUEM, Natan Bueno ; ARAÚJO, Jair Jonko ; AGOSTINI, L. V. . DomoWork. 2004.

AGOSTINI, L. V. ; PRADO, A. R. . Caipirinha Viewer. 2001.

AGOSTINI, L. V. ; PACHECO, R. V. ; CARDOZO, A. ; REINHARDT, K. F. ; PERAÇA, S. E. . OdontoMed. 1998.

AGOSTINI, L. V. . EDITORA. 1998.

SUSIN, Altamiro ; BAMPI, Sergio ; AGOSTINI, L. V. . Protótipo de codificador de vídeo H.264/AVC para o Sistema Brasileiro de TV Digital (SBTVD). 2011.

JACOBI, R. ; SUSIN, Altamiro ; SILVA, Ivan Saraiva ; AGOSTINI, L. V. . Protótipo do terminal de acesso do Sistema Brasileiro de TV Digital (SBTVD). 2011.

SUSIN, Altamiro ; BAMPI, Sergio ; AGOSTINI, L. V. . Protótipo de decodificador de vídeo H.264/AVC para o Sistema Brasileiro de TV Digital (SBTVD). 2006.

AGOSTINI, L. V. . LASCAS 2020 - 11th IEEE Latin American Symposium on Circuits and Systems. Membro do Technical Program Committee (TPC) e responsável pela avaliação de quatro artigos.. 2020.

AGOSTINI, L. V. . ICME 2020 - IEEE International Conference on Multimedia and Expo. Avaliador de cinco artigos.. 2020.

AGOSTINI, L. V. . SBCCI 2020 - 33nd Symposium on Integrated Circuits and Systems Design. Track Chair da track Digital Circuits and Applications, responsável por 18 artigos.. 2020.

AGOSTINI, L. V. . ICECS 2020 - IEEE International Conference on Electronics Circuits and Systems. Track Chair - Signal Image and Video Processing.. 2020.

AGOSTINI, L. V. . AICAS 2020 - 2nd IEEE International Conference on Artificial Intelligence Circuits and Systems. Review Committee Member (RCM) responsável pela avaliação de três artigos.. 2019.

AGOSTINI, L. V. . SPL 2019 - X Southern Conference on Programmable Logic. Technical Program Committee Member avaliando dois artigos.. 2019.

AGOSTINI, L. V. . SBCCI 2019 - 32nd Symposium on Integrated Circuits and Systems Design. Technical Program Committee Member revisando três artigos.. 2019.

AGOSTINI, L. V. . WEAC 2019 - Workshop sobre Educação em Arquitetura de Computadores. Avaliador de um artigo.. 2019.

AGOSTINI, L. V. . WebMedia 2019 - Simpósio Brasileiro de Sistemas Multimídia e Web. Membro do Technical Program Committee, avaliando artigos.. 2019.

AGOSTINI, L. V. . SBrT 2019 - XXXVII Simpósio Brasileiro de Telecomunicações e Processamento de Sinais. Membro do Program Committee revisando três artigos.. 2019.

AGOSTINI, L. V. . ICECS 2019 - IEEE International Conference on Electronics Circuits and Systems. Track Chair - Signal Image and Video Processing, responsável por 15 artigos.. 2019.

AGOSTINI, L. V. . ICME 2019 - IEEE International Conference on Multimedia and Expo. Avaliador de quatro artigos.. 2019.

AGOSTINI, L. V. . LASCAS 2019 - 10th IEEE Latin American Symposium on Circuits and Systems. Track Chair (Track Digital Signal Processing) responsável pela avaliação de 12 artigos.. 2018.

AGOSTINI, L. V. . LASCAS 2019 - 10th IEEE Latin American Symposium on Circuits and Systems. Program Committee Member (Digital Integrated Circuits and Systems), avaliando quatro artigos.. 2018.

AGOSTINI, L. V. . MWSCAS 2018 - IEEE 61st International Midwest Symposium on Circuits and Systems. Avaliação de um artigo.. 2018.

AGOSTINI, L. V. . WebMedia 2018 - Simpósio Brasileiro de Sistemas Multimídia e Web. Membro do Technical Program Committee, avaliando quatro artigos.. 2018.

AGOSTINI, L. V. . SBrT 2018 - XXXVI Simpósio Brasileiro de Telecomunicações e Processamento de Sinais. Membro do Program Committee avaliando 11 artigos.. 2018.

AGOSTINI, L. V. . SBCCI 2018 - 31st Symposium on Integrated Circuits and Systems Design. Membro do Technical Program Committee avaliando dois artigos.. 2018.

AGOSTINI, L. V. . ICECS 2018 - IEEE International Conference on Electronics Circuits and Systems. Track Chair - Signal Image and Video Processing, responsável por 12 artigos.. 2018.

AGOSTINI, L. V. . ICECS 2018 - IEEE International Conference on Electronics Circuits and Systems. Avaliador de quatro artigos.. 2018.

AGOSTINI, L. V. . ICME 2018 - IEEE International Conference on Multimedia and Expo. Avaliador de quatro artigos.. 2018.

AGOSTINI, L. V. . ISCAS 2018 - IEEE International Symposium of Circuits and Systems. RCM no evento responsável por três artigos.. 2018.

AGOSTINI, L. V. . LASCAS 2018 - 9th IEEE Latin American Symposium on Circuits and Systems. Avaliador de seis artigos.. 2017.

AGOSTINI, L. V. . ISCAS 2017 - IEEE International Symposium of Circuits and Systems. RCM no evento responsável por dois artigos.. 2017.

AGOSTINI, L. V. . WEAC 2017 - Workshop sobre Educação em Arquitetura de Computadores. Avaliador de um artigo.. 2017.

AGOSTINI, L. V. . WebMedia 2018 - Simpósio Brasileiro de Sistemas Multimídia e Web. Membro do Technical Program Committee, avaliando seis artigos.. 2017.

Vera Lopes ; AGOSTINI, L. V. . Sistema Brasileiro de TV Digital. 2007. (Programa de rádio ou TV/Entrevista).

AGOSTINI, L. V. . Sistema Brasileiro de TV Digital. 2007. (Programa de rádio ou TV/Entrevista).

Vera Lopes ; AGOSTINI, L. V. . TV Digital e Novas Tecnologias. 2007. (Programa de rádio ou TV/Entrevista).

AGOSTINI, L. V. ; Valter Roesler . Sistema Brasileiro de TV Digital. 2006. (Programa de rádio ou TV/Mesa redonda).

SUSIN, Altamiro ; AGOSTINI, L. V. . Compressão de Vídeo e TV Digital. 2006. (Programa de rádio ou TV/Entrevista).

AGOSTINI, L. V. . EMicro 2020 - Curso Básico 7: Microprocessadores e Systems-on-Chip. 2020. (Curso de curta duração ministrado/Outra).

AGOSTINI, L. V. . Projeto de Arquiteturas Dedicadas para Codificação de Vídeo do Padrão Brasileiro de TV Digital. 2009. (Curso de curta duração ministrado/Outra).

AGOSTINI, L. V. . TV Digital: Arquiteturas para Codificação e Decodificação de Vídeo Segundo o Padrão H.264/AVC. 2009. (Curso de curta duração ministrado/Outra).

AGOSTINI, L. V. . Projeto de Hardware para a Decodificação de Vídeo do Sistema Brasileiro de TV Digital. 2008. (Curso de curta duração ministrado/Outra).

Seção coletada automaticamente pelo Escavador

Projetos de pesquisa

  • 2017 - Atual

    Desenvolvimento de Algoritmos para a Detecção de Oclusão do Escoamento de Líquidos em Bombas de Infusão através de Sensores Ópticos, Descrição: O presente projeto tem o objetivo de investigar e desenvolver algoritmos para a detecção de oclusão do escoamento de líquidos em bombas de infusão, equipamentos eletro-médicos de grande relevância para o suporte a vida em UTIs e salas cirúrgicas. A ideia principal a ser investigada é desenvolver um sistema de medição de pressão para detecção de oclusão sem o efeito de carregamento entre os estágios do transdutor sensor e a primeira hipótese a ser avaliada é a da utilização da reflexão/retroespalhamento da luz como sinal de leitura da pressão. A aplicação de sensores ópticos na leitura de pressão é uma proposta inovadora, pois permite a leitura de pressão de forma não invasiva, já que não é necessária a adição de elementos mecânicos com molas ou membranas com o elemento transdutor. Portanto essa inovação tem potencial para trazer um melhor desempenho nas bombas de infusão, ampliando sua eficiência e eficácia na administração de medicamentos. Assim, a contribuição esperada é gerar resultados capazes de ultrapassar os requisitos normativos vigentes para os critérios de conformidade exigidos na certificação das bombas de infusão, criando um novo patamar de qualidade para estes equipamentos.. , Situação: Em andamento; Natureza: Pesquisa. , Alunos envolvidos: Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Adenauer Yamin - Integrante / Fabrício Neitzke Ferreira - Integrante.

  • 2016 - Atual

    SISCHIP2 - Concepção e Síntese de Sistemas em Chip - A1: Circuitos Integrados Dedicados ao Processamento de Vídeo Digital, Projeto certificado pelo(a) coordenador(a) Ricardo Augusto da Luz Reis em 17/05/2018., Descrição: O projeto PRONEX SISCHIP2 irá congregar cinco Universidades Federais do Estado ? a UFRGS, a UFSM, a FURG, a Unipampa e a UFPel ?, que desenvolverão conjuntamente metodologias, ferramentas e protótipos de circuitos vinculados a uma das quatro áreas de concentração. A área A1 do projeto global, que é foco deste projeto específicos, é a de Circuitos Integrados Dedicados ao Processamento de Vídeo Digital onde novos algoritmos e arquiteturas integradas dedicadas (application-specific) para o processamento de vídeo digital serão desenvolvidos. Codecs novos e eficientes energeticamente para a codificação HEVC são o objetivo neste domínio. Novas arquiteturas de hardware dedicadas à estimativa de movimento, aos acessos eficientes à memória em codificadores paralelos para o padrão HEVC serão propostas e implementadas.. , Situação: Em andamento; Natureza: Pesquisa. , Integrantes: Luciano Volcan Agostini - Integrante / Ricardo Reis - Coordenador / Marcelo Schiavon Porto - Integrante / Bruno Zatt - Integrante / Guilherme Ribeiro Corrêa - Integrante / Daniel Munari Palomino - Integrante / Sergio Bampi - Integrante., Financiador(es): Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro.

  • 2016 - Atual

    Algoritmos Eficientes para a Codificação de Vídeos em Sistemas Embarcados Adaptativos, Descrição: Este projeto visa a geração de algoritmos otimizados para a área de codificação de vídeos, tirando proveito de sistemas embarcados adaptativos, para que sejam executados com maior desempenho e menor consumo energético. Como ponto de partida para as investigações propostas, os algoritmos de codificação de vídeos do padrão HEVC, estado da arte na área, serão otimizados para a execução em sistemas embarcados com unidades reconfiguráveis transparentes (para que possam ser otimizados sem modificação alguma no código).. , Situação: Em andamento; Natureza: Pesquisa. , Integrantes: Luciano Volcan Agostini - Coordenador / Marcelo Schiavon Porto - Integrante / Bruno Zatt - Integrante / Júlio Carlos Balzano de Matos - Integrante / Antonio Carlos Scheneider Beck Filho - Integrante / Gabriel Luca Nazar - Integrante / Mateus Beck Rutzig - Integrante., Financiador(es): Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro.

  • 2011 - Atual

    Heurísticas, Otimizações Algorítmicas e Projetos Arquiteturais para o Padrão HEVC de Codificação de Vídeos Digitais: Soluções Integradas no Desenvolvimento de Hardware Dedicado para Aplicativos Móveis e Sistemas Embarcados em Geral, Descrição: Este projeto está focado na geração de soluções inovadoras para a compressão de vídeos digitais de acordo com o padrão emergente HEVC - High Efficiency Video Coding. Este padrão é o estado da arte para aplicações que manipulam vídeos digitais. As soluções geradas no escopo deste projeto estarão pautadas por critérios tradicionais como qualidade do vídeo gerado, taxa de compressão e complexidade, mas também irão considerar outros critérios, como o consumo de energia e a facilidade de exploração de paralelismo, cujo objetivo é desenvolver soluções eficientes para a implementação em hardware, em especial, para circuitos integrados direcionados para dispositivos móveis. Neste sentido, serão desenvolvidas novas heurísticas, novos algoritmos otimizados e, também, arquiteturas dedicadas, que serão direcionadas para FPGAs e standard-cells. Então a execução do projeto será capaz de gerar impactos científicos e tecnológicos de grande interesse comercial, com potencial de gerar patentes e publicações relevantes. As ferramentas de codificação do HEVC que serão foco deste projeto serão a predição inter-quadros, as transformadas de tamanho variável e os filtros. Além disso, serão desenvolvidas soluções para o controle dinâmico de complexidade do codificador e para a redução do número de acessos à memória externa. Como resultados esperados da execução deste projeto, além do desenvolvimento de heurísticas, algoritmos e arquiteturas para o HEVC, espera-se a geração de quatro artigos para eventos internacionais ou nacionais qualificados e dois artigos para periódicos qualificados. Também espera-se que seja possível gerar pelo menos duas patentes com os resultados mais inovadores e de maior interesse comercial do projeto. Como resultado mais amplo, pretende-se estreitar os laços de cooperação entre os pesquisadores da UFPel com os pesquisadores da UC (Universidade de Coimbra) e do IPL (Instituto Politécnico de Leiria), ambos em Portugal, do KIT (Karlsruhe Institute of Technology), na Alemanha, e da UFRGS, UFSC e IFSul, contribuindo para a geração de um pólo de desenvolvimento tecnológico em microeletrônica e codificação de vídeo na UFPel. Também se espera que a execução deste projeto possa contribuir com a consolidação do Programa de Pós-Graduação em Computação da UFPel.. , Situação: Em andamento; Natureza: Pesquisa. , Alunos envolvidos: Mestrado acadêmico: (3) Doutorado: (11) . , Integrantes: Luciano Volcan Agostini - Coordenador / Roger Endrigo Carvalho Porto - Integrante / Bruno Zatt - Integrante / Guilherme Ribeiro Corrêa - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Marcel Moscarelli Corrêa - Integrante / Pedro Amado Assunção - Integrante / Ruhan Conceição - Integrante / Susin, Altamiro - Integrante / PORTO, MARCELO - Integrante / Vladimir Afonso - Integrante / SANCHEZ, GUSTAVO - Integrante / José Luís Almada Güntzel - Integrante / SALDANHA, MARIO - Integrante / ISMAEL SEIDEL - Integrante / Jones Goebel - Integrante / BRAATZ, LUCIANO - Integrante / Murilo Perleberg - Integrante / Mateus Mendes Gonçalves - Integrante / Isis Duarte Bender - Integrante / Roberta de Carvalho Nobre Palau - Integrante / Robson André Domanski - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa.Número de orientações: 17

  • 2006 - 2008

    Projeto de Arquiteturas para Compressão de Imagens e Vídeo Utilizando Metodologias de Reuso de Hardware, Descrição: Este projeto de pesquisa está relacionado a área de projeto de Sistemas-em-Chip (SoCs) voltados para a compressão de imagens estáticas e vídeos. Serão investigados os padrões JPEG para compressão de imagens estáticas e H.264/AVC para a compressão de vídeos. Serão selecionados, para desenvolvimento em hardware, blocos destes dois padrões e, sobre alguns dos blocos desenvolvidos será inserida uma interface de reuso seguindo o padrão OCP ou VCI. Deste modo, serão geradas arquiteturas reusáveis para a compressão de imagens estáticas e de vídeos. Este projeto é uma ressubmissão atualizada de projeto do mesmo proponente que foi submetido para a FAPERGS em 2002, com previsão de execução para 2003 e 2004. Naquele projeto, que foi aprovado no mérito, mas não foi executado por falta de recursos, estava sendo proposta a investigação do reuso de hardware em arquiteturas direcionadas para a compressão JPEG. Mesmo sem que aquele projeto tenha sido executado, parte das atividades de pesquisa previstas no projeto original foram desenvolvidas, principalmente graças a aprovação pela FAPERGS, em 2003, de uma cota de bolsa IC para o proponente deste projeto. Este bolsista IC, mesmo com poucos recursos disponíveis, trabalhou nas atividades do projeto original. Por isso, esta nova submissão atualizou o projeto original, para aproveitar o que já foi desenvolvido e inserindo novos tópicos, como a compressão de vídeo segundo o padrão H.264/AVC. Este padrão é o mais novo padrão de compressão de vídeos e possui elevado interesse acadêmico e industrial, principalmente para implementações direcionadas para hardware. O projeto será desenvolvido na Universidade Federal de Pelotas, junto ao Grupo de Arquiteturas e Circuitos Integrados, mas contará com o apoio de pesquisadores da Universidade Federal do Rio Grande do Sul (UFRGS) e da Universidade Federal do Rio Grande Norte (UFRN).. , Situação: Concluído; Natureza: Pesquisa. , Alunos envolvidos: Graduação: (5) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Ivan Saraiva Silva - Integrante / José Luis Güntzel - Integrante / Leandro Zanetti Paiva da Rosa - Integrante., Financiador(es): Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Universidade Federal do Rio Grande do Norte - Cooperação., Número de produções C, T & A: 55 / Número de orientações: 8

  • 2004 - 2007

    APISE - Desenvolvimento e Prototipação de Arquiteturas para Processamento e Imagens em Sistemas Embarcados, Descrição: O presente projeto tem como objeto de interesse o estudo, a especificação, o desenvolvimento e a prototipação de arquiteturas de hardware para o processamento digital de imagens e vídeo. Mais especificamente, pretende-se desenvolver arquiteturas para a compressão de imagens e vídeo e para o reconhecimento de padrões em imagens. Também pretende-se desenvolver ferramentas computacionais de apoio ao projeto físico destas arquiteturas. Para a compressão de imagens, o padrão JPEG 2000 será investigado e serão desenvolvidas arquiteturas para este padrão. Serão desenvolvidas arquiteturas para a transformada discreta de wavelet (DWT), para a quantização e para a codificação de entropia. Além disso, o padrão de compressão JPEG original [THE 92] também será tratado, com otimizações arquiteturais em trabalhos anteriores. Para a compressão de vídeo, serão investigados os padrões MPEG 4, e H.264. Serão desenvolvidas arquiteturas para o estimador de movimento, para o preditor intra-espacial, para a transformada discreta do cosseno (DCT) e para o Codificador de Palavra Variável Adaptativa ao Contexto (CAVLC) e o Codificador Aritmético Binário Adaptativo ao Contexto (CABAC). Serão desenvolvidas arquiteturas para o reconhecimento de padrões em imagens, baseadas em redes neurais artificiais, incluindo o desenvolvimento de operadores aritméticos (multiplicadores e somadores) integrados e de elevado desempenho. As arquiteturas para compressão de imagens e vídeo e para o reconhecimento de padrões serão implementadas, em um primeiro momento, em dispositivos reconfiguráveis do tipo FPGAs, por conta de sua grande flexibilidade de operação e facilidade para prototipação.Para a compressão de imagens, o padrão JPEG 2000 será investigado e serão desenvolvidas arquiteturas para este padrão. Serão desenvolvidas arquiteturas para a transformada discreta de wavelet (DWT), para a quantização e para a codificação de entropia. Além disso, o padrão de compressão JPEG original [THE 92] também será trat. , Situação: Em andamento; Natureza: Pesquisa. , Alunos envolvidos: Graduação: (8) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) . , Integrantes: Luciano Volcan Agostini - Integrante / José Luis Güntzel - Coordenador / Andre Marcelo Coelho da Silva - Integrante / Dênis Franco - Integrante / Marcelo Schiavon Porto - Integrante / Thaísa Leal da Silva - Integrante / João Alberto Vortman - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Universidade Federal do Rio Grande - Cooperação.Número de orientações: 6

  • 2004 - 2006

    Projeto de Arquiteturas para Compressão de Imagens JPEG Utilizando Metodologias de Reuso de Blocos de Hardware, Descrição: Este projeto pretende investigar o estado da arte das metodologias de reuso de hardware, visando a sua aplicação em projetos anteriormente desenvolvidos para a compressão de imagens JPEG. Vários serão os blocos de hardware que serão desenvolvidos, de acordo com os padrões de reusabilidade industriais, como o padrão VCI e o padrão OCP. Ao final do trabalho, os módulos desenvolvidos serão disponibilizados no portal Brazil IP, que visa a divulgação dos cores IPs desenvolvidos no Brasil. Além da contribuição específica já mencionada, este projeto pretende auxiliar na consolidação do Grupo de Arquiteturas e Circuitos Integrados (GACI) da UFPel e contribuir com os recentes esforços do MCT e da SCT-RS que, através do Plano Nacional de Microeletrônica e do projeto CEITEC, pretendem estimular o crescimento da produção acadêmica e industrial na área de microeletrônica, apontando fortemente para necessidade de investimentos em pesquisas na área de reuso de hardware. Para auxiliar no desenvolvimento deste projeto é solicitada uma quota de bolsista de iniciação científica. Este bolsista irá trabalhar no desenvolvimento e validação das arquiteturas propostas, se concentrando no desenvolvimento e validação das arquiteturas de interface padrão para reuso de blocos de hardware e no aperfeiçoamento, no desenvolvimento e na validação das arquiteturas direcionadas à compressão JPEG.. , Situação: Concluído; Natureza: Pesquisa. , Alunos envolvidos: Graduação: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Ivan Saraiva Silva - Integrante / José Luis Güntzel - Integrante / Leandro Zanetti Paiva da Rosa - Integrante., Financiador(es): Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Federal do Rio Grande do Norte - Cooperação / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Bolsa.

  • 2003 - 2007

    SoCMicro - Sistemas em Chip: Metodologia de Projeto de Circuitos e Micro-Sistemas, Descrição: Este projeto foca o desafio de integração de sistemas de computação em chips. Esta área engloba uma multiplicidade de técnicas e conhecimentos de engenharia de computação e de engenharia elétrica, com vistas a utilizar a capacidade tecnológica da microeletrônica para soluções de hardware originais. As contribuições do projeto estão no desenvolvimento de métodos de projeto de circuitos mistos analógico-digitais, ferramentas computacionais para sistemas-em-chip (SoC) e no desenvolvimento de circuitos integrados CMOS para aplicações específicas. Fazem parte deste projeto a UFRGS, a UFPel e a UCPel. A coordenação é do Prof. Sergio Bampi (UFRGS). A UFPel está encarregada do desenvolvimento de ferramentas para a Análise de Timing e de Metodologias para o Processamento de Imagens. OBS: Projeto aprovado no contexto da Chamada Conjunta MCT/SEPIN - FINEP - CNPq 01/2002 (Programa de Apoio à Pesquisa, Desenvolvimento e Inovação em Tecnologia da Informação - PDI-TI) Processo CNPq 552121/2002-9 Vigência: janeiro/2003 a dezembro/2006 Benefícios: R$ 669.000,00. Recursos destinados à UFPel: R$ 150.000,00 (capital e custeio), uma bolsa DTI-7G e três bolsas de ITI.. , Situação: Em andamento; Natureza: Pesquisa. , Alunos envolvidos: Graduação: (5) . , Integrantes: Luciano Volcan Agostini - Integrante / Sergio Bampi - Coordenador / Roger Endrigo Carvalho Porto - Integrante / José Luis Güntzel - Integrante / Marcelo Schiavon Porto - Integrante / Thaísa Leal da Silva - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Católica de Pelotas - Cooperação / Não informado.Número de orientações: 7

  • 2003 - 2005

    SoC-Reuse: Desenvolvimento de Sistemas em Silício Baseados no Reuso de Blocos de Hardware, Descrição: Este projeto investigou o estado da arte das metodologias de reuso de hardware, focando na análise de timing de sistemas em chip (SoCs) baseados no reuso de blocos de hardware de diferentes fabricantes. Como estudo de caso para esta investigação, foram desenvolvidas arquiteturas e operadores direcionados para o processamento de imagens, tanto em nível RTL quanto em nível de leiaute. Os blocos de hardware desenvolvidos seguiram os padrões industriais de reusabilidade (OCP e/ou VCI). OBS: Projeto aprovado no contexto do Edital Universal 2003. Processo CNPq 478579/2003-9. Vigência: outubro/2003 a outubro/2005. Benefícios: R$ 20.000,00 (metade em capital e metde em custeio).. , Situação: Concluído; Natureza: Pesquisa. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Integrante / Roger Endrigo Carvalho Porto - Integrante / Rodrigo Araújo Tavares - Integrante / José Luis Güntzel - Coordenador / Marcelo Schiavon Porto - Integrante / Thaísa Leal da Silva - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro.Número de orientações: 4

Seção coletada automaticamente pelo Escavador

Projetos de desenvolvimento

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Rede Nacional de Ensino e Pesquisa - Bolsa / Universidade Federal da Paraíba - Cooperação., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Rede Nacional de Ensino e Pesquisa - Bolsa / Universidade Federal da Paraíba - Cooperação., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Rede Nacional de Ensino e Pesquisa - Bolsa / Universidade Federal da Paraíba - Cooperação., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Rede Nacional de Ensino e Pesquisa - Bolsa / Universidade Federal da Paraíba - Cooperação., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Universidade de Brasília - Cooperação., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro., Número de produções C, T & A: 11

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Universidade Federal da Paraíba - Cooperação / Rede Nacional de Ensino e Pesquisa - Bolsa., Número de produções C, T & A: 6

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Universidade Federal da Paraíba - Cooperação / Rede Nacional de Ensino e Pesquisa - Bolsa., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Rede Nacional de Ensino e Pesquisa - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Coimbra - Cooperação., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Rede Nacional de Ensino e Pesquisa - Bolsa / Universidade Federal da Paraíba - Cooperação., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Universidade Federal da Paraíba - Cooperação / Rede Nacional de Ensino e Pesquisa - Bolsa., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Rede Nacional de Ensino e Pesquisa - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Universidade Federal da Paraíba - Cooperação / Rede Nacional de Ensino e Pesquisa - Bolsa., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Rede Nacional de Ensino e Pesquisa - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Rede Nacional de Ensino e Pesquisa - Bolsa / Universidade Federal da Paraíba - Cooperação., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Universidade Federal da Paraíba - Cooperação / Rede Nacional de Ensino e Pesquisa - Bolsa., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Coimbra - Cooperação., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Universidade Federal da Paraíba - Cooperação / Rede Nacional de Ensino e Pesquisa - Bolsa., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Universidade Federal da Paraíba - Cooperação / Rede Nacional de Ensino e Pesquisa - Bolsa., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Coimbra - Cooperação., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador.Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Universidade de Brasília - Cooperação., Número de produções C, T & A: 11

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante.Financiador(es): Universidade Federal da Paraíba - Cooperação / Rede Nacional de Ensino e Pesquisa - Bolsa., Número de produções C, T & A: 6

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Rede Nacional de Ensino e Pesquisa - Bolsa / Universidade Federal da Paraíba - Cooperação., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Rede Nacional de Ensino e Pesquisa - Bolsa / Universidade Federal da Paraíba - Cooperação., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação., Número de produções C, T & A: 31 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Rede Nacional de Ensino e Pesquisa - Bolsa / Universidade Federal da Paraíba - Cooperação., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro., Número de produções C, T & A: 30 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Universidade Federal da Paraíba - Cooperação / Rede Nacional de Ensino e Pesquisa - Bolsa., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro., Número de produções C, T & A: 30 / Número de orientações: 7

  • 2009 - 2011

    GingaCDN - Ginga Code Development Network, Descrição: No cenário atual existem vários padrões e tecnologias para plataformas de terminais de acesso a sistemas de Televisão Digital (TVD). Contudo, o desenvolvimento da principal camada de software do terminal de acesso, o middleware, ainda é objeto de várias pesquisas. Isso acontece principalmente devido a complexidade do seu desenvolvimento e a tendência cada vez maior de harmonização entre os diferentes padrões de middleware existentes. Além dos motivos supracitados, existe ainda a necessidade de adequar esse software aos requisitos gerados pela convergência tecnológica da TVD com outras redes (Internet e telefonia móvel). No Brasil ainda há ainda muito a ser feito por conta do pouco tempo decorrido do início da implantação do sistema de TVD. O principal objetivo deste projeto é a criação de uma rede de desenvolvedores de código para o middleware Ginga, denominada Ginga Code Development Network (GingaCDN). Esta iniciativa visa difundir as tecnologias relacionadas ao desenvolvimento de código de componentes do middleware Ginga e de ferramentas para seu uso, A GingaCDN será formada através da construção e implantação de um serviço para desenvolvimento distribuído e colaborativo de software, do estabelecimento de parcerias para desenvolvimento de componentes e da oferta de um ambiente de transmissão e recepção de televisão digital de baixo custo para testar os componentes desenvolvidos. Para facilitar o uso dos códigos desenvolvidos pelos membros da GingaCDN por empresas neles interessadas, será definida uma política de gestão de direitos de propriedade intelectual. A idéia é que seja definida uma ou mais licença de uso para cada um dos componentes desenvolvidos pela GingaCDN e que as ferramentas de apoio apóiem a definição de licenças para as releases geradas através da seleção e combinação de componentes.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) . , Integrantes: Luciano Volcan Agostini - Coordenador / Lisane Brisolara de Brisolara - Integrante / Júlio Carlos Balzano de Matos - Integrante / Leomar Soares da Rosa Jr - Integrante / Guido Araújo - Integrante / Juliano L. Gonçalves - Integrante., Financiador(es): Universidade Federal da Paraíba - Cooperação / Rede Nacional de Ensino e Pesquisa - Bolsa., Número de produções C, T & A: 6

  • 2009 - 2011

    SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD, Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Integrante / Ivan Saraiva Silva - Integrante / Altamiro Susin - Integrante / Ricardo Jacobi - Coordenador., Financiador(es): Rede Nacional de Ensino e Pesquisa - Auxílio financeiro / Universidade de Brasília - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Universidade Federal do Rio Grande do Sul - Cooperação., Número de produções C, T & A: 11

  • 2008 - 2011

    Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital, Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (5) / Mestrado acadêmico: (2) / Doutorado: (1) . , Integrantes: Luciano Volcan Agostini - Coordenador / Sergio Bampi - Integrante / Thaisa Leal da Silva - Integrante / Marcelo Schiavon Porto - Integrante / Altamiro Susin - Integrante / Guilherme Ribeiro Corrêa - Integrante / Felipe Sampaio - Integrante / Daniel Palomino - Integrante / Luís Alberto da Silva Cruz - Integrante / Gustavo Sanchez - Integrante / Marcel Moscarelli Corrêa - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Universidade de Coimbra - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro., Número de produções C, T & A: 30 / Número de orientações: 7

Seção coletada automaticamente pelo Escavador

Prêmios

2020

Best Paper Award no SIM 2020 pelo Artigo 'An AV1 Constrained Directional Enhancement Filter Architecture for 4K@60fps Videos', SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2019

Bolsista de Produtividade em Pesquisa - PQ 1D, Comitê Assessor de Microeletrônica - CNPq.

2019

Best Paper Award no SIM 2019 pelo Artigo 'HEVC Video Coding Using Decision Trees for a Memory-Friendly Tiles Workload Balance', SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2019

Co-orientador do trabalho vencedor do Prêmio de Melhor Dissertação de Mestrado na área de Projeto, CAD e Teste de Circuitos Integrados (Luciano Braatz)., SBMicro (Sociedade Brasileira de Microeletrônica).

2018

Orientador do aluno vencedor do 15 Prêmio Destaque na Iniciação Científica e Tecnológica Categoria Ciências Exatas, da Terra e Engenharias (Iago Coelho Storch)., Conselho Nacional de Desenvolvimento Científico e Tecnológico (CNPq).

2018

Best Paper Award no 18th Student Forum (SFORUM 2018) pelo artigo "Energy-Aware HEVC Transrating based on Frame Partitioning Inheritance", SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2018

Honorable Mention Award no 31st Symposium on Integrated Circuits and Systems Design (SBCCI 2018) pelo artigo "3D-HEVC DMM-1 Parallelism Exploration Targeting Multicore Systems", IEEE, ACM, SBC e SBMicro.

2017

Best Paper Award no SIM 2017, pelo artigo "High Speed Tiling Algorithm for Parallel HEVC Encoding", SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2017

Bolsa de Estágio Sênior no Exterior (Instituto Superior Técnico da Universidade de Lisboa - Portugal), CAPES.

2017

ACM Senior Member, Association for Computing Machinery - ACM.

2017

Best Paper Award no VII Brazilian Symposium on Computing Systems Engineering (SBESC) pelo artigo Cache Memory Energy Efficiency Exploration for the HEVC Motion Estimation, SBC, IFIP.

2016

Menção Honrosa no XXXIV SBrT, pelo artigo Avaliação do potencial máximo de speedup usando Tiles para compressão de vídeo paralela segundo o padrão HEVC, Sociedade Brasileira de Telecomunicações.

2016

Bolsista de Produtividade em Pesquisa - PQ2, Comitê Assessor de Microeletrônica - CNPq.

2015

Best Paper Award no SIM 2015, pelo artigo A Hardware Architecture for an HEVC Motion Compensation Luminance Interpolator, SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2015

Best Paper Award no 28th Symposium on Integrated Circuits and Systems Design (SBCCI) pelo artigo Memory-Aware and High-Throughput Hardware Design for the HEVC Fractional Motion Estimation, IEEE, ACM, SBC e SBMicro.

2015

Orientador do trabalho premiado com o terceiro lugar na área de Ciências Exatas no XXIV Congresso de Iniciação Científica (aluno Guilherme Povala), Universidade Federal de Pelotas - UFPel.

2014

Co-orientador do artigo premiado na área Engenharias no ENPOS 2014. Mestrando Dieison Soares Silveira., Encontro de Pós-Graduação (ENPOS) da UFPel.

2014

Best Paper Award no 21st IEEE International Conference on Electronics Circuits and Systems (ICECS), pelo artigo "Classification-Based Early Termination for Coding Tree Structure Decision in HEVC", IEEE, IEEE CAS.

2013

Patrono, Formandos em Ciência da Computação da UFPel - 2012/2.

2013

Best Paper Award - Cicuits and Systems Design no SIM 2013, pelo artigo Energy-Efficient Memory Hierarchy for Motion and Disparity Estimation in Multiview Video Coding, SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2013

Co-orientador da dissertação premiada no Concurso de Teses e Dissertações da SBMicro como Melhor Dissertação de Mestrado - Categoria Projeto, CAD e Teste de Circuitos Integrados (aluno Felipe Sampaio), SBMicro - Sociedade Brasileira de Microeletrônica.

2013

Orientador do trabalho premiado com o primeiro lugar na área de Ciências Exatas no XXII Congresso de Iniciação Científica (aluno José Cláudio de Souza Júnior), Universidade Federal de Pelotas - UFPel.

2013

Co-orientador do trabalho premiado com o segundo lugar na área de Ciências Exatas no XXII Congresso de Iniciação Científica (aluno Henrique do Amarilho Maich), Universidade Federal de Pelotas - UFPel.

2013

Bolsista de Produtividade em Pesquisa - PQ2, Comitê Assessor de Microeletrônica - CNPq.

2012

Altera Best Paper Award no SPL 2012, pelo artigo Memory Bandwidth Reduction in Video Coding Systems Through Context Adaptive Lossless Reference Frame Compression, SPL 2012 Organizing Committee.

2012

Co-orientador do artigo premiado com o segundo lugar no Concurso de Trabalhos de Iniciação Científica da SBC (aluno Jucemar Monteiro), Sociedade Brasileira de Computação - SBC.

2012

Best Paper Award - Circuits and Systems Design no SForum 2012 pelo artigo New Quarter Random Search Motion Estimation Algorithm: a Great Quality-Cost Trade-Off, Sociedade Brasileira de Microeletrônica - SBMicro.

2012

Orientador do artigo premiado na modalidade oral da área Engenharias no ENPOS 2012. Mestrando Ricardo Garcia Jeske., Encontro de Pós-Graduação (ENPOS) da UFPel.

2012

Co-orientador do artigo premiado na modalidade pôster da área de Ciências Exatas no ENPOS 2012. Mestrando Vladimir Afonso., Encontro de Pós-Graduação (ENPOS) da UFPel.

2012

Co-orientador do trabalho premiado com o primeiro lugar na área de ciências exatas e da terra na modalidade oral no XXI Congresso de Iniciação Científica (aluno Vinícius Neves Possani), Universidade Federal de Pelotas.

2011

Altera Best Paper Award no SPL 2011, pelo artigo A H.264/AVC Quarter-Pixel Motion Estimation Refinement Architecture Targeting High Resolution Video, IEEE CAS.

2011

Best Paper Award - Undergraduate Work no SIM 2011, pelo artigo Multilevel Data Reuse Scheme for Off-Chip Memory Accesses Reduction Applied to a Motion Estimation Architecture, SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2011

Best Paper Award no SForum 2011, pelo artigo "A Fast Random Based Motion Estimation Search Algorithm", SBMicro - Sociedade Brasileira de Microeletrônica.

2011

Co-orientador do trabalho premiado com o primeiro lugar na área de ciências exatas na modalidade poster no XX Congresso de Iniciação Científica (aluno Vinícius Neves Possani), Universidade Federal de Pelotas.

2011

Orientador do trabalho premiado com o terceiro lugar na área de ciências exatas na modalidade oral no XX Congresso de Iniciação Científica (aluno Marcel Moscarelli Corrêa), Universidade Federal de Pelotas.

2011

HiPEAC Paper Award pelo artigo "Run-Time Adaptive Energy-Aware Motion and Disparity Estimation in Multiview Video Coding", publicado no ACM/IEEE/EDA 48th Design Automation Conference - DAC11, European Network of Excellence on High Performance and Embedded Architecture and Compilation HiPEAC.

2011

IEEE Senior Member, Institute of Electrical and Electronics Engineers - IEEE.

2010

Best Paper Award - Undergraduate Work no SIM 2010, pelo artigo A Dedicated Hardware Solution for the H.264/AVC Half-Pixel Interpolation Unit, SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2010

Best Paper Award - Undergraduate Work no SIM 2010, pelo artigo A Low Cost Real Time Motion Estimation/Compensation Architecture for the H.264/AVC, SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2010

Best Undergraduate Paper Award no SForum 2010, pelo artigo Transistor Networks Design Using a Graph-Based Approach, SBMicro - Sociedade Brasileira de Microeletrônica.

2010

Co-orientador do trabalho premiado com o terceiro lugar na área de ciências exatas na modalidade oral no XIX Congresso de Iniciação Científica (aluno Vinícius Neves Possani), Universidade Federal de Pelotas.

2010

Co-orientador do trabalho premiado com o segundo lugar na área de ciências exatas na modalidade poster no XIX Congresso de Iniciação Científica (aluno Marco Beckmann), Universidade Federal de Pelotas.

2010

Best Paper Award no AFMS 2010 , pelo artigo Evaluating Two Implementations of the Component Responsible for Decoding Video and Audio in the Brazilian Digital TV Middleware, FTRA - Future Technology Research Association International - Korea.

2009

Professor Homenageado, Formados em Ciência da Computação da UFPel - 2008/2.

2009

PhD Work - Best Paper Award no SIM 2009, pelo artigo SystemC Modeling for H.264/AVC Intra Frame Video Encoder, SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2009

Master Work - Best Paper Award no SIM 2009, pelo artigo A Real Time H.264/AVC Main Profile Intra Frame Prediction Hardware Architecture for High Definition Video Coding, SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2009

Master Work - Mention of Honor no SIM 2009, pelo artigo H.264/AVC Variable Block Size Motion Estimation for Real-Time 1080HD Video Encoding, SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2009

Undergraduated Work - Mention of Honor no SIM 2009, pelo artigo Dedicated Architecture for the T/Q/IQ/IT Loop Focusing the H.264/AVC Intra Prediction, SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2008

Professor Homenageado, Formados em Ciência da Computação da UFPel - 2008/1.

2008

Best Poster Award no SForum 2008, pelo artigo Transient Fault-Tolerant Fast Adders Implemented in FPGAS, SBMicro (Sociedade Brasileira de Microeletrônica).

2007

Professor Homenageado, Formados em Ciência da Computação da UFPel - 2007/2.

2007

Best Paper in Multimedia Hardware and Image Sensor Technologies no PSIVT 2007 (Chile) pelo artigo A Pipelined 8x8 2-D Forward DCT Hardware Architecture for H.264/AVC High Profile Encoder, IEEE (Institute of Electrical and Electronics Engineers).

2007

Orientador do trabalho premiado com o primeiro lugar na área de ciências exatas no XVI Congresso de Iniciação Científica (aluna Fabiane Konrad Rediess), Universidade Federal de Pelotas.

2006

Orientador do trabalho premiado com o primeiro lugar na área de engenharias no XV Congresso de Iniciação Científica (aluna Fabiane Konrad Rediess), Universidade Federal de Pelotas.

2006

Co-orientador do trabalho premiado com o terceiro lugar na área de engenharias no XV Congresso de Iniciação Científica (aluno Guilherme Corrêa Ribeiro), Universidade Federal de Pelotas.

2006

Professor Homenageado, Formados em Ciência da Computação da UFPel - 2006/2.

2006

Homenagem de Reconhecimento por Realização de Trabalhos Voluntários, Câmara Municipal de Pelotas.

2006

Altera Best Paper Award no SPL 2006, pelo artigo Forward and Inverse 2-D DCT Architectures for H.264/AVC Video Compression Directed to HDTV, SPL 2006 - Southern Programmable Logic Conference.

2006

Melhor Apresentação de Trabalho no SIM 2006 (aluno João Alberto Vortmman) com o artigo Dedicated Hardware Architectures for H.264/AVC Exp-Golomb Coding and Decoding, SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).

2005

Orientador do trabalho premiado com o segundo lugar na área de engenharias no XIV Congresso de Iniciação Científica (aluno André Marcelo Coelho da Silva), Universidade Federal de Pelotas.

2004

Paraninfo, Formandos em Ciência da Computação da UFPel - 2004/2.

2004

Orientador do trabalho premiado com o primeiro lugar na área de engenharias no XIII Congresso de Iniciação Científica (aluno Marcelo Schiavon Porto), Universidade Federal de Pelotas.

2003

Orientador do trabalho premiado com o primeiro lugar na área de engenharias no XII Congresso de Iniciação Científica (aluna Thaísa Leal da Silva), Universidade Federal de Pelotas.

2003

Professor Homenageado, Formandos em Ciência da Computação da UFPel - 2003/2.

2002

Orientador do trabalho premiado com o segundo lugar na área de ciências exatas no XI Congresso de Iniciação Científica (aluno Roger Endrigo Carvalho Porto), Universidade Federal de Pelotas.

Histórico profissional

Seção coletada automaticamente pelo Escavador

Endereço profissional

  • Universidade Federal de Pelotas, Centro de Desenvolvimento Tecnológico. , CDTec - Computação - Rua Gomes Carneiro nro 1, Centro, 96010610 - Pelotas, RS - Brasil - Caixa-postal: 354, Telefone: (53) 39211327, URL da Homepage:

Seção coletada automaticamente pelo Escavador

Experiência profissional

  • 2002 - Atual

    Universidade Federal de Pelotas

    Vínculo: Servidor Público, Enquadramento Funcional: Professor Associado, Carga horária: 40, Regime: Dedicação exclusiva.

    Outras informações:
    Professor Associado junto ao Centro de Desenvolvimento Tecnológico - CDTEC. Líder do Grupo de Arquiteturas e Circuitos Integrados - GACI. Líder do Video Technology Research Group - ViTech.

    Atividades

    • 07/2017

      Conselhos, Comissões e Consultoria, Centro de Desenvolvimento Tecnológico, .,Cargo ou função, Membro do Colegiado do Programa de Pós-Graduação em Computação.

    • 07/2017

      Conselhos, Comissões e Consultoria, Centro de Desenvolvimento Tecnológico, .,Cargo ou função, Suplente do Colegiado do Curso de Engenharia de Computação.

    • 03/2014

      Direção e administração, Centro de Desenvolvimento Tecnológico, .,Cargo ou função, Líder do Video Technology Research Group.

    • 11/2010

      Ensino, COMPUTAÇÃO, Nível: Pós-Graduação,Disciplinas ministradas, Arquitetura e Projeto de Computadores, Projeto Avançado de Sistemas Digitais, TEC - Fundamentos de Codificação de Vídeos

    • 03/2010

      Ensino, Engenharia de Computação, Nível: Graduação,Disciplinas ministradas, Arquitetura e Organização de Computadores I, Computação e Sociedade, Tópicos Especiais em Computação, Projetos em Computação

    • 08/2007

      Pesquisa e desenvolvimento , Centro de Desenvolvimento Tecnológico, .,Linhas de pesquisa

    • 10/2006

      Direção e administração, Centro de Desenvolvimento Tecnológico, .,Cargo ou função, Líder do grupo de pesquisa GACI - Grupo de Arquiteturas e Circuitos Integrados.

    • 08/2002

      Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação,Disciplinas ministradas, Arquitetura e Organização de Computadores I, Computação e Sociedade, Tópicos Especiais em Computação, Projetos em Computação

    • 11/2014 - 02/2018

      Conselhos, Comissões e Consultoria, Reitoria, .,Cargo ou função, Representante da UFPel na Associação Civil TECNOSUL - Parque Científico e Tecnológico de Pelotas.

    • 07/2013 - 02/2018

      Conselhos, Comissões e Consultoria, Reitoria, Pró-Reitoria de Pesquisa e Pós-Graduação.,Cargo ou função, Representante da UFPel no Conselho Municipal de Ciência e Tecnologia de Pelotas-RS.

    • 10/2015 - 01/2017

      Conselhos, Comissões e Consultoria, Reitoria, Pró-Reitoria de Pesquisa e Pós-Graduação.,Cargo ou função, Presidente do Comitê Institucional de Infraestrutura de Pesquisa da UFPel.

    • 12/2013 - 01/2017

      Direção e administração, Reitoria, Pró-Reitoria de Pesquisa e Pós-Graduação.,Cargo ou função, Pró-Reitor de Pesquisa e Pós-Graduação.

    • 12/2013 - 01/2017

      Conselhos, Comissões e Consultoria, Conselho Coordenador do Ensino, da Pesquisa e da Extensão, .,Cargo ou função, Coordenador da Comissão de Pesquisa e Pós-Graduação - CPPG.

    • 12/2013 - 01/2017

      Conselhos, Comissões e Consultoria, Conselho Universitário, .,Cargo ou função, Membro do Conselho Universitário.

    • 05/2013 - 02/2014

      Conselhos, Comissões e Consultoria, Reitoria, Pró-Reitoria de Pesquisa e Pós-Graduação.,Cargo ou função, Presidente do Comitê Institucional de Bolsas de Iniciação Científica - UFPel 2013/2014.

    • 10/2013 - 12/2013

      Conselhos, Comissões e Consultoria, Reitoria, Pró-Reitoria de Pesquisa e Pós-Graduação.,Cargo ou função, Coordenador do Comitê Executivo do XXII Congresso de Iniciação Científica (CIC).

    • 01/2013 - 12/2013

      Direção e administração, Reitoria, Pró-Reitoria de Pesquisa e Pós-Graduação.,Cargo ou função, Diretor do Departamento de Pesquisa.

    • 10/2009 - 04/2013

      Outras atividades técnico-científicas , Centro de Desenvolvimento Tecnológico, Centro de Desenvolvimento Tecnológico.,Atividade realizada, Tutor do Grupo PET-Comptuação da UFPel..

    • 05/2011 - 02/2013

      Direção e administração, Centro de Desenvolvimento Tecnológico, .,Cargo ou função, Coordenador Adjunto do Programa de Pós-Graduação em Computação.

    • 05/2008 - 05/2011

      Conselhos, Comissões e Consultoria, Centro de Desenvolvimento Tecnológico, Curso de Ciência da Computação.,Cargo ou função, Membro do Colegiado do Curso de Ciência da Computação.

    • 04/2010 - 06/2010

      Extensão universitária , Instituto de Física e Matemática, Departamento de Informática.,Atividade de extensão realizada, Curso de inclusão digital para alunos da rede pública de ensino..

    • 12/2007 - 06/2010

      Extensão universitária , Instituto de Física e Matemática, Departamento de Informática.,Atividade de extensão realizada, Projeto de Criação do Centro de Desenvolvimento de Software.

    • 11/2008 - 11/2008

      Extensão universitária , Instituto de Física e Matemática, .,Atividade de extensão realizada, XIII Semana Acadêmica do Curso de Ciência da Computação.

    • 11/2007 - 11/2007

      Extensão universitária , Instituto de Física e Matemática, Departamento de Informática.,Atividade de extensão realizada, XII Semana Acadêmica do Curso de Bacharelado de Ciência da Computação.

    • 08/2007 - 08/2007

      Extensão universitária , Instituto de Física e Matemática, .,Atividade de extensão realizada, Workshop de Estudo do Curriculo do Curso de Bacharelado em Ciência da Computação.

    • 07/2004 - 07/2007

      Pesquisa e desenvolvimento , Instituto de Física e Matemática, Departamento de Informática.,Linhas de pesquisa

    • 11/2006 - 12/2006

      Extensão universitária , Instituto de Física e Matemática, .,Atividade de extensão realizada, Comissão Organizadora da XI Semana Acadêmica do curso de Ciência da Computação da UFPel.

    • 06/2003 - 09/2004

      Conselhos, Comissões e Consultoria, Instituto de Física e Matemática, .,Cargo ou função, Membro da Comissão de Estágios da UFPel.

    • 03/2003 - 09/2004

      Conselhos, Comissões e Consultoria, Instituto de Física e Matemática, .,Cargo ou função, Membro da Comissão de Educação à Distância da UFPel.

    • 09/2002 - 09/2004

      Conselhos, Comissões e Consultoria, Instituto de Física e Matemática, Departamento de Matemática Estatística e Informática.,Cargo ou função, Membro de colegiado superior.

    • 06/2004 - 08/2004

      Extensão universitária , Instituto de Física e Matemática, Departamento de Informática.,Atividade de extensão realizada, Coordenador do projeto com palestras ministradas para alunos de escolas públicas de ensino médio com o título: "A Informática Hoje e o Curso de Ciência da Computação da UFPel". Total de 14h e 200 estudantes atingidos..

    • 06/2004 - 07/2004

      Extensão universitária , Instituto de Física e Matemática, Departamento de Informática.,Atividade de extensão realizada, Coordenador do projeto de curso de inclusão digital para alunos carentes do ensino público com o título: "Introdução à Computação e à Internet". Total de 60h e 76 participantes..

  • 2014 - 2018

    Conselho Municipal de Ciência e Tecnologia de Pelotas-RS

    Vínculo: Colaborador, Enquadramento Funcional: Presidente do Conselho, Carga horária: 2

  • 2017 - 2019

    Sociedade Brasileira de Computação - Porto Alegre

    Vínculo: Colaborador, Enquadramento Funcional: Representante Institucional na UFPel, Carga horária: 1

  • 2011 - 2017

    Sociedade Brasileira de Computação - Porto Alegre

    Vínculo: Colaborador, Enquadramento Funcional: Conselheiro eleito da CECCI, Carga horária: 1

  • 2017 - Atual

    Sociedade Brasileira de Microeletrônica, SBMicro

    Vínculo: Colaborador, Enquadramento Funcional: Membro do Conselho da SBMicro, Carga horária: 1

    Outras informações:
    Membro eleito para o Conselho.

  • 2010 - Atual

    Sociedade Brasileira de Microeletrônica, SBMicro

    Vínculo: Colaborador, Enquadramento Funcional: Membro do Steering Committee do SBCCI, Carga horária: 1

  • 2009 - 2013

    Sociedade Brasileira de Microeletrônica, SBMicro

    Vínculo: Colaborador, Enquadramento Funcional: Membro do Conselho da SBMicro, Carga horária: 2

    Outras informações:
    Conselheiro mais votado para o período entre 2009 e 2013.

  • 2017 - 2019

    Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul

    Vínculo: Colaborador, Enquadramento Funcional: Coordenador Substituto CA Computação, Carga horária: 1

    Outras informações:
    Vice-Coordenador do CA-CC

  • 2013 - 2017

    Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul

    Vínculo: Colaborador, Enquadramento Funcional: Integrante do CA MEC, Carga horária: 1

  • 2001 - 2001

    Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul

    Vínculo: Celetista, Enquadramento Funcional: Assessor da Diretoria de Nível Superior, Carga horária: 40

  • 1995 - 2001

    Instituto Federal Sul-Rio-Grandense

    Vínculo: , Enquadramento Funcional: Assistente em Administração, Carga horária: 40

  • 1994 - 1994

    Instituto Federal Sul-Rio-Grandense

    Vínculo: Servidor Público, Enquadramento Funcional: Professor Substituto, Carga horária: 40

    Atividades

    • 01/1995 - 02/2001

      Direção e administração, Departamento de Apoio Ao Ensino, Editoração Eletrônica.,Cargo ou função, Assiistente em Administração.

    • 03/1994 - 06/1994

      Ensino,,Disciplinas ministradas, Eletricidade, Eletrônica Industrial, Microprocessadores

  • 2014 - 2017

    Associação Nacional dos Dirigentes das Instituições Federais de Ensino

    Vínculo: Colaborador, Enquadramento Funcional: Coordenador da Regional Sul do COPROPI, Carga horária: 2

    Outras informações:
    Coordenador eleito da Regional Sul do Colégio de Pró-reitores de Pesquisa, Pós-graduação e Inovação das Ifes (Copropi), da Andifes.

  • 2016 - Atual

    IEEE Circuits and Systems Society

    Vínculo: Multimedia Eleito, Enquadramento Funcional: Multimedia Systems & Applications TC (MSATC), Carga horária: 1

    Outras informações:
    Membro eleito para o período 2016-2020.

  • 2016 - Atual

    Empresa Brasileira de Pesquisa Agropecuária

    Vínculo: Assessor, Enquadramento Funcional: Membro do Comitê Assessor Externo (CAE), Carga horária: 1

  • 2007 - 2007

    Instituto Politécnico de Leiria, IPLeiria

    Vínculo: Colaborador, Enquadramento Funcional: Cooperação Internacional, Carga horária: 40, Regime: Dedicação exclusiva.

    Outras informações:
    Realização de missão de trabalho em projeto com cooperação internacional.

  • 2017 - 2018

    Universidade de Lisboa

    Vínculo: Colaborador, Enquadramento Funcional: Pós-doutorando, Carga horária: 40, Regime: Dedicação exclusiva.