Lucas Brahm
Bacharel em Engenharia de Computação da Pontifícia Universidade Católica do Rio Grande do Sul (aluno destaque - Sociedade Brasileira de Computação). Atualmente trabalha na Digistar Telecomunicações S/A.
Informações coletadas do Lattes em 26/04/2026
Acadêmico
Formação acadêmica
Mestrado em andamento em Ciência da Computação
2016 - Atual
Pontifícia Universidade Católica do Rio Grande do Sul
Orientador:Avelino Francisco Zorzo.
Graduação em Engenharia de Computação
2010 - 2014
Pontifícia Universidade Católica do Rio Grande do Sul
Título: Implementação e Avaliação de Roteador de Baixa Latência para Redes Tridimensionais Intrachip com topologia Malha
Orientador: César Augusto Missio Marcon
Formação complementar
2011 - 2011
Microsoft Students To Business. (Carga horária: 84h). , Pontifícia Universidade Católica do Rio Grande do Sul, PUCRS, Brasil.
Idiomas
Inglês
Compreende Razoavelmente, Fala Razoavelmente, Lê Bem, Escreve Razoavelmente.
Áreas de atuação
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Arquitetura de Sistemas de Computação.
Produções bibliográficas
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MOTA, RAFAEL GONCALVES ; SILVEIRA, JARBAS ; SILVEIRA, JARDEL ; BRAHM, LUCAS ; ZORZO, AVELINO ; MOR, FILIPO ; MARCON, CESAR . Efficient routing table minimization for fault-tolerant irregular Network-on-Chip. In: 2016 IEEE International Conference on Electronics, Circuits and Systems (ICECS), 2016, Monte Carlo. 2016 IEEE International Conference on Electronics, Circuits and Systems (ICECS), 2016. p. 632.
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FERNANDES, RAMON ; BRAHM, LUCAS ; WEBBER, THAIS ; CATALDO, RODRIGO ; POEHLS, LETICIA B. ; MARCON, CESAR . OcNoC: Efficient One-Cycle Router Implementation for 3D Mesh Network-on-Chip. In: 2015 28th International Conference on VLSI Design (VLSID), 2015, Bangalore. 2015 28th International Conference on VLSI Design, 2015. p. 105.
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SILVEIRA, JARBAS ; CORTEZ, PAULO ; CADORE, ALAN ; MOTA, RAFAEL ; MARCON, CÉSAR ; BRAHM, LUCAS ; FERNANDES, RAMON . Smart Reconfiguration Approach for Fault-Tolerant NoC Based MPSoCs. In: the 28th Symposium, 2015, Salvador. Proceedings of the 28th Symposium on Integrated Circuits and Systems Design - SBCCI '15, 2015. p. 1.
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GHIDINI, YAN ; MOREIRA, MATHEUS ; BRAHM, LUCAS ; WEBBER, THAIS ; CALAZANS, NEY ; MARCON, CESAR . Lasio 3D NoC vertical links serialization: Evaluation of latency and buffer occupancy. In: 2013 26th Symposium on Integrated Circuits and Systems Design (SBCCI), 2013, Curitiba. 2013 26th Symposium on Integrated Circuits and Systems Design (SBCCI), 2013. p. 1.
Histórico profissional
Experiência profissional
2015 - Atual
Digistar TelecomunicaçõesVínculo: , Enquadramento Funcional: Engenharia, Carga horária: 44, Regime: Dedicação exclusiva.
2014 - 2014
Pontifícia Universidade Católica do Rio Grande do SulVínculo: Bolsista, Enquadramento Funcional: Bolsista, Carga horária: 20
Outras informações:
Implementação de uma arquitetura de rede intrachip distribuída tolerante a falhas.
2014 - 2014
Pontifícia Universidade Católica do Rio Grande do SulVínculo: Bolsista, Enquadramento Funcional: Bolsista, Carga horária: 20
Outras informações:
Implementação e avaliação de roteador de baixa latência para redes intrachip com topologia malha
2013 - 2013
Pontifícia Universidade Católica do Rio Grande do SulVínculo: Bolsista, Enquadramento Funcional: Bolsista, Carga horária: 20
Outras informações:
Implementação de uma rede intrachip 3D com mecanismos de serialização e deserialização para uso de TSVs (Through-silicon via).
2012 - 2012
Pontifícia Universidade Católica do Rio Grande do SulVínculo: Bolsista, Enquadramento Funcional: Bolsista, Carga horária: 20
Outras informações:
Simulador físico de N-corpos utilizando paralelismo de GPUs através da linguagem CUDA.
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