Leandro Sehnem Heck
Formação em Engenharia da Computação e Mestrado em Sistemas Embarcados e Sistemas Digitais na PUCRS. Suas áreas de interesse abrangem circuitos digitais síncronos e assíncronos e microeletrônica.
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Acadêmico
Formação acadêmica
Doutorado em andamento em Ciência da Computação
2013 - Atual
Pontifícia Universidade Católica do Rio Grande do Sul
Título: Sistemas Embarcados e Sistemas Digitais,
Ney Laert Vilar Calazans. Bolsista do(a): Conselho Nacional de Desenvolvimento Científico e Tecnológico, CNPq, Brasil.
Mestrado em Ciência da Computação
2011 - 2013
Pontifícia Universidade Católica do Rio Grande do Sul
Título: Modelagem e Projeto de um Gerador de Relógio Local Baseado em DCO para MPSoCs GALS,Ano de Obtenção: 2013
Ney Laert Vilar Calazans.Coorientador: César Augusto Missio Marcon. Bolsista do(a): Conselho Nacional de Desenvolvimento Científico e Tecnológico, CNPq, Brasil. Palavras-chave: Geração Local de Relógio Local; LCG; DFS; NoC GALS.Grande área: Engenharias
Graduação em Engenharia de Computação
2002 - 2008
Pontifícia Universidade Católica do Rio Grande do Sul
Título: Automação Residencial: Integração de Dispositivos com Redes sem Fio de Baixa Potência
Orientador: Eduardo Todt
Formação complementar
2009 - 2009
Extensão universitária em Programa Nacional de Formação de Projetistas de CI. (Carga horária: 421h). , NSCAD Microeletrônica, NSCAD, Brasil.
2008 - 2008
Desenvolvedor Flash. (Carga horária: 120h). , Alfamídia, ALFAMÍDIA, Brasil.
2007 - 2007
Curso Básico de Java. (Carga horária: 2h). , Pontificia Universidade Católica do Rio Grande do Sul, PUCRS, Brasil.
2006 - 2006
Especialista Photoshop. (Carga horária: 80h). , Alfamídia, ALFAMÍDIA, Brasil.
2006 - 2006
Formação Desenvolvedor Web PHP 5. (Carga horária: 180h). , Alfamídia, ALFAMÍDIA, Brasil.
2004 - 2004
Quartus II - NIOS. (Carga horária: 6h). , Pontificia Universidade Católica do Rio Grande do Sul, PUCRS, Brasil.
2003 - 2003
Linux Básico - Módulo I. (Carga horária: 30h). , SENAC, SENAC, Brasil.
2003 - 2003
Linux Configuração - Módulo II. (Carga horária: 30h). , SENAC, SENAC, Brasil.
2001 - 2001
Configuração e Manutenção de Software e Hardware. (Carga horária: 174h). , SENAC, SENAC, Brasil.
2000 - 2000
Lógica de Programação. (Carga horária: 45h). , SENAC, SENAC, Brasil.
2000 - 2000
MS-DOS. (Carga horária: 15h). , SENAC, SENAC, Brasil.
2000 - 2000
Programa Miniempresa. (Carga horária: 60h). , Junior Acheivement, JUNIOR, Brasil.
1999 - 1999
Extensão universitária em Windows 95. (Carga horária: 27h). , SENAC, SENAC, Brasil.
1999 - 1999
Microinformática - Iniciação a Área. (Carga horária: 15h). , SENAC, SENAC, Brasil.
Idiomas
Inglês
Compreende Bem, Fala Razoavelmente, Lê Bem, Escreve Razoavelmente.
Espanhol
Compreende Razoavelmente, Fala Pouco, Lê Pouco, Escreve Pouco.
Participação em eventos
IEEEXtreme Programming Competition 6.0. Competição de programação. 2012. (Olimpíada).
Chip in the Pampa. 2008. (Simpósio).
Produções bibliográficas
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JOHANN, SERGIO F. ; MOREIRA, MATHEUS T. ; HECK, LEANDRO S. ; CALAZANS, NEY L.V. ; HESSEL, FABIANO P. . A processor for IoT applications: An assessment of design space and trade-offs. Microprocessors and Microsystems , v. 42, p. 156-164, 2016.
-
HECK, GUILHERME ; HECK, LEANDRO S. ; MOREIRA, MATHEUS T. ; MORAES, FERNANDO G. ; CALAZANS, NEY L. V. . A new local clock generator for globally asynchronous locally synchronous MPSoCs. Analog Integrated Circuits and Signal Processing , v. xx, p. xx-xx, 2016.
-
ZHANG, YANG ; HECK, LEANDRO S. ; MOREIRA, MATHEUS T. ; ZAR, DAVID ; BREUER, MELVIN A. ; CALAZANS, NEY L. V. ; BEEREL, PETER A. . Testable MUTEX Design. IEEE Transactions on Circuits and Systems. I, Regular Papers (Print) , v. PP, p. 1-12, 2016.
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HECK, Leandro Sehnem ; KLEBER, Luis Henrique . Automação residencial: integração de dispositivos com redes sem fio de baixa potência. Revista da Graduação , v. 01, p. 01, 2008.
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HECK, GUILHERME ; HECK, LEANDRO S. ; MOREIRA, MATHEUS T. ; MORAES, FERNANDO G. ; CALAZANS, NEY L. V. . A digitally controlled oscillator for fine-grained local clock generators in MPSoCs. In: 2015 IEEE 6th Latin American Symposium on Circuits & Systems (LASCAS 2015), 2015, Montevideo. 2015 IEEE 6th Latin American Symposium on Circuits & Systems (LASCAS). p. 1.
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ZHANG, YANG ; HECK, LEANDRO S. ; MOREIRA, MATHEUS T. ; ZAR, DAVID ; BREUER, MELVIN ; CALAZANS, NEY L.V. ; BEEREL, PETER A. . Design and Analysis of Testable Mutual Exclusion Elements. In: 2015 21st IEEE International Symposium on Asynchronous Circuits and Systems (ASYNC), 2015, Mountain View. 2015 21st IEEE International Symposium on Asynchronous Circuits and Systems. p. 124.
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HECK, GUILHERME ; HECK, LEANDRO S. ; SINGHV, AJAY ; MOREIRA, MATHEUS T. ; BEEREL, PETER A. ; CALAZANS, NEY L.V. . Analysis and Optimization of Programmable Delay Elements for 2-Phase Bundled-Data Circuits. In: 2015 28th International Conference on VLSI Design (VLSID), 2015, Bangalore. 2015 28th International Conference on VLSI Design. p. 321.
Prêmios
2007
Prêmio ASSESPRO/RS para Trabalhos de Conclusão, ASSESPRO/RS.
Histórico profissional
Endereço profissional
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Pontificia Universidade Católica do Rio Grande do Sul. , Av. Ipiranga, 6681 Prédio 32, Partenon, 90619900 - Porto Alegre, RS - Brasil, Telefone: (51) 97868899
Experiência profissional
2014 - 2015
Universidade de Santa Cruz do SulVínculo: Celetista, Enquadramento Funcional: Horista, Carga horária: 8
2009 - 2010
Portochip Serviços de Design Ltda.Vínculo: Bolsista, Enquadramento Funcional: Bolsista Ci-Brasil fase 3 (CNPQ), Carga horária: 40, Regime: Dedicação exclusiva.
Outras informações:
Atuação como projetista de desenvolvimento de circuitos integrados de aplicação específica (ASICs) digitais na área de microeletrônica. Atua em diferentes partes do fluxo de desenvolvimento, tais como: Desenvolvimento de células, especificação, codificação (front-end), prototipação em FPGA e projeto físico do chip (back-end).
2010 - 2011
Mecomo do BrasilVínculo: Trainee, Enquadramento Funcional: Bolsista, Carga horária: 30
Outras informações:
Desenvolvedor de aplicativos para smartphones como o iPhone.
2008 - 2009
Grupo de Apoio ao Projeto de HardwareVínculo: Bolsista Pesquisador, Enquadramento Funcional: Gerente de Projeto, Carga horária: 40
Outras informações:
Gerente do projeto que desenvolve um transponder capaz de transmitir sinais SDH e Gigabit Ethernet sobre redes do tipo OTN (Open Transport Network). Este projeto (X10GIGA) é financiado pela FINEP e é uma parceria de pesquisa entre a empresa DATACOM, PUCRS e GAPH.
2007 - 2008
Grupo de Apoio ao Projeto de HardwareVínculo: Bolsista Pesquisador, Enquadramento Funcional: Projetista, Carga horária: 30
Outras informações:
Bolsista pesquisador no Grupo de Apoio ao Projeto de Hardware (GAPH), PUCRS. Integrante do GAPH, desenvolvendo atividades de prototipação e programação em VHDL para módulos de hardware para desenvolvimento de um transponder capaz de transmitir sinais SDH e Gigabit Ethernet sobre redes do tipo OTN (Open Transport Network). Este projeto (X10GIGA) é financiado pela FINEP e é uma parceria de pesquisa entre a empresa DATACOM, PUCRS e GAPH.
2004 - 2004
Laboratório de Sistemas, Sinais e ComputaçãoVínculo: Bolsista Pesquisador, Enquadramento Funcional: Desenvolvedor, Carga horária: 20
Outras informações:
Bolsista pesquisador no Laboratório de Sistemas, Sinais e Computação (SISC), PUCRS.Integrante do SISC, desenvolvendo software e hardware embarcados. A bolsa foi financiada pela CNPQ.
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