Wang Jiang Chau
Possui graduação em Engenharia de Eletricidade pela Universidade de São Paulo (1981), mestrado em Engenharia Elétrica (Microeletrônica) pela Universidade de São Paulo (1988) e doutorado em Engenharia de Computação - Syracuse University (1993). Atualmente é professor associado MS-5 da Universidade de São Paulo. Tem experiência na área de Engenharia Elétrica e de Computação, atuando principalmente nos seguintes temas: verificação funcional de sistemas digitais, reconfiguração dinâmica, e projeto e modelagem no nível de sistemas.
Informações coletadas do Lattes em 24/07/2025
Acadêmico
Formação acadêmica
Doutorado em Engenharia de Computação
1988 - 1993
Syracuse University
Título: Multilevel Logic Minimization and Test Set Generation Using Binary Decision Diagrams
Orientador: Edward Stabler
Bolsista do(a): Fundação de Amparo à Pesquisa do Estado de São Paulo, FAPESP, Brasil. Palavras-chave: Bdd; Otimizacao; Compactacao de Testes; Sintese Lógica; minimização lógica; Atpg. Grande área: EngenhariasGrande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Teoria da Computação / Especialidade: Análise de Algoritmos e Complexidade de Computação. Setores de atividade: Industria Eletro-Eletrônica; Informática.
Mestrado em Engenharia Elétrica
1983 - 1988
Universidade de São Paulo
Título: Modelamento Estático de Transistor MOS- Tipo Depleção de Geometria Grande, Ano de Obtenção: 1988
Orientador: Bernard Waldman
Bolsista do(a): Laboratório de Microletrônica Projeto Finep, LME-USP/FINEP, Brasil. Palavras-chave: Modelagem; Transistor MOS; Transistor tipo depleção; SPICE.Grande área: EngenhariasSetores de atividade: Informática; Industria Eletro-Eletrônica.
Idiomas
Inglês
Compreende Bem, Fala Bem, Lê Bem, Escreve Bem.
Chinês
Compreende Razoavelmente, Fala Razoavelmente.
Espanhol
Compreende Razoavelmente, Fala Razoavelmente, Lê Bem, Escreve Pouco.
Português
Compreende Bem, Fala Bem, Lê Bem, Escreve Bem.
Francês
Compreende Pouco, Fala Pouco, Lê Pouco, Escreve Pouco.
Áreas de atuação
Grande área: Engenharias / Área: Engenharia Elétrica / Subárea: Circuitos Elétricos, Magnéticos e Eletrônicos/Especialidade: projeto de sistemas integrados.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Arquitetura de Sistemas de Computação.
Grande área: Engenharias / Área: Engenharia Elétrica / Subárea: Circuitos Elétricos, Magnéticos e Eletrônicos/Especialidade: Circuitos Eletrônicos.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Hardware.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Teoria da Computação/Especialidade: Análise de Algoritmos e Complexidade de Computação.
Grande área: Engenharias / Área: Engenharia Elétrica / Subárea: Medidas Elétricas, Magnéticas e Eletrônicas; Instrumentação/Especialidade: Instrumentação Eletrônica.
Organização de eventos
CHAU W J . 24th Symposium on Integrated Circuits and Systems Design (24th SBCCI). 2011. (Congresso).
Participação em eventos
3rd Colombian Workshop on Circuits and Systems.3rd Colombian Workshop on Circuits and Systems. 2009. (Oficina).
Participação em bancas
SILVA, A. A. A.; UEDA, E. T.;CHAU W J. Análise do consumo de energia em uma implementação física do Low-Energy Adaptive Clustering Hierarchy (LEACH) para redes sem Fio. 2021. Dissertação (Mestrado em Engenharia de Computação) - Instituto de Pesquisas Tecnológicas do Estado de São Paulo.
MATSUMOTO, M. M. S.;OLIVEIRA, D. L.; VICTOR JUNIOR, M. H.;WANG J C. ARQUITETURAS PIPELINE ASSÍNCRONAS ROBUSTAS IMPLEMENTADAS EM FPGA. 2021. Dissertação (Mestrado em Engenharia Eletrônica e Computação) - Instituto Tecnológico de Aeronáutica.
Jiang Chau, WangOLIVEIRA, Duarte Lopes de; Fontebasso, J.N.. Otimização de Mapeamento e Posicionamento para Sistemas Dinamicamente Reconfiguráveis Baseados em NoCs Utilizando-se a Meta-heurística Busca Tabu. 2019. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
WANG J COLIVEIRA, D. L.; OLIVEIRA, N. M. F.; DAMORE, R.; SAOTOME, O.. Validação Experimental de um Sistema Tolerante a Falhas Baseado em FPGA Parcialmente Reconfigurável. 2017. Dissertação (Mestrado em Engenharia Eletrônica e Computação) - Instituto Tecnológico de Aeronáutica.
Jiang Chau, Wang; Ponchet, A.; SOARES JUNIOR, João Navarro. Verificação funcional para circuitos de transmissão e recepção de sinais mistos. 2017. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
Jiang Chau, WangPIRES, Ricardo; Stenico, J.W.G.. Gerador de tráfego multifractal modelado no nível de transações para a avaliação de desempenho de sistemas integrados. 2017. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
NOIJE, W. A. M. V.; HORTA, Edson Lemos;WANG J C. Projeto de um circuito oscoilador controlado numericamente implementado em CMOS com otimização de área. 2016. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
GIMENEZ, S. P.; AVELINO, V. F.;CHAU W J. Projeto de Circuitos Integrados Digitais Utilizando-se de Ferramentas Computacionais de Demonstração e Profissional. 2014. Dissertação (Mestrado em ENGENHARIA ELÉTRICA) - FUNDACAO EDUCACIONAL INACIANA PADRE SABOIA DE MEDEIROS.
CHAU, WANG J.; HORTA, Edson Lemos;PIRES, Ricardo. DyAFNoC: Sistema Dinamicamente Reconfigurável Baseado em Redes Intrachip com Algoritmo de Roteamento Ordenado por Dimensão Flexibilizado. 2014. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J; MOURELLE, L. M.; NEDJAH, N.; RABELLO, E. F. V.. Arquitetura de uma rede de interconexão baseada na topologia crossbar com memória compartilhada. 2013. Dissertação (Mestrado em Engenharia Eletrônica) - Universidade do Estado do Rio de Janeiro.
CHAU W JPIRES, Ricardo; ZUCCHI, W. L.. Ajuste de tráfego intrachip obtido por simulação no nível de transação a modelos de séries autossimilares. 2013. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
OLIVEIRA, Duarte Lopes deCHAU W J; CUNHA, W. C.. Assinalamento de Estados para Controladores Assíncronos baseado em Algoritmo Genético. 2013. Dissertação (Mestrado em Engenharia Eletrônica e Computação) - Instituto Tecnológico de Aeronáutica.
ARAUJO, Guido;CHAU W J; CENTODUCATTE, Paulo. Autenticação de Circuitos Integrados usando Physical Unclonable Functions. 2012. Dissertação (Mestrado em Ciência da Computação) - Universidade Estadual de Campinas.
CHAU W J; A.O.Fernandes;PIRES, Ricardo. Ferramenta de CAD para extração de modelo de cobertura de saída por itens em verificação funcional. 2011. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W JGONZALEZ, José Artur Quilici; HORTA, Edson Lemos. Desenvolvimento de um sistema dinamicamente reconfigurável baseado em redes intrachip e ferramenta para posicionamento de módulos. 2010. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W JGONZALEZ, José Artur Quilici; HORTA, Edson Lemos. Aplicação de técnicas de reconfiguração dinâmica a projeto de máquinas de vetor de suporte (SVM). 2010. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J; D.C.Silva; HORTA, Edson Lemos. Análise da influência do uso de domínios de parâmetros sobre a eficiência da verificação funcional baseada em estimulação aleatória. 2009. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
D.C.Silva;CHAU W J; A.O.Fernandes. Análise de Cobertura e Geração de Vetores de Teste para Módulos Descritos em SystemC. 2008. Dissertação (Mestrado em Engenharia Elétrica) - Universidade Federal de Minas Gerais.
S. Rigo; S. T. Kofuji;CHAU W J. Uma metodologia analítico-determinística para a avaliação de desempenho no tempo de processadores de rede implementados como sistemas-sobre-silício. 2007. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
MARRANGHELLO, Norian; N.Oki;CHAU W J. Desenvolvimentod e uma Arquitetura Reconfigurável para o Processamento de Modelos no Ambiente Abacus. 2007. Dissertação (Mestrado em Engenharia Elétrica) - Universidade Estadual Paulista Júlio de Mesquita Filho.
CHAU W J; SOARES JUNIOR, João Navarro; SILVEIRA, Reinaldo. Técnicas para a verificação eficiente de uma implementação RTL da camada banda base do protocolo Bluetooth. 2005. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J; MARRANGHELLO, Norian;PIRES, Ricardo. Especificação e Implementação de uma Representação Intermediária Unificada para Sistemas Digitais. 2005. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J; CALAZANS, Ney Laert Vilar; HESSEL, Fabiano Passuelo; MORAES, Fernando Gehm. Redes Intra-chip parametrizáveis com interface padrão para síntese em hardware. 2004. Dissertação (Mestrado em Ciência da Computação) - Pontifícia Universidade Católica do Rio Grande do Sul.
CHAU W J; CALAZANS, Ney Laert Vilar; HESSEL, Fabiano Passuelo; MORAES, Fernando Gehm. Modelagem, descrição e validação de redesiIntra-chip no nível de transação. 2004. Dissertação (Mestrado em Ciência da Computação) - Pontifícia Universidade Católica do Rio Grande do Sul.
CHAU W JSTRUM, MariusPIRES, Ricardo. Desenvolvimento de Estruturas Quase-Homogêneas para o Auto-Teste de Circuitos Integrados de Aplicação Específica. 2001. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W JSTRUM, Marius; CÔRTES, Mário Lúcio. Algoritmos de Otimização de Planos de Teste de Unidades Funcionais para Circuitos BIST. 2001. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W JSTRUM, Marius; MELO, Ana Cristina Vieira de. Um Estudo sobre a Utilização de Modelos Computacionais para a Representação de Sistemas Digitais. 2000. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J; VALE NETO, José Vieira Do; CASAGRANDE, Douglas. Um Método de Síntese de Via de Dados para Circuitos Integrados de aplicação Específica Auto-testáveis. 2000. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J. Estimativa de Consumo de Potência Baseada em Perfil de Dados em Síntese de Alto Nível. 1998. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J. Estudo e Implementação de Transformações Arquiteturais para Aplicação em Projetos Hierárquicos Desenvolvidos segundo a Metodologia de Síntese de Alto Nível. 1998. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J. DECMEF: Um sistema de Decomposição Aplicado à Síntese de Máquinas de Estados Finitos Complexas. 1998. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J; MENDES, Leonardo. Redes ATM: Uma Visão Geral. 1997. Dissertação (Mestrado em Engenharia Elétrica) - Universidade Estadual de Campinas.
CHAU W J. Uma ferramenta para Otimização em Síntese de Alto Nível Baseada em Reconhecimento Funcional e Mapeamento de Componentes. 1997. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W JAMAZONAS, José Roberto de Almeida. Requisitos para o Mapeamento Tecnológico em Projetos de Microeletrônica. 1996. Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo.
VICTOR JUNIOR, M. H.;OLIVEIRA, D. L.; DAMORE, R.; RIBAS, R. P.;CHAU W J. NOVAS ARQUITETURAS PARA MÁQUINA DE ESTADOS FINITOS ASSÍNCRONAS ALTAMENTE ROBUSTAS. 2021. Tese (Doutorado em Engenharia Eletrônica e Computação) - Instituto Tecnológico de Aeronáutica.
NOIJE, W. A. M. V.;CHAU W J; GUAZZELLI, M. A.; FINCO, S.; KASTENSMIDT, F. G. L.. Um processador de sinais de aplicação específica para sistemas de detecção a gás em experimentos de física de alta energia. 2021. Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo.
ARAUJO, Guido; SIMPLICIO JUNIOR, M. A.;CHAU W J; HERNANDEZ, J. C. L.; WANNER, L. F.. Computer Security by Hardware-Intrinsic Authentication. 2019. Tese (Doutorado em Ciência da Computação) - Universidade Estadual de Campinas.
OLIVEIRA, D. L.; OLIVEIRA, N. M. F.; DAMORE, R.; SAOTOME, O.;CHAU, WANG J.; STRM, Marius. Arquiteturas e Síntese Automática de Máquinas de Estado Finito Voltadas para Sistemas Digitais Heterogêneos. 2018. Tese (Doutorado em Engenharia Eletrônica e Computação) - Instituto Tecnológico de Aeronáutica.
HERNANDEZ, Emilio Del Moral;WANG J C; ARAUJO, A. F. R.; KITANI, E. C.; PERES, S. M.. Metodologias para desenvolvimento de mapas auto-organizáveis de Kohonen executados em FPGA. 2018. Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo.
BARROS, E. N. S.;Jiang Chau, Wang; TEICHRIEB, V.; ORDONEZ, E. D. M.; MEDEIROS, V. W. C.. Aceleração da Consulta a um Grande Banco de DNA Forense: Uma Abordagem Multiplataforma. 2016. Tese (Doutorado em Ciências da Computação) - Universidade Federal de Pernambuco.
NOIJE, Wilhelmus Adrianus M Van;CHAU, WANG J.; CENTODUCATTE, Paulo; SUZIM, Altamiro Amadeu; SOARES JUNIOR, João Navarro. Projeto e Desenvolvimento de uma Arquitetura de Baixo Consumo de Potência para Microprocessadores. 2015. Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo.
NOIJE, Wilhelmus Adrianus M Van;CHAU, WANG J.; SOARES JUNIOR, João Navarro; PETRAGLIA, A.; BAMPI, S.. Síntese de CIs Analógicos em Nível de Circuito e Sistema Utilizando Métodos Modernos de Otimização. 2015. Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo.
Cortez, P.C.; Marcon, Cesar; Gomes, D.G.; Barroso, G.C.; HESSEL, Fabiano Passuelo;Chau, Wang Jiang. Pré-Processamento de Cenários para Reconfiguração de Roteamento Eficiente em MPSOC Baseado em NOC Tolernte a Falhas. 2015. Tese (Doutorado em Engenharia de Teleinformática) - Universidade Federal do Ceará.
CHAU, WANG J.; HORTA, Edson Lemos; HERNANDEZ, Emilio Del Moral; LIMA, M. E.;PIRES, Ricardo. MAPEAMENTO E POSICIONAMENTO DE MÓDULOS PROCESSANTES EM SISTEMAS DINAMICAMENTE RECONFIGURÁVEIS BASEADOS EM REDES INTRACHIP. 2014. Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W JGONZALEZ, José Artur Quilici; MIDORIKAWA, Edson; RUGGIERO, Wilson; MORAES, Fernando Gehm. Caracterização Analítica de Carga de Trabalho Baseada em Cenários de Aplicações Multimídia. 2012. Tese (Doutorado em Doutorado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J; A.O.Fernandes; Coelho C.J.N; D.C.Silva; FERREIRA, R. S.. Uma Metodologia para Identificação de Módulos de Circuitos Integrados Propensos a Erros. 2011. Tese (Doutorado em Ciências da Computação) - Universidade Federal de Minas Gerais.
CHAU W JGONZALEZ, José Artur Quilici; HORTA, Edson Lemos. Contribuições à verificação funcional ajustada por cobertura para núcleos de hardware de comunicação e multimídia. 2010. Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo.
A.O.Fernandes; D.C.Silva;CHAU W J; N.J.Vieira; M.S.Lubaszewski. Contribuições para o Problema de Verificação de Equivalência Combinacional. 2008. Tese (Doutorado em Ciências da Computação) - Universidade Federal de Minas Gerais.
F.G.L.Kastensmidt; C.A.Zeferino;CHAU W J. Test Logic and Scheduling for Testing Mesh-Based Best-Effort Networks-on-Chip. 2007. Tese (Doutorado em PPGC - Programa de Pós Graduação em Computação UFRGS) - Universidade Federal do Rio Grande do Sul.
CHAU W J; HERNANDEZ, Emilio Del Moral; HORTA, Edson Lemos; QUINTERO, Carlos Humberto Llanos; MARRANGHELLO, Norian. Uma Metodologia de Projetos para Circuitos com Reconfiguração Dinâmica de Hardware Aplicada a Support Vector Machines. 2006. Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J; NOIJE, Wilhelmus Adrianus M Van; SONG, Siang Wu; SANCHEZ, Pedro Luís Próspero; SUZIM, Altamiro Amadeu. Diretrizes para uma nova metodologia de projeto digital. 2004. Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo.
CHAU W J; MARRANGHELLO, Norian; SILVA, Alexandre César Rodrigues da; YAMAKAMI, Akebo; TOKARNIA, Alice Maria Bastos Hubinger; OLIVEIRA, José Raimundo de. Uma Abordagem para a Modelagem de Sistemas Digitais. 2003. Tese (Doutorado em Engenharia Elétrica) - Universidade Estadual de Campinas.
HERNANDEZ, Emilio Del Moral;WANG J C; KATANI, E. C.. Metodologia para desenvolvimento de Mapas Auto-organizáveis de Kohonen executados em FPGA. 2016. Exame de qualificação (Doutorando em Engenharia Elétrica) - Universidade de São Paulo.
BARROS, E. N. S.; SILVA FILHO, A. G.;CHAU, WANG J.. Desenvolvimento de um Acelerador de Hardware para Alinhamento Ótimo de DNA. 2015. Exame de qualificação (Doutorando em Ciências da Computação) - Universidade Federal de Pernambuco.
D.C.Silva; A.O.Fernandes; M.S.Lubaszewski;CHAU W J; Mesquita R C. Técnicas para Prevenção de Defeitos de Projeto em Descrições de SoCs. 2010. Exame de qualificação (Doutorando em Engenharia Elétrica) - Universidade Federal de Minas Gerais.
A.O.Fernandes; Carro L.;CHAU W J; Coelho C.J.N; D.C.Silva. Predição de erros de projeto em circuitos integrados. 2009. Exame de qualificação (Doutorando em Ciências da Computação) - Universidade Federal de Minas Gerais.
A.O.Fernandes; M.S.Lubaszewski;CHAU W J; D.C.Silva; N.J.Vieira. Verificação de Equivalência Incremental de Circuitos Combinacionais Dissimilares através de Resolvedores de Satisfabilidade. 2007. Exame de qualificação (Doutorando em Ciências da Computação) - Universidade Federal de Minas Gerais.
GOMI, E.; MORATO, A. C.;CHAU, WANG. Proteção da Propriedade Intelectual dos Circuitos Integrados. 2021. Monografia (Aperfeiçoamento/Especialização em Direito e Tecnologia de Informação) - Universidade de São Paulo.
HERNANDEZ, Emilio Del Moral; Ramirez, Miguel; PERES, S. M.; Campo, Alexandre;WANG J C. Comissão Especial de Avaliação para a Carreira de Professor Titular. 2022. Instituto Federal de São Paulo.
(Oliveira W); Maciel P R;CHAU W J. Cargo de Professor Adjunto - Edital No. 4- 1009. 2010. Universidade Estadual de Feira de Santana.
CHAU W J; DIRANI, Ely Antônio Tadeu; CRUZ, José Jaime da; MATAKAS JUNIOR, Lourenço; MAYA, Paulo Álvaro. Cargo de Professor Assistente Doutor de Fabrizio Leonardi. 2003. Pontifícia Universidade Católica de São Paulo.
RUGGIERO, Wilson;CHAU W J; PIQUEIRA, J. R. C.. Professor Doutor. 2018. Escola Politécnica-USP.
XEXEO, J. A. M.;CHAU W J. Renovação de Curso de Telecomunicações (INEP/MEC). 2011. Centro Universitário Luterano de Manaus.
Yamada F;CHAU W J. Renovação de Curso INEP- comunicações - FUCAPI- CESF. 2010. Fundação Centro de Análise Pesquisa e Inovação Tecnológica.
CHAU W J; NOIJE, W. A. M. V.; VALE NETO, José Vieira Do. Concurso para Especialista de Laboratório. 2011. Escola Politécnica-USP.
CHAU W J; NOIJE, Wilhelmus Adrianus M Van; VALE NETO, José Vieira Do; MARTINO, J. A.. Concurso para Especialista de Laboratório- Projeto de Circuitos Integrados (nível superior). 2010. Escola Politécnica-USP.
CHAU W J; NOIJE, W. A. M. V.; SOARES JUNIOR, João Navarro. Concurso para Especialista de Laboratório- Projeto de Circuitos Integrados (nível superior). 2009. Escola Politécnica-USP.
Orientou
Verificação Funcional de Implementação de NoC Usando Biblioteca Baseada em UVM com Capacidade de Injeção de Falhas; Início: 2022; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo; (Coorientador);
Accelerating the Alignment Phase of Minimap2 Genome Assembly Algorithm Using GACT-X in a Commercial Cloud FPGA Machine; 2022; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Coorientador: Wang Jiang Chau;
Otimização de Mapeamento e Posicionamento para Sistemas Dinamicamente Reconfiguráveis baseados em NoCs utilizando-se a meta-heurística Busca Tabu; 2019; Dissertação (Mestrado em Engenharia Elétrica) - Escola Politécnica-USP, ; Orientador: Wang Jiang Chau;
Multifractal Traffic Generator Modeled at the Transaction Level for Integrated Systems Performance Evaluation; 2017; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Verificação Funcional para circuitos de transmissão e recepção de sinais mistos; 2017; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, ; Orientador: Wang Jiang Chau;
DyAFNoC: Sistema dinamicamente reconfigurável baseado em redes intrachip com algoritmo de roteamento ordenado por dimensão flexibilizado; 2014; Dissertação (Mestrado em Microeletrônica) - Escola Politécnica, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Orientador: Wang Jiang Chau;
Ajuste de trafego intrachip obtido por simulação no nível de transação a modelos de séries autossimilares; 2013; Dissertação (Mestrado em Microeletrônica) - Escola Politécnica, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Ferramenta CAD para extração de modelo de cobertura de saída por itens em verificação funcional; 2011; Dissertação (Mestrado em Microeletrônica) - Escola Politécnica, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Aplicação de Técnicas de Reconfiguração Dinâmica a Projeto de Máquina de Vetor de Suporte (SVM); 2010; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Desenvolvimento de um Sistema Dinamicamente Reconfigurável Baseado em Redes Intrachip e Ferramenta para Posicionamento de Módulos; 2010; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Técnicas de Análise de Parâmetros de Verificação Funcional para Determinação de Espaço Simulação e Cobertura; 2009; 0 f; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Orientador: Wang Jiang Chau;
UMA METODOLOGIA ANALÍTICO-DETERMINÍSTICA PARA A AVALIAÇÃO DE DESEMPENHO NO TEMPO DE PROCESSADORES DE REDE IMPLEMENTADOS COMO SISTEMAS-SOBRE-SILÍCIO; 2007; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Técnicas para a Verificação Funcional Eficiente de uma Implementação RTL da Camada Banda Base do Protocolo Bluetooth; 2005; 71 f; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Especificação e Implementação de uma Representação Intermediária Unificada para Sistemas Digitais; 2005; 133 f; Dissertação (Mestrado em Microeletrônica) - Escola Politécnica da Universidade de São Paulo, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Orientador: Wang Jiang Chau;
Algoritmos de Otimização de Planos de Teste de Unidades Funcionais para Circuitos BIST; 2001; 0 f; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Orientador: Wang Jiang Chau;
Estimativa de Consumo de Potência Baseada Em Perfil de Dados Em Síntese de Alto Nível; 1998; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, ; Orientador: Wang Jiang Chau;
Estudo e Implementação de Transformações Arquiteturais Para Aplicação Em Projetos Hierárquicos Desenvolvidos Segundo A Metodologia de Síntese de Alto Nível; 1998; Dissertação (Mestrado em Engenharia Elétrica) - Universidade de São Paulo, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Orientador: Wang Jiang Chau;
Checagem de equivalência de sequências de estados de projetos digitais em RTL com modelos de referência em alto nível e de protocolo de comunicação; 2014; Tese (Doutorado em Microeletrônica) - Escola Politécnica, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Mapeamento e posicionamento de módulos processantes em sistemas dinamicamente reconfiguráveis baseados em redes intrachip; 2014; Tese (Doutorado em Engenharia Elétrica) - Escola Politécnica-USP, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Caracterização Analítica de Carga de Trabalho Baseada em Cenários de Aplicações Multimídia; 2012; 0 f; Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Orientador: Wang Jiang Chau;
CONTRIBUIÇÕES À VERIFICAÇÃO FUNCIONAL AJUSTADA POR COBERTURA PARA NÚCLEOS DE HARDWARE DE COMUNICAÇÃO E MULTIMÍDIA; 2010; 0 f; Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Uma Metodologia de Projetos para Circuitos com Reconfiguração Dinâmica de Hardware Aplicada a Support Vector Machines; 2006; Tese (Doutorado em Engenharia Elétrica) - Universidade de São Paulo, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior; Orientador: Wang Jiang Chau;
Proteção da Propriedade Intelectual dos Circuitos Integrados; 2021; Monografia; (Aperfeiçoamento/Especialização em Direito e Tecnologia de Informação (PECE)) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
DEMU: PLATAFORMA DE VERIFICAÇÃO FUNCIONAL DE DESCRIÇÕES RTL POR EMULAÇÃO EM FPGA; 2021; Trabalho de Conclusão de Curso; (Graduação em Engenharia Elétrica - Ênfase em Eletrônica e Sistemas Computacionais) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
DEMU: PLATAFORMA DE VERIFICAÇÃO FUNCIONAL DE DESCRIÇÕES RTL POR EMULAÇÃO EM FPGA; 2021; Trabalho de Conclusão de Curso; (Graduação em Engenharia Elétrica - Ênfase em Eletrônica e Sistemas Computacionais) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
DEMU: PLATAFORMA DE VERIFICAÇÃO FUNCIONAL DE DESCRIÇÕES RTL POR EMULAÇÃO EM FPGA; 2021; Trabalho de Conclusão de Curso; (Graduação em Engenharia Elétrica - Ênfase em Eletrônica e Sistemas Computacionais) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
BATMAP: ACELERADOR POR FPGA PARA MINIMAP2 - ALGORITMO DE MONTAGEM DE LEITURAS LONGAS DE DNA; 2019; Trabalho de Conclusão de Curso; (Graduação em Engenharia Elétrica - Ênfase em Sistemas Eletrônicos) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
BATMAP: ACELERADOR POR FPGA PARA MINIMAP2 - ALGORITMO DE MONTAGEM DE LEITURAS LONGAS DE DNA; 2019; Trabalho de Conclusão de Curso; (Graduação em Engenharia Elétrica - Ênfase em Sistemas Eletrônicos) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
BATMAP: ACELERADOR POR FPGA PARA MINIMAP2 - ALGORITMO DE MONTAGEM DE LEITURAS LONGAS DE DNA; 2019; Trabalho de Conclusão de Curso; (Graduação em Engenharia Elétrica - Ênfase em Sistemas Eletrônicos) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
JBCard (Java Biometric Card); 2013; Trabalho de Conclusão de Curso; (Graduação em Engenharia Elétrica - Ênfase em Sistemas Eletrônicos) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
JBCard (Java Biometric Card); 2013; Trabalho de Conclusão de Curso; (Graduação em Engenharia Elétrica - Ênfase em Sistemas Eletrônicos) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
JBCard (Java Biometric Card); 2013; Trabalho de Conclusão de Curso; (Graduação em Engenharia Elétrica - Ênfase em Sistemas Eletrônicos) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
GUIA ELETRÔNICO INDOOR PARA DEFICIENTES VISUAIS UTILIZANDO ETIQUETAS RFID; 2012; Trabalho de Conclusão de Curso; (Graduação em Engenharia de Sistemas Eletrônicos) - Escola Politécnica-USP; Orientador: Wang Jiang Chau;
Sistema Rtool- Ferramenta de Prototipagem Rápida de Descrições RTL para Fins de Depuração; 2011; Trabalho de Conclusão de Curso; (Graduação em Engenharia de Sistemas Eletrônicos) - Escola Politécnica-USP; Orientador: Wang Jiang Chau;
Desenvolvimento e implementação da microarquitetura de comunicação interna para FPGAs dinamicamente reconfiguráveis; 2008; Trabalho de Conclusão de Curso; (Graduação em Engenharia de Sistemas Eletrônicos) - Escola Politécnica-USP; Orientador: Wang Jiang Chau;
Caracterização, Modelagem e Desenvolvimento de Geradores Sintéticos para Tráfego com Dependência de Longa Duração em Comunicação Intrachip; 2014; Iniciação Científica; (Graduando em Engenharia de Sistemas Eletrônicos) - Escola Politécnica-USP, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Porte de Aplicações Multimídia para Processador da Plataforma SocLib e Caracterização do Tráfego na Comunicação com Memória; 2013; Iniciação Científica; (Graduando em Engenharia de Sistemas Eletrônicos) - Escola Politécnica-USP, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Desenvolvimento de testes para adaptador Bluetooth em placa de prototipagem; 2006; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Desenvolvimento e Adaptação de SW embarcado para núcleo controlador de rede sem fio com protocolo Bluetooth; 2006; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Desenvolvimento e Adaptação de SW embarcado para núcleo controlador de rede sem fio com protocolo Bluetooth; 2006; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Implementação de adaptador e de camada física de interfaces para núcleo adaptador de rede; 2006; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Verificação functional e implementação física de interfaces para núcleo adaptador de rede; 2005; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Estudo de núcleos de teste e análise para placa de prototipagem; 2005; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Projeto RTL e prototipação de interface OCP para adaptador de rede sem fio Bluetooth; 2004; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Projeto em software de driver e camadas de protocolo de adaptador de rede sem fio Bluetooth; 2004; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Estudo, Implementação e Análise de Algoritmos para Otimização de Planos de Teste de Unidades Funcionais em Circuitos BIST; 2003; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Desenvolvimento e Implementação de Ferramenta de Análise de Otimização de Planos de Teste de Unidades Funcionais em Circuitos BIST; 2002; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Fundação de Amparo à Pesquisa do Estado de São Paulo; Orientador: Wang Jiang Chau;
Estudo, Implementação e Análise de Algoritmos para Otimização de Planos de Teste de Unidades Funcionais em Circuitos BIST; 2002; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Reordenamento dinâmico em BDDs, aplicados a síntese sequencial; 1997; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Sakai; BDDs Aplicados a Síntese Lógica Combinatória e Minimização Lógica; 1996; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Desenvolvimento de Aplicações para Diagrama de Decisão Binária (BDDs) para Síntese Combinatória; 1995; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
BDDs Aplicados a Síntese Sequencial e Equivalência de Estados; 1995; Iniciação Científica; (Graduando em Escola Politécnica) - Universidade de São Paulo, Conselho Nacional de Desenvolvimento Científico e Tecnológico; Orientador: Wang Jiang Chau;
Reformulação de Projeto de Referência de Disciplina (Simplificação e Modularização); 2020; Orientação de outra natureza; (Engenharia Elétrica - Ênfase em Sistemas Eletrônicos) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
Tools for manipulationg circuit descriptions in VHDL language; 2017; Orientação de outra natureza; (Engenharia Elétrica - Ênfase em Sistemas Eletrônicos) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
Synphony C Compiler, by Synopsys Synthesizing and testing a GCD; 2013; Orientação de outra natureza; (Engenharia Elétrica - Ênfase em Sistemas Eletrônicos) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
Implementação em Hardware de Chave e Algoritmo de Roteamento FDOR para Sistemas Dinamicamente Reconfiguráveis baseados em Network-on-Chips; 2012; Orientação de outra natureza; (Engenharia Elétrica - Ênfase em Sistemas Eletrônicos) - Universidade de São Paulo; Orientador: Wang Jiang Chau;
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GONZALEZ, José Artur Quilici ; CHAU W J . Circuit Partitioning and HDL Restructuring for Behavioral Simulation ofDynamically Reconfigurable Circuit Partitions: a Case Study. In: 2nd International Conference on Electronic Design, 2006, Vera Cruz, Mexico. 2006 International Conference on Electronic Design- Procceddings, 2006. v. 1. p. 6-11.
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KOJIMA, Leandro ; ESQUIAGOLA, John ; STRUM, Marius ; CHAU W J . Design Space Exploration for Dynamic Reconfiguration from SystemC. In: 2nd International Conference on Electronic Design, 2006, Vera Cruz, Mexico. 2006 International Conference on Electronic Design- Proceedings, 2006. v. 1. p. 74-79.
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ESLAVA, Sebastian ; LOZADA, Gino ; STRUM, Marius ; CHAU W J . Performance Estimation of On-Chip Communication Structures at Different TLM Sub-levels. In: XI Workshop IBERCHIP, 2005, Salvador. XI Workshop IBERCHIP, 2005. p. 70-73.
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ROMERO, Edgar Leonardo ; CHAU W J ; STRM, Marius . Functional Verification of a baseband BLUETOOTH Adaptor. In: XI Workshop IBERCHIP, 2005, Salvador. XI Workshop IBERCHIP, 2005. p. 235-238.
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ESQUIAGOLA, John ; OZARI, Guilherme ; TERUYA, Marcio ; STRUM, Marius ; CHAU W J . A Dinamically Reconfigurable Bluetooth Base Band Unit. In: International Conference on Field Programmable Logic and Applications (FPL), 2005, Tampere. FPL2005 -International Conference on Field Programmable Logic and Applications (FPL), 2005. v. 1. p. 148-152.
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OLIVEIRA, Duarte Lopes de ; STRM, Marius ; CHAU W J . Miria-SI: A Toll for the Synthesis of Speed-Independent Multi Burst-Mode Controllers. In: 18th Symposium on Integrated Circuits and Systems Design (SBCCI2005), 2005, Florianópolis. Proceedings- SBCCI2005- 18th Symposium on Integrated Circuits and Systems Design, 2005. v. 1. p. 56-61.
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ROMERO, Edgar Leonardo ; STRUM, Marius ; CHAU W J . Comparing Two Testbench Methods for Hierarchical Functional Verification of a Bluetooth Baseband Adaptor. In: International Conference on Hardware/Software Codesign and System Synthesis (CODES+ISSS 2005), 2005, Jersey City. CODES+ISSS 2005 - International Conference on Hardware/Software Codesign and System Synthesis, 2005. v. 1. p. 327-332.
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CHAU W J ; OLIVEIRA, Duarte Lopes de ; STRUM, Marius ; CUNHA, Wagner . Modified ATACS Algorithm for the Logic Minimization of Multi Burst-Mode Asynchronous Controllers. In: X Workshop Iberchip, 2004, Cartagena de Indias. IWS´04 - seção 6b - 8 páginas, 2004. p. 1-8.
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CHAU W J ; OLIVEIRA, Duarte Lopes de ; STRUM, Marius . Synthesis of Multi Burst- Mode Controllers using Genralizar C-Components. In: IX Workshop IBERCHIP, 2003, La Habana. IWS´2003 - seção 4a - 8 páginas, 2003. v. 0. p. 1-8.
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CHAU W J ; P.S.Cardoso ; STRUM, Marius ; PIRES, Ricardo . A Comparison Between Test Pattern Generation Strategies for Functional Units in BIST Applications. In: 3rd IEEE Latin-American Test Workshop, 2002, Montevideo. 3rd IEEE Latin-American Test Workshop - Digest of Papers, 2002. v. 1. p. 61-63.
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CHAU W J ; GONZALEZ, José Artur Quilici ; STRUM, Marius ; PIRES, Ricardo . BIST Plan Optimization and Independent Input Test Register Insertion for Datapath Functional Units. In: 3rd IEEE Latin-American Test Workshop, 2002, Montevideo. 3rd IEEE Latin-American Test Workshop - Digest of Papers, 2002. v. 1. p. 64-69.
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CHAU W J ; GONZALEZ, José Artur Quilici ; STRUM, Marius ; PIRES, Ricardo . Comparing BIST Plan Optimization for Functional Units with Single and Independent Input Test Registers. In: Iberchip International Workshop, 2002, Guadalajara. Iberchip - VIII Workshop Internacional, 2002.
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OLIVEIRA, Duarte Lopes de ; STRUM, Marius ; CHAU W J ; CUNHA, W. C. . Synthesis of Multi-Burst Controllers as Generalized RS Architecture for Heterogenous Systems. In: VIII Iberchip Workshop, 2002, Guadalajara. Iberchip - VIII Workshop Internacional, 2002. p. 1.
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TERUYA, M. Y. ; CHAU W J . Bluetooth Link Controller Implementation on a Novel Dynamically Reconfigurable Architecture. In: VIII Iberchip Worshop, 2002, Guadalajara. Iberchip - VIII Workshop Internacional, 2002.
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CHAU W J ; OLIVEIRA, Duarte Lopes de ; STRUM, Marius ; CUNHA, W. C. . Synthesis of Multi-Burst Controllers as Modified Huffman Machines. In: 14th Symposium on Integrated Circuits and System Design, 2001, Pirenópolis. Proceedings 14th Symposium on Integrated Circuits and System Design. Los Alamitos, CA: IEEE Computer Society, 2001. v. 1. p. 220-225.
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CHAU W J ; OLIVEIRA, Duarte Lopes de ; STRUM, Marius ; CUNHA, W. C. . Synthesis of Multi-Burst Controllers as Standard RS Architectures. In: XVI International Conference on Microelectronics asd Packaging, 2001, Pirenópolis, GO. Proceedings XVI International Conference on Microelectronics asd Packaging. Brasília: Sociedade Brasileira de Microeletrônica, 2001. v. 1. p. 158-163.
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OLIVEIRA, Duarte Lopes de ; STRUM, Marius ; CHAU W J ; CUNHA, W. C. . Synthesis of Speed-Independent Circuitsfrom Multi-Burst Graph Speciifcationand Using Gate-Level Architectures. In: VII Workshop Iberchip, 2001, Montevideo. IWS´2001- VII Workshop Iberchip - seção 10 - 10 páginas, 2001. p. 1-10.
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CHAU W J ; QUILICI, J. A. ; AMAZONAS, José Roberto de Almeida ; STRUM, Marius . Self Test Built-in Plan for Data-Path Functional Units. In: 1st IEEE Latin-America Test Workshop (LATW2000), 2000, Rio de Janeiro. Digest of Papers of the 1st IEEE Latin-America Test Workshop, 2000. p. 9-14.
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CHAU W J ; OLIVEIRA, Duarte Lopes de ; STRUM, Marius ; CUNHA, Wagner . Direct Synthesis of Speed-Independent Circuits using Multi-Burst Graph Specification. In: XV International Conference on Microelectronics and Packaging, 2000, Manaus. Proceedings of the XV International Conference on Microelectronics and Packaging, 2000. p. 232-237.
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CHAU W J ; OLIVEIRA, Duarte Lopes de ; STRUM, Marius ; CUNHA, Wagner . Synthesis of High Performance Extended Burst Mode Asynchronous State Machines. In: 13th Symposium on Integrated Circuits ans Systems Design (SBCCI2000), 2000, Manaus. Proceedings of the 13th Symposium on Integrated Circuits ans Systems Design. Los Alamitos, CA: IEEE Computer Society, 2000. p. 41-46.
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CARDOSO, P. S. ; STRUM, Marius ; AMAZONAS, J. R. ; CHAU W J . Comparison between Quasi-Uniform Linear Cellular Automata and Linear Feedback Shift Registers as Test Pattern Generators for Built-in Self-Test Applications. In: XII Brazilian Symposium on Integrated Circuits and Systems Design (SBCCI'99), 1999, Natal. Proceedings of the XII Brazilian Symposium on Integrated Circuits and Systems Design (SBCCI'99), 1999. p. 198-201.
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TERUYA, M. Y. ; STRUM, Marius ; CHAU W J . Architectural Transformations for Hierarchical Algorithmic Descriptions. In: X IFIP International Conference on Very Large Scale Integration (VLSI'99), 1999, Lisboa. Proceeedings of the X IFIP International Conference on Very Large Scale Integration (VLSI'99), 1999. p. 473-488.
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P.S.Cardoso ; STRUM, Marius ; AMAZONAS, J. R. ; CHAU W J . Quasi-Uniform Cellular Automata For Bist Application. In: IV Workshop IBERCHIP, 1998, Mar del Plata. Proceedings of the IV Workshop IBERCHIP, 1998. p. 392-401.
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AMAZONAS, J. R. ; STRUM, Marius ; CHAU W J . Exploring Concurrency In Data Path Functional Units Bist Plan Optimization: A Study-Case. In: XI Brazilian Symposium on Integrated Circuit Design, 1998, Búzios. Proceedings of the XI Brazilian Symposium on Integrated Circuit Design, 1998. p. 244-247.
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P.S.Cardoso ; STRUM, Marius ; AMAZONAS, J. R. ; CHAU W J . A Methodology For Minimum Area Cellular Automata Generation. In: 7th Asian Test Symposium, 1998, Cingapura. Proceedings of the 7th Asian Test Symposium, 1998. p. 33-37.
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AMAZONAS, J. R. ; STRUM, Marius ; VALE NETO, J. V. ; CHAU W J ; ROUZEYRE, B. ; FLOTTES, M. . Data Path Functional Units Bist Plan Optimization: A Study-Case. In: XI Simpósio Brasileiro de Concepção de Circuitos Integrados, 1997, Gramado. Anais do XI Simpósio Brasileiro de Concepção de Circuitos Integrados, 1997. p. 185-194.
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TERUYA, M. Y. ; CHAU W J ; VALE NETO, J. V. ; STRUM, Marius ; JERRAYA, A. A. . Transformations For Functional Modules In Hierachical High Level Synthesis. In: XI Simpósio Brasileiro de Concepção de Circuitos Integrados, 1997, Gramado. Anais do XI Simpósio Brasileiro de Concepção de Circuitos Integrados, 1997. p. 115-124.
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CHAU W J ; TERUYA, M. Y. ; VALE NETO, J. V. ; STRUM, Marius ; JERRAYA, A. A. . A Recursive High Level System. In: 5th International Conference on VLSI and CAD, 1997, Seul. Proceedings of the 5th International Conference on VLSI and CAD, 1997. p. 412-414.
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TERUYA, M. Y. ; CHAU W J ; STRUM, Marius . A New Method For Inverse-Image Computation In Generating The Set Of Equivalent States. In: XI Conference of the Brazilian Microelectronics Society, 1996, Águas de Lindoia, SP. Proceedings of the XI Conference of the Brazilian Microelectronics Society, 1996. p. 10-15.
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STRUM, Marius ; CHAU W J ; STABLER, E. . Collective Test Generation And Test Set Compaction. In: 1995 International Symposium on Circuits and Systems, 1995, Seattle. Proceedings of the 1995 International Symposium on Circuits and Systems. Seattle, EUA: IEEE Press, 1995. p. 2008-2011.
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STRUM, Marius ; CHAU W J . Geração Coletiva e Compactação de Conjunto de Testes Em Síntese Lógica. In: VIII Simpósio Brasileiro de Concepção de Circuitos Integrados, 1994. Anais do VIII Simpósio Brasileiro de Concepção de Circuitos Integrados. Gramado, RS. p. 311-323.
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CHAU W J . Set Containment and Cube Expansion with Binary Decision Diagrams for Logic Synthesis. In: XX Seminário Integrado de Software e Hardware da Soc. Brasileira de Computação, 1993. Anais do XX Seminário Integrado de Software e Hardware da Soc. Brasileira de Computação. p. 25-37.
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CHAU W J . Optimized Cube Expansion with Binary Decision Diagrams and Expansion Graphs for Logic Minimization. In: VIII Congresso Brasileiro de Microeletrônica, 1993, Campinas. Anais do VIII Congresso Brasileiro de Microeletrônica, 1993. p. 8.6-8.13.
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VILLEGAS CASTILLO, ERNESTO ; MIORANDI, GABRIELE ; Chau, Wang Jiang . DyAFNoC: Characterization and analysis of a dynamically reconfigurable NoC using a DOR-based deadlock-free routing algorithm. In: 2014 Eighth IEEE/ACM International Symposium on NetworksonChip (NoCS), 2014, Ferrara. 2014 Eighth IEEE/ACM International Symposium on Networks-on-Chip (NoCS). p. 190-191.
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Sepúlveda, Martha Johanna ; Gogniat, Guy ; SEPÚLVEDA, DANIEL MAURICIO ; PIRES, Ricardo ; Chau, Wang Jiang ; STRUM, Marius . 3DMIA. In: Proceeding of the fifteenth annual conference companion, 2013, Amsterdam. Proceeding of the fifteenth annual conference companion on Genetic and evolutionary computation conference companion - GECCO '13 Companion. New York: ACM Press, 2013. v. 1. p. 167-168.
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FARIA, Frederico de ; STRUM, Marius ; CHAU W J . Performance Evaluation of a Network Processors Bus Arbiter Policies Using Worst-Case Deterministic Analytical Methodologies. In: XII Workshop IBERCHIP, 2006, San Jose. XII Workshop IBERCHIP, 2006. v. 1. p. 306-307.
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ESQUIAGOLA, John ; OZARI, Guilherme ; TERUYA, Marcio ; STRM, Marius ; CHAU W J . Dynamic Reconfiguration of Bluetooth Baseband Bitstream Processing. In: XI Workshop IBERCHIP, 2005, Salvador. XI Workshop IBERCHIP, 2005. p. 318-319.
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LOZADA, Gino ; ESLAVA, Sebastian ; STRUM, Marius ; CHAU W J . Random Traffic Generator for the performance Estimation of On-Chip Communication Structures. In: XI Workshop IBERCHIP, 2005, Salvador. XI Workshop IBERCHIP, 2005. p. 299-300.
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CHAU W J ; E.L.Romero ; STRUM, Marius . Functional Verification of a Cyclic Redundancy Checker RTL Module. In: X Workshop Iberchip, 2004, Cartagena de Indias. IWS´04 - seção 3b- 5 páginas, 2004. p. 1-5.
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TAVARES, L. S. ; CHAU W J ; FONSECA, F. J. . Development of a UVM Environment for the Functional Verification of a NoC Router. 2022. (Apresentação de Trabalho/Simpósio).
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TENG, C. ; CHAU W J ; FONSECA, F. J. . A Comparison of Two Banded Smith-Waterman Algorithms for Hardware Acceleration. 2022. (Apresentação de Trabalho/Simpósio).
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Jiang Chau, Wang . Palestra- Estilos Arquiteturais. 2019. (Apresentação de Trabalho/Conferência ou palestra).
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Jiang Chau, Wang . Arquitetura de CIs Digitais. 2018. (Apresentação de Trabalho/Conferência ou palestra).
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Jiang Chau, Wang ; SILVA NOVAES, GUILHERME APOLINARIO . Redes intrachip (NoCs) e de algoritmos de otimização associados.. 2017. (Apresentação de Trabalho/Conferência ou palestra).
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CHAU W J . Multilevel Logic Minimization and Test Set Generation Using Binary Decision Diagrams. Syracuse: CASE Center Technical Report Series, 1993 (Boletim Técnico).
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WANG CHAU . Hardware: Conceitos, Tecnologias e Negócios. 2015. (Curso de curta duração ministrado/Especialização).
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WANG CHAU . Hardware: Conceitos, Tecnologias e Negócios. 2014. (Curso de curta duração ministrado/Especialização).
Projetos de pesquisa
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2013 - 2015
Redes de Comunicação Intrachip Híbridas para Sistemas Eletrônicos Integrados Seguros, Descrição: Os dois tipos de estruturas de comunicação, EC, mais usados atualmente são os barramentos hierárquicos (HBus) e as redes de comunicação intrachip (network-on-chip - NoC). Recentemente vem ganhando importância as estruturas de comunicação híbridas (hybrid-on-chip - HoC), que englobam ambos os tipos numa única EC. Entre outras promessas, as HoCs vem sendo apontadas como as estruturas de comunicação mais adequadas para os SoCs 3D (3 dimensões), uma nova tecnologia que permite integrar verticalmente os componentes de um sistema num único chip. A importância das ECs vem aumentando devido ao crescente aumento do número e complexidade de componentes processantes e aplicações que são integrados num único SoC (MPSoC). A EC é também responsável, entre outras coisas, pelo atendimento das diferentes qualidades de serviço (QoS) exigidas pelas aplicações. Outro aspecto cada vez mais importante diz respeito ao incremento da informação crítica que é capturada, armazenada e processada por um sistema. Isto faz com que a segurança se torne mais um requisito crítico de projeto. A segurança pode ser realizada tanto na estrutura de computação como na de comunicação. A inclusão de serviços de segurança na EC é atraente devido à sua capacidade de: 1) monitorar a informação transmitida; 2) detectar violações; 3) bloquear ataques; e 4) fornecer informações para diagnóstico e ativação de mecanismos de recuperação e defesa. Um conceito recentemente desenvolvido denominado de qualidade dos serviços de segurança (quality-of-security-service - QoSS) permite incluir a segurança de um sistema como uma dimensão de sua qualidade de serviço por admitir a possibilidade de se prover diferentes níveis de proteção. O projeto de uma EC exige a criação de diversos modelos em diferentes níveis de abstração que possam ser usados em diferentes etapas do projeto do sistema. Tais modelos são altamente parametrizáveis permitindo gerar uma grande variedade de instâncias (configurações) da EC. O conjunto de todas as configurações possíveis é designado por ?espaço de soluções?. Neste projeto, dois objetivos são propostos. O primeiro consiste em desenvolver dois modelos de uma HoCQoSS. Um modelo de alto nível, em SystemC no nível de transações (TLM) que permite realizar simulações funcionais logo nas primeiras etapas do projeto do SoC que serve para validar o comportamento do sistema como também para realizar estimativas de seu desempenho. O segundo modelo, de baixo nível, em VHDL sintetizável que permite avaliar seu desempenho quando mapeado sobre FPGA. Entretanto, buscar uma instância (configuração) da EC do espaço de soluções que satisfaça simultaneamente os requisitos de funcionalidade, desempenho, qualidade de serviço e de segurança próprios para cada aplicação (ou conjunto de aplicações no caso de MPSoCs) não é uma tarefa trivial. O segundo objetivo consiste em estabelecer uma metodologia que permita rapidamente explorar o espaço de soluções buscando uma que satisfaça as exigências (especificações) de cada projeto.. , Situação: Concluído; Natureza: Pesquisa. , Alunos envolvidos: Graduação: (1) . , Integrantes: Wang Jiang Chau - Integrante / M.STRUM - Coordenador / Ricardo Pires - Integrante / Martha Johanna Sepúlveda - Integrante., Financiador(es): Fundação de Amparo à Pesquisa do Estado de São Paulo - Auxílio financeiro., Número de produções C, T & A: 4
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2013 - 2015
Arcabouço Integrado de Verificação Funcional baseado em Checagem de Equivalência ESL-RTL seguido por Simulação em Testbench, Descrição: Chamada MCT/ CNPq N° 20/2013 - PNM (GM e GD). , Situação: Desativado; Natureza: Pesquisa. , Alunos envolvidos: Mestrado acadêmico: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Renan Costa Bellódi - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa.
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2006 - 2008
Desenvolvimento, Implementação e Análise de Métodos de Verificação Funcional Dirigidos por Cobertura para Circuitos Digitais (FAPESP 2006 / 52164-3), Descrição: Trata-se de projeto individual na área de técnicas de verificação funcional. A verificação funcional é uma das principais tarefas dentro do fluxo de projeto de sistemas digitais integrados, permitindo checar, a consistência após cada etapa, ou seja, verificar que o sistema sempre comporta-se de acordo com a especificação. Sabe-se que a etapa de verificação funcional é aquela, dentro do fluxo de projeto, que mais recursos humanos e de tempo consome, sendo identificada como o seu principal gargalo. Para diminuir o tempo ocupado pela verificação funcional, algumas propostas baseadas em técnicas de inteligência artificial têm sido sugeridas. São os métodos de verificação funcional dirigidos por cobertura e, por eles, a análise de cobertura identificar os aspectos da cobertura menos excitados e, daí, indicar como mudar os padrões de geração de estímulos para reduzir o tempo de obtenção de determinada cobertura global. É objetivo do presente plano de pesquisa fazer uma investigação sobre as alternativas existentes de verificação funcional dirigidas por cobertura, procurando-se implementar, em particular, as de Data Mining e redes Bayesianas, para efeitos de comparação. É um segundo objetivo, estudar comparativamente e implementar uma outra técnica, conhecida como Support Vector Machine (SVM), como também alternativa de análise da cobertura. Esta técnica, ainda não apresentada na literatura técnica relacionada à verificação funcional, tem sido considerada mais rápida e precisa que outras técnicas de aprendizado em uma série de áreas, como a de reconhecimento de padrões e bio-informática. , Situação: Concluído; Natureza: Pesquisa. , Alunos envolvidos: Graduação: (0) / Especialização: (0) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Edgar Leornardo Romero - Integrante / Carlos Castro - Integrante., Financiador(es): Fundação de Amparo à Pesquisa do Estado de São Paulo - Auxílio financeiro., Número de produções C, T & A: 6
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1999 - 2001
Desenvolvimento, Implementação e Análise de Algoritmos para Otimização de Planos de Teste de Unidades Funcionais, com Variados Graus de Paralelismo, em Circuitos BIST (FAPESP 1999/07740-0), Situação: Concluído; Natureza: Pesquisa. , Integrantes: Wang Jiang Chau - Coordenador / José Artur Quilici Gonzalez - Integrante., Financiador(es): Fundação de Amparo à Pesquisa do Estado de São Paulo - Auxílio financeiro., Número de produções C, T & A: 4
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1994 - 1997
Síntese Automática de Circuitos Integrados Digitais de Aplicação Específica VLSI (CAPES-COFECUB 163/94), Descrição: Convênio entre o Grupo de Projetos de Circuitos Integrados do LME-USP com os Grupos TIMA (INPG- Grenoble) e do LIRMM (Univ. Montpellier). Vesou no desenvolvimento de sistemas de teste e de síntese automática de circuitos junto a plataformas de síntese de alto nível.. , Situação: Concluído; Natureza: Pesquisa. , Integrantes: Wang Jiang Chau - Integrante / Marius Strum - Coordenador., Financiador(es): Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro., Número de produções C, T & A: 12
Projetos de desenvolvimento
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência e Tecnologia - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Estadual de Campinas - Cooperação / Universidade Federal da Paraíba - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência e Tecnologia - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Estadual de Campinas - Cooperação / Universidade Federal da Paraíba - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência e Tecnologia - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Estadual de Campinas - Cooperação / Universidade Federal da Paraíba - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência, Tecnologia e Inovação - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Estadual de Campinas - Cooperação / Universidade Federal da Paraíba - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Federal de Pernambuco - Outra.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência, Tecnologia e Inovação - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Estadual de Campinas - Cooperação / Universidade Federal da Paraíba - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Federal de Pernambuco - Outra.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência, Tecnologia, Inovações e Comunicações - Auxílio financeiro / Universidade de Brasília - Cooperação / Universidade Estadual de Campinas - Cooperação / Universidade Federal da Paraíba - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência, Tecnologia, Inovações e Comunicações - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Federal da Paraíba - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Estadual de Campinas - Cooperação.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência, Tecnologia, Inovações e Comunicações - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Estadual de Campinas - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Federal da Paraíba - Cooperação.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência, Tecnologia, Inovações e Comunicações - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Federal da Paraíba - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Estadual de Campinas - Cooperação.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência, Tecnologia, Inovações e Comunicações - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Estadual de Campinas - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Federal da Paraíba - Cooperação.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência, Tecnologia, Inovações e Comunicações - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Federal da Paraíba - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Estadual de Campinas - Cooperação.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IPs) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência, Tecnologia e Inovações - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Estadual de Campinas - Cooperação / Universidade Federal de Minas Gerais - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Federal da Paraíba - Cooperação.Número de orientações: 1
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2003 - 2007
Consórcio para a Formação de Talentos Humanos na Concepção e Projeto de Sistemas Digitais e Propriedade Intelectual (IP´s) (MCT/CNPq 552078/02-6), Descrição: O objetivo central deste projeto é a estruturação de uma rede de P&D na área de projeto de sistemas digitais de propriedade intelectual com o desenvolvimento de competências em projeto e validação de sistemas digitais. Estão previstos os seguintes objetivos: formação de recursos humanos em tecnologias de projeto e validação de sistemas digitais; concepção, desenvolvimento, validação e prototipação de uma plataforma "wireless" moderna (denominada Fênix) usando metodologias e ferramentas de projeto com padrão industrial, e a partir de módulos IPs desenvolvidos por cada um dos grupos participantes; disponibilidade para toda a comunidade em um repositório de núcleos (Brazil-IP), da plataforma Fênix e dos IPs que a compõem.. , Situação: Concluído; Natureza: Desenvolvimento. , Alunos envolvidos: Graduação: (2) / Especialização: (1) / Mestrado acadêmico: (1) / Mestrado profissional: (0) / Doutorado: (1) . , Integrantes: Wang Jiang Chau - Coordenador / Marius Strum - Integrante / Alexandre Ignacio Barboza - Integrante / Edgar Leonardo Romero Tobar - Integrante / Guilherme Ozari de Almeida - Integrante / Marcio Yukio Teruya - Integrante / Eduardo Correia - Integrante., Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro / Ministério da Ciência, Tecnologia e Inovações - Auxílio financeiro / Pontifícia Universidade Católica do Rio Grande do Sul - Cooperação / Universidade de Brasília - Cooperação / Universidade Estadual de Campinas - Cooperação / Universidade Federal da Paraíba - Cooperação / Universidade Federal de Pernambuco - Outra / Universidade Federal do Rio Grande do Sul - Cooperação / Universidade Federal de Minas Gerais - Cooperação., Número de produções C, T & A: 1
Histórico profissional
Endereço profissional
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Universidade de São Paulo, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos. , Av. Prof. Luciano Gualberto 158 Trav. 3, Cidade Universitária, 05508900 - São Paulo, SP - Brasil, Telefone: (11) 30910740, Ramal: 220, Fax: (11) 30915585, URL da Homepage:
Experiência profissional
2007 - Atual
Universidade de São PauloVínculo: Servidor Público, Enquadramento Funcional: Professor Associado MS_5, Carga horária: 40, Regime: Dedicação exclusiva.
1993 - 2007
Universidade de São PauloVínculo: Servidor Público, Enquadramento Funcional: Professor Doutor MS-3, Carga horária: 40, Regime: Dedicação exclusiva.
1988 - 1993
Universidade de São PauloVínculo: Servidor Público, Enquadramento Funcional: Professor Assistente MS-2, Carga horária: 40, Regime: Dedicação exclusiva.
Atividades
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09/2023
Conselhos, Comissões e Consultoria, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos.,Cargo ou função, Membro- representante dos professores associados.
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02/2019
Pesquisa e desenvolvimento, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos.,Linhas de pesquisa
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04/2018
Conselhos, Comissões e Consultoria, Escola Politécnica.,Cargo ou função, Membro da Comissão Financeira do Programa de Pós-Graduação em Engenharia Elétrica (PPGEE).
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03/2018
Ensino, Engenharia Elétrica - Ênfase em Eletrônica e Sistemas Computacionais, Nível: Graduação,Disciplinas ministradas, Projeto de Circuitos Integrado Digitais e Analógicos (PSI 3452)- nos 2os. semestres, Projeto de Sistemas Embarcados em Chip (PSI3551) - nos 1os. semestres, Projeto de Circuitos Lógicos Integrados (PSI3451) -nos 1os. semestres
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02/2017
Ensino, Direito e Tecnologia de Informação (PECE), Nível: Especialização,Disciplinas ministradas, Hardware: Conceitos, Tecnologias e Negócios
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02/2017
Extensão universitária , Escola Politécnica.,Atividade de extensão realizada, Aulas de Especialização junto ao Programa de Educação Continuada da Escola Politécnica (PECE-Poli).
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02/2010
Conselhos, Comissões e Consultoria, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos.,Cargo ou função, Membro da Comissão Coordenadora de Curso (CoC) do Departamento (suplente).
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05/2021 - 04/2023
Conselhos, Comissões e Consultoria, Escola Politécnica.,Cargo ou função, Membro da Congregação- Representante Titular dos Professores Associados.
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09/2019 - 08/2021
Conselhos, Comissões e Consultoria, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos.,Cargo ou função, Membro de Conselho Departamental - Representante dos Professores Associados.
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05/2019 - 04/2021
Conselhos, Comissões e Consultoria, Escola Politécnica.,Cargo ou função, Membro da Congregação- Representante Suplente dos Professores Associados.
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09/2014 - 05/2019
Extensão universitária , Escola Politécnica, Departamento de Engenharia Elétrica.,Atividade de extensão realizada, Apoio Didático ao Centro de Treinamento de Projetistas de Circuitos Integrados da Escola Politécnica (Programa CI Brasil do MCT).
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05/2017 - 04/2019
Conselhos, Comissões e Consultoria, Escola Politécnica.,Cargo ou função, Membro da Congregação- Representante Titular dos Professores Associados.
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03/2017 - 12/2017
Ensino, Engenharia Elétrica - Ênfase em Eletrônica e Sistemas Computacionais, Nível: Graduação,Disciplinas ministradas, Projeto de Circuitos Lógicos Integrados (PSI3451) - 1o. semestre, Projeto de Circuitos Integrado Digitais e Analógicos (PSI3452) - 2o. semestre
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03/2008 - 12/2017
Ensino, Engenharia Elétrica, Nível: Pós-Graduação,Disciplinas ministradas, Projeto de Sistemas-Sobre-Silício- Tarefas ?System Level? (PSI5899)
-
09/2015 - 09/2017
Conselhos, Comissões e Consultoria, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos.,Cargo ou função, Membro de Conselho Departamental- Representante dos Professores Associados.
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03/2017 - 06/2017
Ensino, Engenharia Elétrica - Ênfase em Sistemas Eletrônicos, Nível: Graduação,Disciplinas ministradas, Projeto de Sistemas Integrados (PSI3551)
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05/2015 - 04/2017
Conselhos, Comissões e Consultoria, Escola Politécnica.,Cargo ou função, Membro da Congregação- Representante Suplente dos Professores Associados.
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03/2013 - 12/2016
Ensino, Engenharia Elétrica - Ênfase em Sistemas Eletrônicos, Nível: Graduação,Disciplinas ministradas, Introdução ao Projeto de Circuitos Integrados Dedicados (PSI2451)- nos 1os. semestres, Projeto de CIs Semidedicados (PSI2452) - nos 2os semestres, Projeto de Sistemas Integrados (PSI3551)- nos 1os. semestres
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05/2008 - 08/2016
Conselhos, Comissões e Consultoria, Escola Politécnica.,Cargo ou função, Comissão Coordenadora de Programa de Pós-graduação em Engenharia Elétrica- membro suplente da área de microeletrônica.
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10/2012 - 12/2015
Ensino, Direito e Tecnologia de Informação (PECE), Nível: Especialização,Disciplinas ministradas, Hardware: Conceitos, Tecnologias e Negócios
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10/2012 - 12/2015
Extensão universitária , Escola Politécnica.,Atividade de extensão realizada, Aulas de Especialização junto ao Programa de Educação Continuada da Escola Politécnica (PECE-Poli).
-
05/2013 - 04/2015
Conselhos, Comissões e Consultoria, Escola Politécnica.,Cargo ou função, Membro da Congregação- Representante Titular dos Professores Associados.
-
09/2007 - 09/2013
Conselhos, Comissões e Consultoria, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos.,Cargo ou função, Membro de Conselho Departamental- Representante dos Professores Associados.
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03/2010 - 07/2013
Ensino, Engenharia Elétrica, Nível: Graduação,Disciplinas ministradas, Práticas de Eletricidade e Eletrônica I (PSI2221) - 1os. semestres
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05/2009 - 04/2013
Conselhos, Comissões e Consultoria, Escola Politécnica.,Cargo ou função, Membro da Congregação- Representante Suplente dos Professores Associados.
-
06/2008 - 12/2012
Ensino, Engenharia Elétrica - Ênfase em Sistemas Eletrônicos, Nível: Graduação,Disciplinas ministradas, Introdução ao Projeto de Sistemas Integrados (PSI3551)- nos 1os. semestres, Projeto de CIs Semidedicados (PSI2452) - nos 2os. semestres
-
03/2006 - 12/2010
Ensino, Engenharia Elétrica, Nível: Pós-Graduação,Disciplinas ministradas, Síntese Lógica em Projeto de Circuitos e Ferramentas Associadas (PSI5742)
-
03/1988 - 12/2010
Pesquisa e desenvolvimento, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos.,Linhas de pesquisa
-
03/2009 - 12/2009
Ensino, Engenharia Elétrica, Nível: Graduação,Disciplinas ministradas, Práticas de Eletricidade e Eletrônica I (PSI2221)- 1o. semestre, Práticas de Eletricidade e Eletrônica II (PSI2222)- 2o. semestre
-
03/2003 - 07/2008
Ensino, Engenharia Elétrica, Nível: Graduação,Disciplinas ministradas, Práticas de Eletricidade e Eletrônica I (PSI2221) - nos 1os. semestres
-
03/2003 - 06/2008
Ensino, Engenharia Elétrica - Ênfase em Sistemas Eletrônicos, Nível: Graduação,Disciplinas ministradas, Introdução ao Projeto de Circuitos Integrados Dedicados (PSI2451)- nos 1os. semestres, Projeto de Circuitos Integrados Semidedicados (PSI2452)- nos 2os. semestres, Projeto de Sistemas Integrados (PSI2553) - nos 1os. semestres
-
11/2003 - 10/2005
Conselhos, Comissões e Consultoria, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos.,Cargo ou função, Membro de Conselho Departamental- Representante de Professores Doutores.
-
03/1994 - 06/2004
Ensino, Engenharia Elétrica, Nível: Pós-Graduação,Disciplinas ministradas, Projeto de Sistemas-Sobre-Silício- Tarefas ?System Level? (PSI5899)- desde 08, Síntese Lógica em Compilação de Silício (PEE742/5742)- de 94 a 04, Síntese Lógica em Projeto de Circuitos e Ferramentas Associadas (PSI5742)- desde 06
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03/2002 - 12/2002
Ensino, Engenharia Elétrica - Ênfase em Sistemas Eletrônicos, Nível: Graduação,Disciplinas ministradas, Introdução ao Projeto de Circuitos Integrados Dedicados (PSI2451)- nos 1os. semestres, Projeto de CIs Semidedicados (PSI2452) - nos 2o. semestre
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08/2001 - 06/2002
Ensino, Engenharia Elétrica - Ênfase em Microeletrônica, Nível: Graduação,Disciplinas ministradas, Estágio Supervisionado (PEE700) - nos 1os. semestres, Teste e Testabilidade de Circuitos Integrados (PEE 654)- nos 1os. semestres
-
03/2001 - 06/2002
Ensino, Engenharia Elétrica, Nível: Graduação,Disciplinas ministradas, Laboratório de Eletricidade I (PSI2315)- nos 1os. semestres, Práticas de Eletricidade e Eletrônica I (PSI2221) - nos 1os. semestres
-
11/1999 - 10/2001
Conselhos, Comissões e Consultoria, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos.,Cargo ou função, Membro de Conselho Departamental- Representante dos Professores Doutores.
-
11/1999 - 10/2001
Conselhos, Comissões e Consultoria, Escola Politécnica.,Cargo ou função, Membro de comissão permanente- Comissão de Graduação.
-
03/1999 - 06/2001
Ensino, Engenharia Elétrica - Ênfase em Microeletrônica, Nível: Graduação,Disciplinas ministradas, Estágio Supervisionado (PEE700) - nos 1os. semestres, Laboratório de Projeto de Circuitos Integrados (PEE446) - nos 1os. semestres, Teste e Testabilidade de Circuitos Integrados (PEE 654)- nos 1os. semestres, Projeto de Formatura (PEE607) - nos 2os. semestres
-
07/2000 - 12/2000
Ensino, Engenharia Elétrica - Ênfase em Telecomunicações, Nível: Graduação,Disciplinas ministradas, Projeto de CIs para Telecomunicações (PEE605)
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03/2000 - 06/2000
Ensino, Engenharia Elétrica, Nível: Graduação,Disciplinas ministradas, Práticas de Eletricidade e Eletrônica I (PSI2221)
-
05/1997 - 04/1999
Conselhos, Comissões e Consultoria, Escola Politécnica, Departamento de Engenharia Elétrica.,Cargo ou função, Membro de Conselho Departamental- Representante dos Professores Doutores.
-
08/1995 - 12/1998
Ensino, Engenharia Elétrica - Ênfase em Microeletrônica, Nível: Graduação,Disciplinas ministradas, Laboratório de Projeto de Circuitos Integrados (PEE446) - nos 1os. semestres, Estágio Supervisionado (PEE700) - nos 1os. semestres, Projeto de Formatura (PEE607) - nos 2os. semestres
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07/1994 - 12/1996
Ensino, Engenharia Elétrica - Ênfase em Computação, Nível: Graduação,Disciplinas ministradas, Projeto de Cicruitos Integrados (PEE605)- 94 a 96 nos 2os. semestres
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03/1993 - 06/1995
Ensino, Engenharia Elétrica - Ênfase em Microeletrônica, Nível: Graduação,Disciplinas ministradas, Estágio Supervisionado (PEE700) -1os. semestres, Laboratório de Projeto de Circuitos Integrados (PEE446) -1os. semestres
Criando um monitoramento
Nossos robôs irão buscar nos nossos bancos de dados todos os processos de Wang Jiang Chau e sempre que o nome aparecer em publicações dos Diários Oficiais, avisaremos por e-mail e pelo painel do usuário
Criando um monitoramento
Nossos robôs irão buscar nos nossos bancos de dados todas as movimentações desse processo e sempre que o processo aparecer em publicações dos Diários Oficiais e nos Tribunais, avisaremos por e-mail e pelo painel do usuário
Confirma a exclusão?